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硬件描述語(yǔ)言(hdl)
硬件描述語(yǔ)言(hdl) 文章 進(jìn)入硬件描述語(yǔ)言(hdl)技術(shù)社區
用硬件描述語(yǔ)言設計復雜數字電路的優(yōu)點(diǎn)
- 以前的數字邏輯電路及系統的規模的比較小而且簡(jiǎn)單，用電路原理圖輸入法基本足夠了。但是一般工程師需要手工布線(xiàn)，需要熟悉器件的內部結構和外部引線(xiàn)特點(diǎn)，才能達到設計要求，這個(gè)工作量和設計周期都不是我們能想象的?，F在設計要求的時(shí)間和周期都很短，用原理圖這個(gè)方法顯然就不符合實(shí)際了。
- 關(guān)鍵字： Verilog HDL 虛擬接口聯(lián)盟
基于CPLD/FPGA的出租車(chē)計費系統
- 介紹了出租車(chē)計費器系統的組成及工作原理，簡(jiǎn)述了在EDA平臺上用單片CPLD器件構成該數字系統的設計思想和實(shí)現過(guò)程。論述了車(chē)型調整模塊、計程模塊、計費模塊、譯碼動(dòng)態(tài)掃描模塊等的設計方法與技巧。
- 關(guān)鍵字： CPLD／PPGA 硬件描述語(yǔ)言 出租車(chē)計費器 MAX+PLUS軟件 數字系統
基于FPGA的自適應均衡器的研究與設計
- 摘要：近年來(lái)，自適應均衡技術(shù)在通信系統中的應用日益廣泛，利用自適應均衡技術(shù)在多徑環(huán)境中可以有效地提高數字接收機的性能。為了適應寬帶數字接收機的高速率特點(diǎn)，本文闡述了自適應均衡器的原理并對其進(jìn)行改進(jìn)。最
- 關(guān)鍵字： 自適應均衡器 寬帶數字接收機 FPGA Verilog HDL
基于FPGA的GPS數據采集器的設計與實(shí)現
- 全球定位系統(Clobal Position System，GPS)能夠提供實(shí)時(shí)、全天候、全球性和高精度的服務(wù)，其廣泛應用于各行各業(yè)中。GPS接收機通過(guò)天線(xiàn)單元接收衛星信號，將信號進(jìn)行帶通濾波、下變頻混頻、AGC放大、A/D轉換等一系
- 關(guān)鍵字： NMEA-0183協(xié)議 現場(chǎng)可編程門(mén)陣列 硬件描述語(yǔ)言 協(xié)議解析
基于FPGA的高速長(cháng)線(xiàn)陣CCD驅動(dòng)電路
- 高速長(cháng)線(xiàn)陣CCD(電荷耦合器)具有低功耗，小體積，高精度等優(yōu)勢，廣泛應用于航天退掃系統中的圖像數據采集。而CCD驅動(dòng)電路設計是CCD正常工作的關(guān)鍵問(wèn)題之一，CCD驅動(dòng)信號時(shí)序是一組相位要求嚴格的脈沖信號，只有時(shí)序信
- 關(guān)鍵字： CCD 線(xiàn)陣 FPGA verilog HDL
基于Verilog HDL的SVPWM算法的設計與仿真
- 摘要：空間矢量脈寬調制算法是電壓型逆變器控制方面的研究熱點(diǎn)，廣泛應用于三相電力系統中?；谟布腇PGA/CPLD芯片能滿(mǎn)足該算法對處理速度、實(shí)時(shí)性、可靠性較高的要求，本文利用Verilog HDL實(shí)現空間矢量脈寬調制算
- 關(guān)鍵字： 同步電動(dòng)機 電壓型逆變器 Verilog HDL
一種高效網(wǎng)絡(luò )接口的設計
- 為了得到比傳統片上網(wǎng)絡(luò )的網(wǎng)絡(luò )資源接口(NI)更高的數據傳輸效率和更加穩定的數據傳輸效果，提出了一種新的高效網(wǎng)絡(luò )接口的設計方法，并采用Verilog HDL語(yǔ)言對相關(guān)模塊進(jìn)行編程，實(shí)現了高效傳輸功能，同時(shí)又滿(mǎn)足核內路由的設計要求。最終通過(guò)仿真軟件Xilinx ISE Design Suite 12．3和ModelSim SE 6．2b得到了滿(mǎn)足設計要求的仿真結果。
- 關(guān)鍵字： 片上網(wǎng)絡(luò ) 網(wǎng)絡(luò )資源接口 核內路由 Verilog HDL
基于CPLD的LCD1602顯示系統設計與實(shí)現
- 摘要：為了提高LCD1602顯示效果，增強抗擾能力，文章基于TOP2812開(kāi)發(fā)板，依據LCD1602操作時(shí)序要求，在開(kāi)發(fā)板CPLD部分實(shí)現了LCD1602顯示系統的設計。文中對
- 關(guān)鍵字： LCD1602 顯示系統 時(shí)序 Vetilog HDL
混合同余法產(chǎn)生隨機噪聲的FPGA實(shí)現
- 混合同余法產(chǎn)生隨機噪聲的FPGA實(shí)現,摘要：隨著(zhù)電子對抗技術(shù)的快速發(fā)展，在有源式干擾機中需要用到數字高斯白噪聲。通過(guò)對混合同余法產(chǎn)生隨機序列的原理研究，本文提出了一種利用FPGA產(chǎn)生高斯白噪聲的方法。該方法在PC主控端的控制下，采用ROM查找表的方
- 關(guān)鍵字： 高斯白噪聲 混合同余法 FPGA Verilog HDL
硬件描述語(yǔ)言(hdl)介紹
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歡迎您創(chuàng )建該詞條，闡述對硬件描述語(yǔ)言(hdl)的理解，并與今后在此搜索硬件描述語(yǔ)言(hdl)的朋友們分享。 創(chuàng )建詞條
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