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EEPW首頁(yè) >> 主題列表 >> 數字信號處理

本土廠(chǎng)商難舍DSP情懷

  • 1948 年貝爾實(shí)驗室的克勞德·香農 (Claude Shannon) 發(fā)表了他具有里程碑意義的論文——《通信的數學(xué)理論》(A Mathematical Theory of Communication),該論文明確闡述了可實(shí)現的比特率、信道帶寬和信噪比之間的關(guān)系。這是DSP(digital signal processing)的元年??梢哉f(shuō),香濃的這篇論文開(kāi)拓了一個(gè)新紀元。但具體到硬件方面,此時(shí)距離第一顆DSP芯片面世還有很多年。因為哪怕是最基本的IC,也需要10年后才由TI的Jack Kilby發(fā)明。但
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精通信號處理設計小Tips(8):檢測淹沒(méi)在噪聲中的信號

  • 精通信號處理設計小Tips(8):檢測淹沒(méi)在噪聲中的信號-相關(guān)函數的應用很廣,比如噪聲中信號的檢測,信號中隱含周期性的檢測,信號時(shí)延長(cháng)度的測量等等。這一節專(zhuān)門(mén)討論利用自相關(guān)函數檢測淹沒(méi)在噪聲下的周期性信號。
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精通信號處理設計小Tips(7):應用極其廣泛的相關(guān)

  • 精通信號處理設計小Tips(7):應用極其廣泛的相關(guān)-相關(guān)不僅是一個(gè)非常有理論價(jià)值的概念,而且是一個(gè)在實(shí)踐中應用極為廣泛的處理方法和有效的處理手段。在通信接收機的同步檢測,導航,定位,電子偵察,延時(shí)估計,譜估計等方面有著(zhù)廣泛的應用。后面系列文章,將風(fēng)別結合實(shí)際應用,列舉數例一一說(shuō)明。
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精通信號處理設計小Tips(6):卷積是怎么得到的?

  • 精通信號處理設計小Tips(6):卷積是怎么得到的?-卷積是信號處理的一個(gè)基本概念,它的體現最重要的一個(gè)方面,也許就是下面這句話(huà)了:時(shí)域的卷積對應頻域的相乘。這句話(huà),或者說(shuō),這個(gè)概念,在很多應用會(huì )得到充分的體現,比如頻域均衡,比如信道估計,比如濾波分析等等。
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工程師須知:FPGA 的演進(jìn)、優(yōu)勢、設計、改進(jìn)

  • 工程師須知:FPGA 的演進(jìn)、優(yōu)勢、設計、改進(jìn)-1989年我第一次接觸到電路板的時(shí)候,上面密布著(zhù)一系列的TTL、CMOS芯片,一顆14~20只管腳的芯片中一般只有4-6個(gè)簡(jiǎn)單的“門(mén)”,十幾個(gè)芯片的大板子也就完成尋址、譯碼之類(lèi)的功能,使用起來(lái)是非常的痛苦,如果要修改邏輯,只能用手術(shù)刀切割電路板并進(jìn)行飛線(xiàn)。
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mcu,DSP,PLD/EDA的介紹/比較/分析

基于FPGA的915 MHz射頻讀卡器設計

  • 參照ISO/IEC 18000-6 Type B 協(xié)議設計了一款工作頻率為915 MHz的射頻讀卡器,采用FPGA完成協(xié)議中規定的數字信號處理,C8051F020單片機作為主控器。利用Verilog HDL硬件描述語(yǔ)言,搭建FPGA內部各個(gè)小模塊及系統的驗證平臺,選用Altera公司Cyclone系列的EP1C6Q240C8芯片為目標器件,使用Quartus II進(jìn)行綜合,并通過(guò)時(shí)序和功能驗證。
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Xilinx助力邁信成功推出POWERLINK主站

  • 基于賽靈思Zynq All Programmable SoC的解決方案幫助中國武漢邁信電氣技術(shù)有限公司大大降低了開(kāi)發(fā)難度,同時(shí)大幅加速了開(kāi)發(fā)進(jìn)程,使得中國武漢邁信電氣技術(shù)有限公司成為市場(chǎng)上POWERLINK主站的首家中國供應商。2013
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FPGA雙雄公布季度財報數據顯示一片光明

  • FPGA供應商Altera和賽靈思近日陸續公布了健康的財務(wù)數據。Altera公司四季度銷(xiāo)售額為4.544億美元,環(huán)比增長(cháng)2%同比增長(cháng)3%。賽靈思則為5.87億美元,環(huán)比下降了2%,但是同比激增15%。“受益于Kintex 7系列產(chǎn)品的熱
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基于PIC32的數字渦街流量計設計方案

  • 研究背景與意義1.渦街流量計概述當流體中安放一個(gè)非流線(xiàn)型旋渦發(fā)生體時(shí),流體將會(huì )在發(fā)生體兩側交替分離,并釋放出兩串規則的交錯排列的旋渦。在一定范圍內,旋渦分離頻率與流量成正比。根據這種原理實(shí)現流量測量的流
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基于DSP及FPGA的水下目標定位系統數字信號處理模塊設計

  • 隨著(zhù)水下武器和水下航行器等水下目標的快速發(fā)展,對其進(jìn)行定位和跟蹤從而檢驗其性能的試驗具有非常重要的意義,這也是水下目標試驗場(chǎng)的重要工作內容。水下試驗場(chǎng)的定位系統根據被測目標是否加裝合作聲信標,可以分為
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從業(yè)績(jì)來(lái)看,賽靈思已經(jīng)遠遠領(lǐng)先于A(yíng)ltera

  • Altera和賽靈思20年來(lái)都在FPGA這個(gè)窄眾市場(chǎng)激烈的競爭者,然而Peter Larson基于對兩個(gè)公司現金流折現法的研究表明,賽靈思是目前FPGA市場(chǎng)的絕對領(lǐng)先者。(http://seekingalpha.com/article/2008621-xilinx-appears-
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FPGA:縱向創(chuàng )新與橫向整合引領(lǐng)變革

  • FPGA在先進(jìn)工藝路上的狂飚猛進(jìn)帶來(lái)了如影隨形的挑戰:一方面,進(jìn)入20nm和14nm階段后,不光是FPGA復雜度提升,對其外圍的電源管理等芯片也提出了“與時(shí)俱進(jìn)”的要求。另一方面,隨著(zhù)SoC FPGA和3D IC技術(shù)
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硬核浮點(diǎn)DSP的FPGA或取代高性能計算GPGPU

  • 近來(lái),Altera公司推出業(yè)界首款浮點(diǎn)FPGA,它集成了硬核IEEE754兼容浮點(diǎn)運算功能,提高了DSP性能、設計人員的效能和邏輯效率。據悉,硬核浮點(diǎn)DSP模塊集成在A(yíng)ltera20nmArria10FPGA和SoC中,以及14nmStratix10FPGA和SoC
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DSP和FPGA各顯神通,應對TD-SCDMA基站成本和演進(jìn)需求

  • 由于運營(yíng)商大手筆進(jìn)行基礎設施建設的時(shí)代已經(jīng)過(guò)去,成本和靈活性成為對通信基礎設施的共同要求,對于TD-SCDMA基站更是如此。因為采用了智能天線(xiàn)等先進(jìn)技術(shù),TD基站的容量大幅提升,但也還帶來(lái)了成本挑戰;另外,TD技術(shù)
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數字信號處理介紹

  數字信號處理的定義   數字信號處理是將信號以數字方式表示并處理的理論和技術(shù)。數字信號處理與模擬信號處理是信號處理的子集。   數字信號處理的目的是對真實(shí)世界的連續模擬信號進(jìn)行測量或濾波。因此在進(jìn)行數字信號處理之前需要將信號從模擬域轉換到數字域,這通常通過(guò)模數轉換器實(shí)現。而數字信號處理的輸出經(jīng)常也要變換到模擬域,這是通過(guò)數模轉換器實(shí)現的。   數字信號處理的算法需要利用計算機或專(zhuān)用處理設 [ 查看詳細 ]
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