應用HyperLynx解決高速采集板中阻抗匹配的問(wèn)題

本次設計中高速數據采集板的技術(shù)指標如下：a)垂直分辨率12bit;b)雙通道同時(shí)工作交替采樣，單通道采樣率為500MSPS;c)有效分辨率位數大于等于10bits;d)信噪比SNR>62dB。該采集板系統的主要器件有ADC芯片，時(shí)鐘芯片和通道上的模擬放大器和濾波器。

　　通過(guò)對性能指標的綜合分析，我們選擇ADS5463為我們的ADC芯片，AD9517-3為時(shí)鐘芯片。數據采集板中遇到的阻抗匹配問(wèn)題主要集中在這兩個(gè)芯片上。

　　ADS5463的采樣率為500MSPS，垂直分辨率為12bits，有效分辨位數為10.5bits。ADS5463的時(shí)鐘信號輸入幅值范圍很寬，輸入的時(shí)鐘信號峰峰值最大可達到3伏。ADS5463的信噪比和時(shí)鐘信號的幅度、共模電壓的大小、溫度以及供電電壓的紋波等因素有關(guān)。其中時(shí)鐘信號的幅度對信噪比影響較大，時(shí)鐘信號的峰峰值越高信噪比越高。數據輸出的格式為L(cháng)VDS電平。

　　AD9517為可編程的12通道的時(shí)鐘產(chǎn)生器。AD9517內置有2GHz的VCO，可產(chǎn)生最高800MHz的LVDS時(shí)鐘信號以及1.6GHz的LVPECL時(shí)鐘信號。通過(guò)對寄存器的設置可以產(chǎn)生不同電平標準以及不同頻率的時(shí)鐘輸出信號。

　　為了盡量增大ADS5463的信噪比，AD9517的輸出時(shí)鐘采用LVPECL電平。LVPECL的信號擺幅為800mV，輸出阻抗很低，因此它有很強的驅動(dòng)能力。ADS5463的輸出為L(cháng)VDS電平、AD9517的輸出為L(cháng)VPECL電平，二者均為差分信號。為了控制差分線(xiàn)的阻抗并且找到一個(gè)良好的端接方案，下面引出差分阻抗的定義。

　　差分線(xiàn)的阻抗

　　對于FR4材料的邊緣耦合微帶線(xiàn)，差分阻抗近似為：

　　式中，Zdiff表示差分阻抗，單位為Ω;Z0表示未耦合時(shí)的單端特性阻抗;s表示信號線(xiàn)邊沿的間距，單位是mil;h表示信號線(xiàn)與返回路徑平面間的介質(zhì)厚度;FR4介質(zhì)的介電常數決定了式中的兩個(gè)系數0.48、0.96。

　　對于FR4材料的邊緣耦合帶狀線(xiàn)，差分阻抗近似為：

　　式中，FR4介質(zhì)的介電常數決定了式中的兩個(gè)系數0.37、2.9，b表示平面間總的介質(zhì)厚度，其余同公式(1)。

　　傳輸線(xiàn)中，導線(xiàn)引起的總衰減為：

　　式中，Len表示傳輸線(xiàn)的長(cháng)度，單位為in;Z0表示傳輸線(xiàn)的特征阻抗，單位為Ω;w表示線(xiàn)寬，單位為mil;f表示正弦波頻率分量，單位為GHz;Acond表示導線(xiàn)引起的總的衰減，單位是dB;36這個(gè)參數和FR4介質(zhì)的介質(zhì)耗散因子tan(δ)有關(guān)，FR4的介質(zhì)耗散因子tan(δ)為0.02。