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基于HyperLynx的高速PECL交流耦合時(shí)鐘
- 隨著(zhù)電子技術(shù)的不斷發(fā)展，數據的傳輸速度越來(lái)越快，高速時(shí)鐘的應用日益廣泛，如何保證時(shí)鐘在高速跳變過(guò)程中的信號完整性、抖動(dòng)、功耗等問(wèn)題，已逐漸成為關(guān)注的問(wèn)題。傳統的時(shí)鐘設計方法大多依靠經(jīng)驗和理論計算，但是隨著(zhù)時(shí)鐘頻率越來(lái)越高，時(shí)鐘的電磁環(huán)境日趨復雜，時(shí)鐘的傳輸線(xiàn)效應、過(guò)沖／欠沖、反射、振鈴效應、趨膚效應都成為影響時(shí)鐘設計的關(guān)鍵因素，只有使用現代科技手段，利用計算機的強大計算能力進(jìn)行仿真才能夠保證時(shí)鐘電路設計成功。 HyperLynx是Mentor(Graphics開(kāi)發(fā)的一款板級信號完整性的仿真工具。它可以進(jìn)行
- 關(guān)鍵字： HyperLynx PECL 交流耦合 時(shí)鐘
高速數字電路的設計與仿真
- 摘要：介紹了專(zhuān)用于高速數字電路的仿真工具Hyperlynx，并使用它對高速數字電路中的阻抗匹配、傳輸線(xiàn)長(cháng)度與串擾問(wèn)題進(jìn)行布線(xiàn)前的模型建立和仿真，通過(guò)仿真結果分析給出了相應解決辦法，尤其在傳輸線(xiàn)長(cháng)度上提供了LVDS電路的解決辦法。通過(guò)軟件平臺對電路參數的設置進(jìn)行比較與分析，給出了高速數字電路設計的指導性結論。 關(guān)鍵詞：信號完整性；高速電路；PCB；Hyperlynx，IBIS 高速數字系統設計成功的關(guān)鍵在于保持信號的完整，而影響信號完整性(即信號質(zhì)量)的因素主
- 關(guān)鍵字： 設計 仿真 Hyperlynx 信號完整性 高速電路 PCB IC電路板測試 PCB
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