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利用FPGA實(shí)現HDB3編解碼功能

作者： 時(shí)間：2010-03-16 來(lái)源：網(wǎng)絡(luò ) 收藏

3．1．2 V碼和B碼解碼過(guò)程
檢測V碼后，根據HDB3編碼規則，只需將V碼及之前3位碼全部置零就可同時(shí)完成扣V／扣B操作。這又會(huì )涉及到一個(gè)由現在事件狀態(tài)決定過(guò)去事件狀態(tài)的情況，仍可采用兩組4位移位寄存器解決。根據編碼規則，V碼是取代連“0”串中的第4個(gè)“0”，而B(niǎo)碼總是出現在V碼之前，且只相隔兩個(gè)“O”，當輸入是V碼后，只需同時(shí)將4位移位寄存器置零，即可同時(shí)完成V碼和B碼的解碼過(guò)程?？鄢齎碼和B碼后，還需將雙相碼變換成單相碼，即當輸入是“00”時(shí)輸出“0”，輸入是“01”時(shí)輸出“l(fā)”，至此便完成了HDB3解碼。
3．2 HDB3解碼的Verilog HDL實(shí)現
以下利用硬件描述語(yǔ)言實(shí)現解碼功能，這里只給出正V碼檢測模塊和扣V碼／扣B碼模塊的關(guān)鍵程序。

本文引用地址：http://dyxdggzs.com/article/191774.htm

關(guān)鍵詞： FPGA HDB3 編解碼

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