簡(jiǎn)易USB與LVDS接口轉換器
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時(shí)間：2009-09-03
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技術(shù)方案與實(shí)用技巧
FPGA編程只需通過(guò)控制引腳，控制兩個(gè)并行信號的輸入輸出即可，同時(shí)可將數據的讀寫(xiě)操作模塊化，從而進(jìn)一步簡(jiǎn)化系統編程。
系統軟件設計流程如同6所示。由于遵循USB協(xié)議，在一段時(shí)間不進(jìn)行任何操作時(shí)則進(jìn)入低功耗模式。而USB3300也擁有這一特性。在一定時(shí)間系統不進(jìn)行任何的讀寫(xiě)操作，USB3300將進(jìn)入低功耗模式，此時(shí)USB3300會(huì )自動(dòng)關(guān)閉鎖相環(huán)時(shí)鐘輸出。本文引用地址：http://dyxdggzs.com/article/181241.htm
所以在系統啟動(dòng)后，首先判斷USB3300的狀態(tài)，如果在低功耗模式下，則控制STP信號開(kāi)啟內部時(shí)鐘，進(jìn)入到同步模式。
設備連接成功后，隨時(shí)判斷是否應該進(jìn)行讀寫(xiě)操作，若需要，則進(jìn)入讀寫(xiě)操作模塊，實(shí)現讀寫(xiě)操作后又開(kāi)始判斷讀寫(xiě)。等待一段時(shí)間不執行讀寫(xiě)操作后，USB3300則進(jìn)入低功耗模式，關(guān)閉鎖相環(huán)，等待下次讀寫(xiě)操作時(shí)再重新啟動(dòng)內部時(shí)鐘。
5 結論
采用專(zhuān)用轉換器USB3300，SN65LV1023，SN65LV1224分別將USB協(xié)議物理層的差分信號和LVDS的低壓差分信號轉換成并行信號，并通過(guò)FPGA編程實(shí)現協(xié)議編程的轉換。該系統設計較為簡(jiǎn)單，并且系統拓展較簡(jiǎn)單，可易于實(shí)現USB接口、LVDS接口對多種接口的轉換。
由于串口通信協(xié)議的物理層信號較為復雜，FPGA直接與其物理層信號進(jìn)行數據交互比較難以實(shí)現，難以做到時(shí)序同步，而采用專(zhuān)用的轉換器將串行信號轉換成并行數據信號，則大大簡(jiǎn)化邏輯門(mén)陣列編程。該系統合理使用USB3300和SN65LV1023與SN65LV1224接口器件使得邏輯門(mén)陣列的編程易于實(shí)現，也可使用其他的專(zhuān)用轉換器，實(shí)現不同接口的轉換。
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