基于FPGA的圖像采集系統設計與實(shí)現

1、引言

視頻圖像采集是視頻信號處理系統的前端部分，正在向高速、高分辨率、高集成化、高可靠性方向發(fā)展。圖像采集系統在當今工業(yè)、軍事、醫學(xué)各個(gè)領(lǐng)域都有著(zhù)極其廣泛的應用，如使用在遠程監控、安防、遠程抄表、可視電話(huà)、工業(yè)控制、圖像模式識別、醫療器械等各個(gè)領(lǐng)域都有著(zhù)廣泛的應用[1]。本文介紹了一種基于FPGA的圖像采集系統，用戶(hù)可以根據需要對FPGA 內部的邏輯模塊和I/O模塊重新配置,以實(shí)現系統的重構[1][2]；而且采用這種設計方案 ,便于及時(shí)地發(fā)現設計中的錯誤,能夠有效地縮短研發(fā)時(shí)間，提高工作效率。

2、系統的總體框架和工作原理

整個(gè)系統主要分為四個(gè)模塊：視頻解碼模塊、視頻編碼模塊、存儲器模塊和FPGA核心控制模塊，系統總體框架如圖1所示。

圖1 系統的總體框圖

其中FPGA實(shí)現的主要功能有：視頻編解碼器件的初始化，視頻圖像的采集存儲以及將采集的圖像數據通過(guò)視頻編碼芯片送到監視器上顯示。

系統的工作原理為：系統上電后，FPGA通過(guò)FLASH中的程序對完成視頻解碼和編碼芯片的初始化配置；在接到視頻AD轉換的中斷信號后，FPGA將轉換的數字圖像數據傳送到SRAM保存；一幀圖像轉換結束后FPGA再將SRAM中的數字圖像傳遞給視頻編碼芯片以便在監視器上顯示，同時(shí)開(kāi)始控制下一幀圖像的采集。

3、硬件電路設計

3.1 AD和DA轉換模塊

本系統采用的視頻編解碼芯片是ADV7181和ADV7177，下面分別介紹AD和DA轉換器件的硬件電路設計。

3.1.1 AD轉換模塊

ADV7181系統是AD公司推出的一款視頻解碼芯片[3]，它具有如下特點(diǎn)： I2C總線(xiàn)接口，6通道模擬視頻輸入，支持NTSC、PAL、SECAM視頻制式，支持多種模擬輸入格式和多種數字輸出格式。

本系統中選用其中的通道1作為PAL制CVBS視頻輸入，數據輸出可根據需要采用8位或16位的格式輸出。ADV7181與FPGA的接口電路如圖2所示。

圖2 ADV7181與FPGA的接口電路

系統上電后通過(guò)FPGA的I2C模塊完成對ADV7181的初始化配置，其中ADC_SCLK、ADC_SDATA分別為I2C總線(xiàn)的時(shí)鐘線(xiàn)和數據線(xiàn)。ADV7181正常工作后分別輸出水平同步信號ADV_HS、垂直同步信號ADV_VS、 場(chǎng)同步信號ADV_FIELD、中斷信號ADC_/INTRQ、ADC_LLC同步信號和圖像數據信號ADC_DATA(8位或16位可配置輸出)，另外ADC_/PWRDN信號控制ADV7181是否工作于省電模式。用戶(hù)可以根據需要選擇水平、垂直和場(chǎng)同步信號（CCIR-601格式）或ADC¬_LLC信號（CCIR-656格式）來(lái)實(shí)現系統與視頻輸入的同步，并利用這些同步信號控制對轉換完成的視頻數據的寫(xiě)存儲器操作。

3.1.2 DA轉換模塊

DA轉換采用的是AD公司的ADV7177[4]，它具有如下特點(diǎn)：I2C接口，3路模擬視頻輸出，支持多種數字輸入格式和多種模擬輸出格式，用戶(hù)可根據需要選擇使用。它的電路設計與ADV7181類(lèi)似，ADV7177與FPGA的接口電路如圖3所示。

圖3 ADV7177與FPGA的接口電路

其中DAC_DATA為輸入數字視頻信號，DAC_/HSYNC、DAC_/VSYNC分別為水平和垂直同步信號，DAC_CLOCK2為ADV7177輸出的27M或13.5M同步時(shí)鐘( 與寄存器的配置數據有關(guān))，DAC_SCLK、DAC_SDATA為ADV7177的I2C配置總線(xiàn)。

3.2 FPGA核心控制模塊

FPGA核心控制模塊采用的是ALTERA公司Cyclone II系列的EP2C20[5]，它具有較高的性?xún)r(jià)比：EP2C20最多用戶(hù)管腳數為315，四個(gè)PLL，26個(gè)嵌入式18*18乘法器，52個(gè)M4K RAM塊，186752個(gè)邏輯單元；共分8個(gè)I/O Bank，每個(gè)Bank可以根據需要配置為1.2V或3.3V的I/O電平，方便與外圍電路連接?？紤]到系統的實(shí)際需求，在該系統中采用具有240個(gè)引腳PQFP封裝的EP2C20Q240。

在該系統中，FPGA主要完成對視頻AD、DA的初始化配置和存儲器的讀寫(xiě)控制，它通過(guò)AD的中斷信號完成對視頻數據的采集，并將采集的數據放到存儲模塊中，當采集完一幀后將數據傳遞給視頻編碼芯片并在監視器上顯示同時(shí)開(kāi)始采集下一幀圖像。

在本系統中FPGA采用了JTAG和AS兩種配置模式，具體的設計可參考ALTERA數據手冊[5]。

3.3 存儲器及其他模塊

由于FPGA芯片內部的RAM資源有限，不能存儲過(guò)多的視頻數據并對其進(jìn)行處理，因此在本系統設計中，外加了兩片SRAM芯片來(lái)輔助FPGA進(jìn)行視頻信號采集。兩片SRAM可以進(jìn)行16位的數據存儲，這樣ADV7181和ADV7177可以根據需要配置為8位或16位數據的工作模式，提高了系統的靈活性。

本系統設計中采用的SRAM芯片是美國IDT公司生產(chǎn)的IDT71V424[6]，它是采用高性能與可靠性的CMOS工藝生產(chǎn)的高速靜態(tài)存儲器，其單片存儲容量為512K*8Bit，具有高速的訪(fǎng)問(wèn)時(shí)間，10或12ns。其內部完全由靜態(tài)異步電路構成，無(wú)需輸入時(shí)鐘信號，也不必對芯片進(jìn)行刷新，即可直接對無(wú)用數據進(jìn)行覆蓋。

在實(shí)際的設計中為了保證控制信號的有效性，3條控制線(xiàn)SRAM_/WE、SRAM_/OE, SRAM_/CS分別加了一個(gè)4.7K的上拉電阻后才與FPGA芯片連接。具體電路如圖4所示：

圖4 SRAM與FPGA的接口電路

此外，為了減少模擬與數字系統之間的相互干擾，電源模塊采用的是數字電源和模擬電源分開(kāi)設計最后一點(diǎn)共地的設計方案。主要采用了TI公司的TPS54612、TPS64616分別提供FPGA 1.2V核心電壓和3.3V IO電壓；模擬1.8V和3.3V采用的是AMS1117系列的電源芯片。

4、系統軟件設計

本系統軟件是在Quartus II 環(huán)境下采用Verilog語(yǔ)言開(kāi)發(fā)完成的。主要包括：1、AD和DA芯片的初始化配置，2、視頻圖像的采集，3、視頻圖像的存儲與DA轉換。