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Avago于28nm CMOS工藝達成32Gbps的SerDes性能

  • Avago Technologies (Nasdaq: AVGO)為有線(xiàn)、無(wú)線(xiàn)和工業(yè)應用模擬接口零組件領(lǐng)先供應商宣布其28nm串行/解串器(SerDes)核心已經(jīng)達到32Gbps的性能，并且可以承受高達40dB的通道損耗，這個(gè)最新的SerDes核心不僅僅重新定義了芯片到芯片、連接端口和背板等接口可達到的數據率，并且反映了Avago為數據中心和企業(yè)應用提供領(lǐng)先解決方案的持續承諾。
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優(yōu)化封裝以滿(mǎn)足SerDes應用鍵合線(xiàn)封裝規范

  • 對于10Gbps及以上數據速率的SerDes，每個(gè)數據位的單位間隔是隨著(zhù)近 20～30ps的信號上升/下降時(shí)間而縮短的。選擇合適的封裝互連結構，有效地傳輸這些信號已成為最大限度減少信號完整性問(wèn)題的重要考慮因素，如串擾、阻
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基于GMSL SerDes的雙汽車(chē)電子控制單元的應用

  • Maxim的吉比特(千兆)多媒體串行鏈路(GMSL)方案可以對數字視頻和音頻數據進(jìn)行串行轉換，然后通過(guò)一對雙絞線(xiàn)串行傳輸。另外，集成雙向控制通道可以使能單個(gè)微處理器(micro;C)對串行器、解串器和所有連接外設編程。在典
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LatticeECP4高速配置SERDES

  • LatticeECP4? FPGA系列結合了高性能FPGA結構、高性能I/O和多達16個(gè)通道的嵌入式SERDES，帶有相關(guān)的物理編碼子層(PCS)邏輯。每個(gè)PCS邏輯通道包含專(zhuān)用的發(fā)送和接收電路，用于高速、全雙工的串行數據傳輸，傳輸速率高達
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GMSL SerDes在雙汽車(chē)電子控制單元(ECU)中的應用

  • 摘要：Maxim的吉比特(千兆)多媒體串行鏈路(GMSL)方案可以對數字視頻和音頻數據進(jìn)行串行轉換，然后通過(guò)一對雙絞線(xiàn)串行傳輸。另外，集成雙向控制通道可以使能單個(gè)微處理器(micro;C)對串行器、解串器和所有連接外設編程
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優(yōu)化遠程及遙測應用的視頻SERDES電路

  • 優(yōu)化遠程及遙測應用的視頻SERDES電路,為了滿(mǎn)足視頻系統、工業(yè)和醫療顯示和視頻傳送等應用消除較長(cháng)連接電纜限制、提高數據速率，以及需要雙向傳輸輔助數據的要求。Intersil公司推出了一款采用雙向I2C接口的SERDESIC ISL34340，有助于各種應用實(shí)現遠程配置
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通過(guò)SerDes遠端I2C接口訪(fǎng)問(wèn)16位I2C外設寄存器地址

  • 摘要：本應用筆記介紹如何通過(guò)吉比特多媒體串行鏈路（GMSL） SerDes的遠端I2C接口訪(fǎng)問(wèn)16位寄存器地址。引言Maxim吉比特多媒體串行鏈路（GMSL）串行器/解串器（SerDes）系列包括MAX9249、MAX9259、MAX9260、MAX9263和
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高性能SERDES及其在CPRI接口的應用分析

  • 1引言
    隨著(zhù)數據寬帶網(wǎng)絡(luò )的迅猛發(fā)展，需要不斷提高系統設備的業(yè)務(wù)容量。目前的趨勢是采用高速串行通信技術(shù)，即采用串行解串器SERDES，把低速的并行數據轉換為高速串行數據連接。SERDES串行接口可在背板或電纜/光纖等
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SERDES的數字系統中高效時(shí)鐘設計方案

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò )家園
  • 關(guān)鍵字： SERDES  數字系統  高效時(shí)鐘  

低壓差分SerDes的全雙工互連和分組數據傳輸技術(shù)

  • 低壓差分SerDes的全雙工互連和分組數據傳輸技術(shù),由于現代數字信號處理器(dsp)設計、半導體工藝、并行處理和互連與傳輸技術(shù)的進(jìn)步，現代高性能dsp的處理能力得到極大發(fā)展。但在移動(dòng)通信、雷達信號處理和實(shí)時(shí)圖像處理等復雜電子系統中，單片dsp的性能仍可能無(wú)法滿(mǎn)足需
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第四代無(wú)線(xiàn)基礎架構的離散式 SerDes 解決方案

  • 當網(wǎng)絡(luò )設備制造商建置4G的基礎架構時(shí)，對于分布式基站架構部署中無(wú)線(xiàn)電設備控制及無(wú)線(xiàn)電設備之間的高序列數據速率需求將大幅升高。要滿(mǎn)足如此需求，光纖纜線(xiàn)兩端的SerDeson必須發(fā)揮更高的效能。網(wǎng)絡(luò )設備制造商可將系統切割開(kāi)來(lái)，便能使用同一個(gè)熟悉的FPGA平臺進(jìn)行邏輯層處理。
  • 關(guān)鍵字： SerDes  解決方案  離散  架構  基礎  無(wú)線(xiàn)  

高性能FPGA中的高速SERDES接口

  • 引言　 串行接口常用于芯片至芯片和電路板至電路板之間的數據傳輸。隨著(zhù)系統的帶寬不斷增加至多吉比特范圍，并行接口已經(jīng)被高速串行鏈接，或SERDES （串化器/ 解串器）所取代 。起初， SERDES是獨立的ASSP或ASIC器
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符合EMI/EMC標準的SerDes――基本測試策略和指南

  • 摘要：電磁干擾（EMI）和電磁兼容（EMC）測試是汽車(chē)應用領(lǐng)域中串行器/解串器（SerDes）設計必須驗證的參數，需要在設計之初謹慎考慮EMI和EMC問(wèn)題，避免不必要的設計修改。以下應用筆記詳細介紹了如何在SerDes系統
  • 關(guān)鍵字： SerDes  EMI  EMC  標準    

基于SERDES收發(fā)器和CPRI的電信系統低延遲變化設計

  • 基于SERDES收發(fā)器和CPRI的電信系統低延遲變化設計,　　本文討論利用帶嵌入式SERDES收發(fā)器和CPRI鏈路IP內核的低成本FPGA，來(lái)實(shí)現電信系統低延遲變化設計的考慮因素?！　o(wú)線(xiàn)電信設備制造商正受到以更小體積、更低功耗、更低制造成本來(lái)布署基站架構的壓力。當通過(guò)WiMa
  • 關(guān)鍵字： 延遲  變化  設計  系統  電信  SERDES  收發(fā)器  CPRI  基于  

TI推出分立式雙通道串行器／解串器

  • 　　日前，德州儀器 (TI) 宣布推出業(yè)界首款 6 千兆位每秒 (Gbps) 的雙通道串行器-解串器 IC (SerDes)，其可為無(wú)線(xiàn)應用提供 高達470 兆位每秒 (Mbps) 至6.25 Gbps 的連續數據速率。該 TLK6002 支持從原有速度到最新更快速度的升級，符合所有無(wú)線(xiàn)基站設計所需的 OBSAI 與 CPRI 標準要求。TLK6002 可用于各種無(wú)線(xiàn)基礎設施應用，其中包括 WiMAX、TD-SCDMA、WCDMA 以及 CDMA2000 等。 　　最新 SerDes 使用統一 12
  • 關(guān)鍵字： TI  串行器  解串器  SerDes  
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