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利用Virtex-5 FPGA實(shí)現更高的性能

  • 在FPGA系統設計中,要達到性能最大化需要平衡具有混合性能效率的元器件,包括邏輯構造(fabric)、片上存儲器、DSP和I/O帶寬。在本文中,我將向你解釋怎樣能在追求更高系統級性能的過(guò)程中受益于Xilinx® 的Virtex™-5 FPGA構建模塊,特別是新的ExpressFabric™技術(shù)。以針對邏輯和算術(shù)功能的量化預期性能改進(jìn)為例,我將探究ExpressFabric架構的主要功能?;趯?shí)際客戶(hù)設計的基準將說(shuō)明Virtex-5ExpressFabric技術(shù)性能平均比前一
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利用Xilinx Platform Studio工具套件,快速、便捷地生成 BSP

  • 具有嵌入式處理器的 平臺 FPGA 為您提供前所未有的靈活性、集成度和高性能。目前,在單個(gè)可編程邏輯設備中開(kāi)發(fā)極其復雜且高度定制化的嵌入式系統已成為可能。 隨著(zhù)芯片性能的不斷增加,如何使設計方法始終高效、多產(chǎn),成為人們面臨的主要挑戰。嵌入式系統開(kāi)發(fā)的關(guān)鍵活動(dòng)之一是開(kāi)發(fā)板支持包 (BSP)。利用 BSP,可以使嵌入式軟件應用程序成功地初始化,并與連接到處理器的硬件資源進(jìn)行通信。典型的 BSP 組件包括引導代碼、設備驅動(dòng)程序代碼和
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基于MCU的家庭防盜報警系統(圖)

  •   從實(shí)際出發(fā),設計一種家庭用、與電話(huà)線(xiàn)連接、操作簡(jiǎn)單、工作穩定可靠的遠程智能防盜報警裝置。   當人們外出時(shí),往往希望實(shí)施自動(dòng)監測報警以使家庭財產(chǎn)免受損失。針對這一需求,研制出了一系列自動(dòng)報警系統,如門(mén)磁式、觸摸式和紅外線(xiàn)監測自動(dòng)報警系統等。本文將介紹的遠程智能防盜報警裝置,可同時(shí)監視多個(gè)重要點(diǎn)(如門(mén)、窗等),發(fā)現盜情及時(shí)撥叫號碼,并能利用普通電話(huà)線(xiàn)進(jìn)行告警信號呼叫,其性能穩定可靠,實(shí)用性、適用性強,且具有較高的靈活性。 基本工作原理   如圖1所示,遠程智能防盜報警裝置由信號檢測電路、復位電路、
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SYNPLICITY CERTIFY軟件全面支持XILINX VIRTEX-5 FPGA簡(jiǎn)化ASIC原型驗證過(guò)程

  •   Synplicity宣布其Certify® ASIC RTL 原型設計軟件增強了對 Xilinx Virtex™-5 系列的 65 納米 FPGA 的支持。Certify 軟件是業(yè)界首款支持多個(gè) FPGA 進(jìn)行 ASIC 原型設計的產(chǎn)品。Certify 工具將多芯片分組技術(shù)與業(yè)界一流的 FPGA 綜合技術(shù)
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利用Virtex-5 FPGA實(shí)現更高性能的方法

  • 在FPGA系統設計中,要達到性能最大化需要平衡具有混合性能效率的元器件,包括邏輯構造(fabric)、片上存儲器、DSP和I/O帶寬。在本文中,我將向你解釋怎樣能在追求更高系統級性能的過(guò)程中受益于Xilinx? 的Virtex?-5 FPGA構建模塊,特別是新的ExpressFabric?技術(shù)。以針對邏輯和算術(shù)功能的量化預期性能改進(jìn)為例,我將探究ExpressFabric架構的主要功能?;趯?shí)際客戶(hù)設計的基準將說(shuō)明Virtex-5ExpressFabric技術(shù)性能平均比前一代Virtex-4 FPGA要高
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可重構計算技術(shù)將漸入民用領(lǐng)域

  • ??? 可重構計算(Reconfigurable Computing) 技術(shù)是指在軟件的控制下,利用系統中的可重用資源(如FPGA等可重構邏輯器件),根據應用的需要重新構造一個(gè)新的計算平臺,達到接近專(zhuān)用硬件設計的高性能。它避免了微處理器計算模式因為取指、譯碼等步驟導致的性能損失,同時(shí)也消除了專(zhuān)用集成電路(ASIC)計算模式因為前期設計制造的復雜過(guò)程帶來(lái)的高代價(jià)和不可重用等缺陷。???? 從某種意義上來(lái)說(shuō),可重構計算技術(shù)并不是什么新技術(shù),
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FPGA實(shí)現的FIR算法在汽車(chē)動(dòng)態(tài)稱(chēng)重儀中的應用

  • 引言 車(chē)輛在動(dòng)態(tài)稱(chēng)重時(shí),作用在平臺上的力除真實(shí)軸重外,還有許多因素產(chǎn)生的干擾力,如:車(chē)速、車(chē)輛自身諧振、路面激勵、輪胎驅動(dòng)力等,給動(dòng)態(tài)稱(chēng)重實(shí)現高精度測量造成很大困難。若在消除干擾的過(guò)程中采用模擬方法濾波,參數則不能過(guò)大,否則將產(chǎn)生過(guò)大的延遲導致不能實(shí)現實(shí)時(shí)處理,從而造成濾波后的信號仍然含有相當一部分的噪聲。所以必須采用數字濾波消除干擾。 FIR濾波的原理及實(shí)現 本文采用FIR數字濾波,其原理如公式1所示。 Y(n)= (1) 其中h(k)為系統濾波參數,x(n)為采集的信號,
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無(wú)線(xiàn)數據傳輸后端RFW—D100的原理與應用

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò )家園
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低功耗FPGA設計技術(shù)

  • 一、前言      隨著(zhù)系統功率預算的不斷緊縮,迫切需要新型低功率元器件。對通信基礎設施而言,電路板冷卻、機箱體積小型化以及系統可靠性在系統設計中都起著(zhù)重要的作用。對e-應用,電池壽命、熱耗散和小體積尺寸是主要的設計難點(diǎn)。選用智能器件,輔以正確的設計技巧增加了符合功率預算的可能性。盡管可編程邏輯器件(PLD)有很好的性能,然而卻以犧牲功耗為代價(jià)。Actel公司的抗熔斷型FPGA提供低功耗且高性能應用的理想解決方案。本文涵蓋Actel eX系列以及SX/SX-A系列器件,詳細描述了器件的結構特點(diǎn)與設計技巧。
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賽靈思推出系統性能最高、編譯時(shí)間最快的ISE WEBPACK 9.1i設計套件

  • 可免費下載并同時(shí)支持Windows和Linux平臺的設計套件,能降低平均10%的動(dòng)態(tài)功耗并提供擴展的FPGA器件支持      2007年1月30日,北京 - 全球領(lǐng)先的可編程邏輯解決方案提供商賽靈思公司(Xilinx, Inc.) (NASDAQ:XLNX) 日前宣布推出最新版本、可免費下載的邏輯設計套件——集成軟件環(huán)境 (ISE™) WebPACK™ 9.1i,目前用戶(hù)可立即下載使用。這一新版本包含了使用廣泛的賽靈思 ISE Foundatio
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FPGA與CPLD的區別

  • 管FPGA和CPLD都是可編程ASIC器件,有很多共同特點(diǎn),但由于CPLD和FPGA結構上的差異,具有各自的特點(diǎn):①CPLD更適合完成各種算法和組合邏輯,FP GA更適合于完成時(shí)序邏輯。換句話(huà)說(shuō),FPGA更適合于觸發(fā)器豐富的結構,而CPLD更適合于觸發(fā)器有限而乘積項豐富的結構。②CPLD的連續式布線(xiàn)結構決定了它的時(shí)序延遲是均勻的和可預測的,而FPGA的分段式布線(xiàn)結構決定了其延遲的不可預測性。 ③在編程上FPGA比CPLD具有更大的靈活性。CPLD通過(guò)修改具有固定內連電路的邏輯功能來(lái)編程,FPGA主要通過(guò)
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HOLTEK推工業(yè)級八位I/O型快閃微控制器(Flash MCU)

  • HOLTEK半導體不斷追求于MCU領(lǐng)域的卓越與精進(jìn),在客戶(hù)的期盼下,HOLTEK半導體正式推出符合工業(yè)規格的I/O型系列快閃微控制器HT48FxxE,全系列符合工業(yè)上 - 40℃ ~ 85℃工作溫度與高抗噪聲之性能要求,快閃程序內存(Flash Program ROM)可重復10萬(wàn)次之讀/寫(xiě),數據存儲器EEPROM可重復100萬(wàn)次之讀/寫(xiě)。  I/O型快閃微控制器HT48FxxE系列共計五個(gè)型號 --- HT48F0
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一種眼科B型超聲診斷議

  • 摘要:介紹一種以Winbond公司的W78E58單片機為控制核心,并采用FPGA和大容量FIFO等器件構成的眼科B型超聲診斷儀。闡述了眼科超聲診斷儀的基本原理,使用FIFO作為數據共享RAM實(shí)現采樣和顯示相對獨立的模塊化設計方案以及FPGA在該設計中的具體應用。 20世紀50年代初超聲探測開(kāi)始應用于醫學(xué)領(lǐng)域至今,超聲診斷技術(shù)已有了長(cháng)足的進(jìn)展。超聲診斷儀更是形式多樣,型號繁多。 超聲診斷儀通常按三種方法分類(lèi),它們是:①按圖像信息的獲取方法分類(lèi),由此可分為反射法超 聲診斷儀、多普勒法超聲診斷儀和透射法超
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Nios II系統在數字式心電診監測設備中的應用

  • (1、武漢科技學(xué)院 河北 武漢 430073;2、華中科技大學(xué) 同濟醫學(xué)院河北 武漢 430000) 1 引言心電檢測儀是醫學(xué)界運用廣泛的一種心電監測設備,他主要由12導聯(lián)心電傳感器和心電信號處理設備兩部分組成,目前運用廣泛的數字式心電檢測儀大都是由DSP處理器外加一個(gè)單片機(MCU),通過(guò)編寫(xiě)復雜的并行通訊協(xié)議來(lái)完成的,這種結構雖然有較高的精度,但硬件設計復雜,軟件編寫(xiě)煩瑣,相應的開(kāi)發(fā)周期長(cháng),研制成本高。本設計采用Altera公司先進(jìn)的SOPC(可編程片上系統)解決方案--以32位Nios I
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基于FPGA的數字式心率計

  • 心率計是常用的醫學(xué)檢查設備,實(shí)時(shí)準確的心率測量在病人監控、臨床治療及體育競賽等方面都有著(zhù)廣泛的應用。心率測量包括瞬時(shí)心率測量和平均心率測量。瞬時(shí)心率不僅能夠反映心率的快慢。同時(shí)能反映心率是否勻齊;平均心率雖只能反映心率的快慢,但記錄方便,因此這兩個(gè)參數在測量時(shí)都是必要的。   測量心率有模擬和數字兩種方法。模擬方法是在給定的時(shí)間間隔內計算R波(或脈搏波)的脈沖個(gè)數,然后將脈沖計數乘以一個(gè)適當的常數測量心率的。這種方法的缺點(diǎn)是測量誤差較大、元件參數調試困難、可靠性差。數字方法是先測量相鄰R波之間的時(shí)間,
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