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詳細講解Vivado設計套件帶來(lái)的益處

  • 歷經(jīng)四年的開(kāi)發(fā)和一年的試用版本測試，賽靈思可編程顛覆之作Vivado設計套件終于震撼登場(chǎng)，并通過(guò)其早期試用計...
  • 關(guān)鍵字： FPGA  IP  嵌入式  PLD  CPLD  SoC  數字信號處理  消費電子  FPGA  

IP 封裝器、集成器和目錄

  • 賽靈思的工具架構團隊把重點(diǎn)放在新套件專(zhuān)門(mén)的IP功能設計上，以便于IP的開(kāi)發(fā)、集成與存檔。為此，賽靈思開(kāi)發(fā)出了IP封裝器、IP集成器和可擴展IP目錄三種全新的IP功能。Feist表示：“今天很難找到不采用IP的IC設計
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ARM程序優(yōu)化及其在嵌入式TCP/IP協(xié)議實(shí)現中的應用

  • 隨著(zhù)嵌入式技術(shù)的發(fā)展，人們對系統的智能化、小型化的要求也越來(lái)越高?；贏(yíng)RM結構的微處理器以其高性能、低功耗、低價(jià)格等方面的優(yōu)勢被廣泛應用于各種電子產(chǎn)品，特別是一些高端的嵌入式控制應用中，例如移動(dòng)電話(huà)、工
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采用IP內核的多業(yè)務(wù)分組平臺介紹

  • 一、引言 　　

    隨著(zhù)軟交換和未來(lái)3G業(yè)務(wù)的開(kāi)展，現有網(wǎng)絡(luò )業(yè)務(wù)分組化的趨勢日益明顯。ITU-T也明確指出，下一代網(wǎng)絡(luò )NGN是基于分組承載的網(wǎng)絡(luò )。而現有的數據承載主要采用交換機光纖直聯(lián)方式或通過(guò)基于SDH的MSTP方式，
  • 關(guān)鍵字： 平臺  介紹  分組  業(yè)務(wù)  IP  內核  采用  

quartus的IP仿真錯誤分析

  • quartus的IP仿真錯誤分析, 大家都知道quartus的IP可以直接拿來(lái)用的，大大節省了開(kāi)發(fā)時(shí)間，而且其代碼是絕對優(yōu)化的；所有的前奏都操作成功，設置沒(méi)什么問(wèn)題，開(kāi)始對生成的fft.vhd文件進(jìn)行編譯，點(diǎn)擊Start Compilation，第一感覺(jué)：慢！編譯很
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對數轉換電路--可獲得IP/十進(jìn)位輸出

  • 電路的功能為了把大范圍的信號電平壓縮顯示，可使用對數電路，通常稱(chēng)對數放大器，在電氣電路中多使用以10為底的常用對數，本電路是1V/十進(jìn)位、即10倍的變化引起1V變化輸出的電路。對數作為除法、乘法等運算電路的基本
  • 關(guān)鍵字： IP  對數  轉換電路    

CDMA無(wú)線(xiàn)終端TCP／IP協(xié)議介紹

  • CDMA是無(wú)線(xiàn)通信領(lǐng)域的后起之秀，采用頻分編碼技術(shù)，與基于時(shí)分復用的GSM相比具有明顯優(yōu)勢。CDMA能夠實(shí)現從現有通信系統到下一代通信系統的平滑過(guò)渡，具有較強的功能伸縮性；可以支持先進(jìn)的天線(xiàn)技術(shù)，通過(guò)增加小區覆蓋
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IP4776CZ38構成的HDMI接口技術(shù)

  • 本文介紹了IP4776CZ38主要特性和優(yōu)勢, 功能方框圖, HDMI發(fā)送器和接收器應用框圖以及PCB布局方案框圖.NXP公司的IP4776CZ38是全集成的HDMI接口器件,集成了電平轉移,ESD和背驅保護等功能. IP4776CZ38和HDMI 1.3兼容,每路
  • 關(guān)鍵字： 4776  HDMI  IP  38    

利用FFT IP Core實(shí)現FFT算法

  • 結合工程實(shí)踐，介紹了一種利用FFT IP Core實(shí)現FFT的方法，設計能同時(shí)對兩路實(shí)數序列進(jìn)行256點(diǎn)FFT運算，并對轉換結果進(jìn)行求模平方運算，且對數據具有連續處理的能力。設計采用低成本的FPGA實(shí)現，具有成本低、性能高、
  • 關(guān)鍵字： FFT  Core  IP  算法    

可以將第三方的IP(來(lái)自VHDL或Verilog)吸納到NI Fl

  • 如果適配器模塊是由NI公司開(kāi)發(fā)的，那么不需要任何VHDL或其他硬件描述語(yǔ)言的經(jīng)驗。所有的FPGA編程均通過(guò)NI LabVIEW FPGA模塊和NI-RIO驅動(dòng)程序軟件以圖形化的方式完成。如果該適配器模塊是由第三方開(kāi)發(fā)的，則或許提供定
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TCP/IP遠程網(wǎng)絡(luò )步進(jìn)電機控制器

  • 在計算機整合制造業(yè)(CIM)或工業(yè)自動(dòng)化(IA)領(lǐng)域，許多控制設備進(jìn)行長(cháng)距離的數據傳送時(shí)有困難，抗干擾性能不好,多 ...
  • 關(guān)鍵字： TCP  IP  遠程網(wǎng)絡(luò )  步進(jìn)電機  控制器  

基于FPGA的UPFC控制器IP設計

  • 　0 引言 　　統一潮流控制器(Unified Power Flow Con-troller，簡(jiǎn)稱(chēng)UPFC)是一種可以較大范圍地控制電流使之按指定路經(jīng)流動(dòng)的設備，它可在保證輸電線(xiàn)輸送容量接近熱穩定極限的同時(shí)又不至于過(guò)負荷?？刂葡到y是UPFC的核
  • 關(guān)鍵字： IP  設計  控制器  UPFC  FPGA  基于  

IP承載網(wǎng)絡(luò )規劃設計探討

  • 毋庸置疑，現代通信網(wǎng)絡(luò )的發(fā)展，是由業(yè)務(wù)需求和市場(chǎng)需求來(lái)決定的，而不是技術(shù)的發(fā)展。我們回頭看看互聯(lián)網(wǎng)（IP網(wǎng)絡(luò )）的發(fā)展歷程，這其中市場(chǎng)推動(dòng)的痕跡非常明顯：這一種六七十年代就已經(jīng)誕生的IP網(wǎng)絡(luò )技術(shù)，在九十年代
  • 關(guān)鍵字： 探討  規劃設計  網(wǎng)絡(luò )  承載  IP  

基于Nios II處理器的SVPWM IP Core設計

  • 摘要 為降低FPGA實(shí)現3電平SVPWM算法的復雜性，減小SVPWM模塊所占用的資源，文中利用正弦函數和余弦函數的關(guān)系，采用小容量ROM提出了一種新的SVPWM控制算法。利用Verilog HDL實(shí)現了算法的硬件設計，并封裝成IP核以方便
  • 關(guān)鍵字： SVPWM  Nios  Core  IP    

基于Nios II步進(jìn)電機控制器IP核的設計與實(shí)現

  • 摘要 根據Nios II處理器的Avalon總線(xiàn)規范，設計了一款面向步進(jìn)電機的控制器IP核。該定制IP核采用軟、硬件協(xié)同設計的方法，功能符合Avalon總線(xiàn)的讀寫(xiě)傳輸時(shí)序，具有完備的步進(jìn)電機驅動(dòng)能力。仿真結果表明，該IP核具有
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