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一種基于FPGA的雷達回波實(shí)時(shí)模擬器的實(shí)現
- 提出了一種基于FPGA的雷達回波實(shí)時(shí)模擬器的實(shí)現方法。該模擬器采用cPCI標準總線(xiàn)，以FPGA為核心計算單元，配有高速數模、模數轉換模塊，可實(shí)現雷達回波信號實(shí)時(shí)在線(xiàn)注入模擬。該模擬器可實(shí)現多種體制下復雜回波的模擬，具有很好的工程應用價(jià)值。
- 關(guān)鍵字： 雷達回波實(shí)時(shí)模擬器 半實(shí)物仿真 FPGA
基于FPGA的嵌入式圖像采集系統設計
- 介紹了以FPGA為核心的邏輯控制模塊的數據采集系統的設計可以滿(mǎn)足實(shí)時(shí)性要求，設計中采用自頂向下的設計方法，根據不同的功能將整個(gè)系統劃分為若干模塊進(jìn)行設計，并介紹了每個(gè)模塊的功能和實(shí)現方法。在設計中采用VHDL語(yǔ)言對各個(gè)模塊進(jìn)行描述。視頻解碼芯片采用Philips公司的SAA7113H，該芯片通過(guò)I2C總線(xiàn)協(xié)議進(jìn)行配置。實(shí)驗表明，設計可以滿(mǎn)足圖像采集實(shí)時(shí)性的要求。
- 關(guān)鍵字： I2C總線(xiàn) 圖像處理 FPGA
基于FPGA的電子攝像系統的穩像設計
- 穩像系統的反應速度是電子穩像要解決的關(guān)鍵技術(shù)之一。傳統的基于“攝像機-圖像采集卡-計算機”模式的穩像系統、圖像檢測和匹配算法全部由計算機以軟件方式實(shí)現。盡管當今計算機的性能很高，能夠部分滿(mǎn)足單傳感器電子穩系統的實(shí)時(shí)處理要求，但在以下幾個(gè)方面有著(zhù)難以解決的問(wèn)題：首先，其固有的串行工作方式使得單計算機難以適應其于多傳感器視頻處理系統的實(shí)時(shí)穩像，阻礙了在實(shí)際中的應用adw欠，傳統的圖像采集卡中能將采集圖像數據實(shí)時(shí)傳輸給計算機，而不能傳輸給標準接口的視頻監視設備lk之很多應用場(chǎng)合對聽(tīng)要求很高。因此，研制專(zhuān)用的電
- 關(guān)鍵字： 隔行掃描 電子穩像系統 FPGA
基于FPGA和PCI的AFDX終端接口卡設計
- 航空電子全雙工交換式以太網(wǎng)(AFDX)是在商用以太網(wǎng)的基礎上經(jīng)過(guò)改進(jìn)實(shí)時(shí)性和可靠性建立起來(lái)的。依據ARINC664規范第7部分對終端接口卡時(shí)延和抖動(dòng)的性能要求，提出基于FPGA和PCI的AFDX終端接口卡的整體設計方案，對發(fā)送和接收模塊等關(guān)鍵模塊進(jìn)行了設計，并分析了PCI接口驅動(dòng)程序。測試結果表明,該接口卡實(shí)時(shí)性好、傳輸速率高、穩定可靠，符合AFDX協(xié)議標準。
- 關(guān)鍵字： 全雙工交換式以太網(wǎng) 實(shí)時(shí)性 FPGA
LTE上行DFT/IDFT的一種設計實(shí)現
- MSL4163提供1MHz I2C串口，器件包括先進(jìn)的PWM引擎以及片上EEPROM等。主要用在電視和臺式電腦監視器、醫療、工業(yè)儀表和汽車(chē)音/視頻顯示器。本文介紹了MSL4163/MSL4164主要特性、方框圖和典型應用電路、級聯(lián)連接電路。
- 關(guān)鍵字： 3GPP協(xié)議 流水線(xiàn)結構 FPGA
基于FPGA的級聯(lián)H橋多電平變流器CPS-PWM觸發(fā)脈沖快速生成
- 提出一種基于現場(chǎng)可編程門(mén)陣列(FPGA)及不對稱(chēng)規則采樣的級聯(lián)H橋型變流器觸發(fā)脈沖的快速生成方法。詳細分析了基于不對稱(chēng)規則采樣的載波相移SPWM(CPS-SPWM)觸發(fā)脈沖的快速生成原理。重點(diǎn)介紹了基于FPGA的CPS-SPWM觸發(fā)脈沖快速生成的實(shí)現方法。理論分析和實(shí)驗結果表明，在既沒(méi)有增加采樣頻率，又沒(méi)有增加計算量的情況下，相對基于對稱(chēng)規則采樣的CPS-SPWM脈沖生成方法，該方法具有較快的生成速度，并可廣泛應用于DSTATCOM等高壓級聯(lián)H橋多電平變流器觸發(fā)脈沖的快速生成。
- 關(guān)鍵字： 脈沖形成 CPS-SPWM技術(shù) FPGA
數字基帶預失真系統中環(huán)路延遲估計的FPGA實(shí)現
- 基于FPGA芯片Stratix II EP2S60F672C4設計實(shí)現了數字基帶預失真系統中的環(huán)路延遲估計模塊。該模塊運用了一種環(huán)路延遲估計新方法，易于FPGA實(shí)現。同時(shí)，在信號失真的情況下也能給出正確的估計結果。Modelsim SE 6.5c的時(shí)序仿真結果和SignalTaps II的硬件調試結果驗證了模塊的有效性。
- 關(guān)鍵字： 數字基帶預失真系統 環(huán)路延遲估計 FPGA
fpga介紹
FPGA是英文Field－Programmable Gate Array的縮寫(xiě)，即現場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、EPLD等可編程器件的基礎上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專(zhuān)用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現的，既解決了定制電路的不足，又克服了原有可編程器件門(mén)電路數有限的缺點(diǎn)。
FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個(gè)新概念，內部包括可 [ 查看詳細 ]
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