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利用FPGA實(shí)現無(wú)線(xiàn)分布式采集系統設計
- 在無(wú)線(xiàn)分布式采集系統設計中，采用了基于卷積編碼、Viterbi譯碼的編碼和互為備份的雙通道傳輸方案，利用了FPGA內豐富的邏輯資源以及存儲資源，實(shí)現了數據的遠距離同步可靠傳輸。
- 關(guān)鍵字： 無(wú)線(xiàn)分布 Viterbi FPGA 采集系統 卷積編碼
基于FPGA的多路CameraLink數據的WDM光傳輸
- 本系統是基于FPGA的多路CameraLink數據的單光纖傳輸設計，由于FPGA的開(kāi)發(fā)成本低廉，升級方便所以成為該系統設計的選擇。
- 關(guān)鍵字： CameraLink 多路 FPGA WDM 光傳輸
基于NETFPGA的可重構科學(xué)計算平臺
- 本項目的研究目標是探索和建立圖形化數學(xué)算法向硬件轉換的理論方法，研究開(kāi)發(fā)數學(xué)算法向硬件邏輯轉換的工具，與科學(xué)計算軟件相結合建立起基于FPGA陣列的科學(xué)計算平臺原型。研究目標結構流程如下：
- 關(guān)鍵字： 可重構 科學(xué)計算平臺 FPGA NET
基于多級SE網(wǎng)絡(luò )和混沌加密原理的FPGA設計與實(shí)現
- ：提出了混沌加密算法為基礎核心，并結合多級Shuffle-Exchange網(wǎng)絡(luò )設計并實(shí)現一個(gè)高效的加密系統。在解決多條輸入數據通道因復用要求而造成訪(fǎng)問(wèn)沖突的問(wèn)題后，提高加密模塊冗余度，實(shí)現系統吞吐能力的提升和最佳配置需求。
- 關(guān)鍵字： 混沌加密 多級SE網(wǎng)絡(luò ) FPGA Shuffle-Exchange
基于FPGA的實(shí)時(shí)金融指數行情并行計算
- 本項目的研究成果除股票交易的并行加速模型與系統設計外，還包括對股票交易系統其它業(yè)務(wù)處理的硬件加速論證方案，根據計算任務(wù)特點(diǎn)不同，給出合理的硬件加速平臺建設方案，股票指數實(shí)時(shí)更新只是其中的一個(gè)應用場(chǎng)景。
- 關(guān)鍵字： 實(shí)時(shí)金融指數 并行計算 FPGA PCI-Express 突發(fā)傳輸模式
基于FPGA的手勢語(yǔ)音轉換器
- 本文所設計的手勢語(yǔ)音識別器大大提高了殘疾人與正常人進(jìn)行交流溝通的方便性。系統的開(kāi)發(fā)與利用將可以促進(jìn)手勢識別技術(shù)的發(fā)展，具有很強的實(shí)用性和廣闊的應用前景。
- 關(guān)鍵字： 手勢語(yǔ)音轉換器 面積篩選算法 背景圖像減法 FPGA 空間域法
FPGA并行計算抽象接口的設計與實(shí)現
- 本設計為基于C語(yǔ)言開(kāi)發(fā)的程序開(kāi)發(fā)了一個(gè)FPGA的并行計算接口，凡是以C語(yǔ)言設計的程序，均可通過(guò)調用本設計的接口，把復雜的算法、數值處理交給FPGA芯片完成，在不需要程序員學(xué)習FPGA知識以及使用FPGA開(kāi)發(fā)工具的前提下，大大地減輕CPU的負荷以及從根本上提高了程序的執行效率，是FPGA并行化應用的一次全新嘗試。
- 關(guān)鍵字： IP核 調度模塊 FPGA PCI設備驅動(dòng) Express總線(xiàn)
基于FPGA的混沌信號保密通信平臺的設計
- 本項目基于FPGA技術(shù)進(jìn)行混沌信號保密通信平臺的設計。重點(diǎn)在于通信平臺的硬件電路設計，在軟件上采取VHDL硬件描述語(yǔ)言對每一部分的功能進(jìn)行模塊化設計，最后給出通信保密平臺的仿真驗證結果。
- 關(guān)鍵字： 混沌保密通訊 Lorenz混沌吸引子 FPGA 多路傳播
基于蜜罐技術(shù)的FPGA實(shí)現
- 利用FPGA實(shí)現IDS和入侵檢測、入侵審計的功能防止黑客利用蜜罐作為跳板攻擊服務(wù)器。
- 關(guān)鍵字： 蜜罐技術(shù) SPARTEN-3E FPGA 高交互 入侵審計
基于FPGA的動(dòng)態(tài)局部可重構實(shí)現方法
- 該實(shí)現方案借助嵌入式開(kāi)發(fā)套件EDK建立一個(gè)處理器系統，同時(shí)借助Xilinx ISE工具建立一個(gè)頂層模塊，該頂層模塊包含了作為子模塊的處理器系統和同樣作為子模塊的局部重構模塊。
- 關(guān)鍵字： 動(dòng)態(tài)局部可重構 OPB總線(xiàn) FPGA PlanAhead EDK
fpga介紹
FPGA是英文Field－Programmable Gate Array的縮寫(xiě)，即現場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、EPLD等可編程器件的基礎上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專(zhuān)用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現的，既解決了定制電路的不足，又克服了原有可編程器件門(mén)電路數有限的缺點(diǎn)。
FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個(gè)新概念，內部包括可 [ 查看詳細 ]
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