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基于FPGA的空間電場(chǎng)信號數據采集與處理系統設計
- 提出一種基于FPGA的空間電場(chǎng)信號數據采集與處理系統的設計方案，FPGA為主控制器控制A／D采樣和同步422發(fā)送。X，Y，Z三個(gè)方向的空間電場(chǎng)信號經(jīng)過(guò)信號處理和A／D采樣，在FPGA片內濾波劃分為不同的頻段，通過(guò)同步422接口發(fā)送到后續設備。該系統性能可靠穩定，致力于應用在探空火箭有效載荷——箭載電場(chǎng)儀上，對其他電場(chǎng)信號采集與處理系統也有
- 關(guān)鍵字： 空間電場(chǎng) 數據采集 FPGA
高速定點(diǎn)FFT算法的FPGA設計方案
- 著(zhù)重討論基于FPGA的64點(diǎn)高速FFT算法的實(shí)現方法。采用高基數結構和流水線(xiàn)結構，大大提高了FFT處理器的運行速度。同時(shí)塊浮點(diǎn)結構的引入，也大幅減少了浮點(diǎn)操作占用FPGA器件的資源數目，兼顧了FPGA高精度、低資源、低功耗的特點(diǎn)。
- 關(guān)鍵字： 高速FFT算法 高基數結構 FPGA 流水線(xiàn)結構
基于Nios II的多媒體廣告系統
- 電子屏的出現，不僅可以使企業(yè)更全面的展示產(chǎn)品，推廣企業(yè)文化，而且可以滿(mǎn)足不同讀者的需求，改善城市環(huán)境，提升人民生活質(zhì)量，更重要的是廣告能夠更及時(shí)、更準確、更全面的展示自己的新產(chǎn)品，第一時(shí)間與消費者進(jìn)行溝通，贏(yíng)得市場(chǎng)，獲取利潤，以及根據市場(chǎng)動(dòng)態(tài)更及時(shí)更全面的做出市場(chǎng)決策?；谝陨显?，我們采用Nios II軟核設計了能及時(shí)發(fā)布戶(hù)外廣告、電子公告的多媒體廣告系統。
- 關(guān)鍵字： NiosII處理器 多媒體廣告 FPGA
基于FPGA的實(shí)時(shí)視頻信號處理平臺的設計與實(shí)現
- 提出一種基于FPGA 的實(shí)時(shí)視頻信號處理平臺的設計方法，該系統接收低幀率數字YCbCr 視頻信號，對接收的視頻信號進(jìn)行格式和彩色空間轉換、像素和，利用片外SDRAM 存儲器作為幀緩存且通過(guò)時(shí)序控制器進(jìn)行幀率提高，最后通過(guò)VGA 控制模塊對圖像信號進(jìn)行像素放大并在VGA 顯示器上實(shí)時(shí)顯示。整個(gè)設計使用Verilog HDL 語(yǔ)言實(shí)現，
- 關(guān)鍵字： 實(shí)時(shí)視頻信號處理 CCD圖像傳感器 FPGA YCbCr
面向FPGA應用的電源設計
- 近幾年，FPGA 產(chǎn)業(yè)迅速擴張，有越來(lái)越多的工程師從事著(zhù)與 FPGA 相關(guān)的設計和研發(fā)工作。作為任何一款產(chǎn)品都不可或缺的電源，也面臨來(lái)自FPGA應用的要求和挑戰。一方面是需求的增多，另一方面的技術(shù)指標要求的不斷提升，如何幫助工程師輕松完成FPGA產(chǎn)品的電源設計，讓他們得以將更多的精力投入到核心部分的設計中，從而縮短設計周期，成了每個(gè)電源廠(chǎng)商要面對的問(wèn)題。為此，筆者采訪(fǎng)了來(lái)自?xún)?yōu)質(zhì)電源產(chǎn)品供應商凌力爾特公司的DC/DC μModule 產(chǎn)品市場(chǎng)經(jīng)理Afshin Odabaee，來(lái)聽(tīng)一聽(tīng)他對面向FPGA應用的電
- 關(guān)鍵字： 靜態(tài)電流 散熱 FPGA
基于EDA技術(shù)的FPGA設計
- 對傳統電子系統設計方法與現代電子系統設計方法進(jìn)行了比較，引出了基于EDA技術(shù)的現場(chǎng)可編程門(mén)陣列（FPGA）電路，提出現場(chǎng)可編程門(mén)陣列（FPGA）是近年來(lái)迅速發(fā)展的大規?？删幊虒?zhuān)用集成電路（ASIC），在數字系統設計和控制電路中越來(lái)越受到重視。介紹了這種電路的基本結構、性能特點(diǎn)、應用領(lǐng)域及使用中的注意事項。對基于EDA技術(shù)的FPGA進(jìn)行了展望。指出EDA技術(shù)將是未來(lái)電子產(chǎn)品設計技術(shù)發(fā)展的主要方向。
- 關(guān)鍵字： 自動(dòng)化設計 EDA FPGA
實(shí)時(shí)圖像小波無(wú)損壓縮系統的FPGA實(shí)現
- 將Altera 公司的DE2 多媒體開(kāi)發(fā)平臺與Terasic 公司的D5M 數碼相機開(kāi)發(fā)套件相結合，設計了一套基于小波無(wú)損壓縮的實(shí)時(shí)圖像處理系統。系統采用便于可編程邏輯器件靈活實(shí)現的二維整數5 /3 提升小波變換實(shí)現壓縮。為保證圖像的無(wú)損壓縮，對邊界數據進(jìn)行對稱(chēng)周期延拓處理。并針對實(shí)時(shí)處理過(guò)程中的大容量數據流的存儲問(wèn)題，應用片外存儲資源保存采集和處理過(guò)程中的圖像數據，有效地降低了片上存儲資源的消耗。測試結果表明: 系統滿(mǎn)足實(shí)時(shí)圖像采集、預處理及無(wú)損壓縮的要求。
- 關(guān)鍵字： 圖像處理 無(wú)損壓縮 FPGA
基于FPGA/Nios-Ⅱ的矩陣運算硬件加速器設計
- 針對復雜算法中矩陣運算量大,計算復雜,耗時(shí)多,制約算法在線(xiàn)計算性能的問(wèn)題,從硬件實(shí)現角度,研究基于FPGA/Nios-Ⅱ的矩陣運算硬件加速器設計,實(shí)現矩陣并行計算。首先根據矩陣運算的算法分析,設計了矩陣并行計算的硬件實(shí)現結構,并在Modelsim中進(jìn)行功能模塊的仿真,然后將功能模塊集成一個(gè)自定制組件,并通過(guò)Avalon總線(xiàn)與NiosⅡ主處理器通信,作為硬件加速器。最后在FPGA芯片中構建SoPC系統,并在A(yíng)ltera DE3開(kāi)發(fā)板中進(jìn)行矩陣實(shí)時(shí)計算測試。測試結果驗證了基于FPGA/Nios-Ⅱ矩陣運算硬件
- 關(guān)鍵字： 硬件加速器 矩陣運算 FPGA
TD-LTE綜合測試儀表關(guān)鍵模塊的研究與實(shí)現
- 在對OFDM調制以及FPGA、DSP、中頻接口進(jìn)行深入研究的基礎上，提出了一種TD-LTE系統中下行鏈路基帶信號發(fā)送的實(shí)現方案，在系統的設計思路和硬件資源上進(jìn)行了優(yōu)化。在實(shí)際的硬件環(huán)境下，通過(guò)大量測試，驗證了該方案的可行性和有效性。
- 關(guān)鍵字： TD-LTE 基帶信號發(fā)送 FPGA
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