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硬件描述語(yǔ)言Verilog HDL設計進(jìn)階之： 邏輯綜合的原則以及可綜合的代碼設計風(fēng)格
- 用always塊設計純組合邏輯電路時(shí)，在生成組合邏輯的always塊中，參與賦值的所有信號都必須有明確的值，即在賦值表達式右端參與賦值的信號都必需在always @(敏感電平列表)中列出。
- 關(guān)鍵字： VerilogHDL 邏輯綜合 FPGA
基于FPGA的可配置判決反饋均衡器的設計
- 在移動(dòng)通信和高速無(wú)線(xiàn)數據通信中，多徑效應和信道帶寬的有限性以及信道特性的不完善性導致數據傳輸時(shí)不可避免的產(chǎn)生碼間干擾，成為影響通信質(zhì)量的主要因素，而信道的均衡技術(shù)可以消除碼間干擾和噪聲，并減少誤碼率。其中判決反饋均衡器（DFE）是一種非常有效且應用廣泛得對付多徑干擾得措施。
- 關(guān)鍵字： 無(wú)線(xiàn)數據通訊 可配置均衡器 FPGA
Verilog HDL基礎之：實(shí)例5 交通燈控制器
- 本實(shí)例通過(guò)Verilog HDL語(yǔ)言設計一個(gè)簡(jiǎn)易的交通等控制器，實(shí)現一個(gè)具有兩個(gè)方向、共8個(gè)燈并具有時(shí)間倒計時(shí)功能的交通燈功能。
- 關(guān)鍵字： VerilogHDL 華清遠見(jiàn) FPGA 交通燈控制器
基于FPGA的CAN總線(xiàn)轉換USB接口的設計方案
- 這里以CAN總線(xiàn)通信接口為例，詳細論述了基于FPGA的CAN總線(xiàn)轉換USB接口的設計方案。
- 關(guān)鍵字： 光電隔離 CAN總線(xiàn)轉換器 FPGA
移動(dòng)計算SoC IP組件設計
- 作為SoC在移動(dòng)通信控制的分支，移動(dòng)操作SoC和一般的SoC在設計上是相似的。作為一個(gè)系統的核心，SoC要完成運行、操作或控制功能，必須有相應的組件配合。而多數組件，尤其是外部組件在SoC內都要有一個(gè)對應的控制器。所以，為了實(shí)現應用對象操作，SoC要設計相當數量的組件控制器。組件控制器的設計，對SoC而言就是一些IP（Intellectual Property）組件的設計。由于可編程器件PLD具有簡(jiǎn)單易學(xué)、修改方便的特點(diǎn)，常常被用來(lái)作為設計IP組件的硬件支撐。
- 關(guān)鍵字： SoC 移動(dòng)計算 無(wú)線(xiàn)通信
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