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使用一個(gè)FPGA便可實(shí)現的64通道下變頻器

RF Engines公司的ChannelCore64使設計者能夠用一個(gè)可對FPGA編程的IP核來(lái)替代多達16個(gè)DDC(直接下變頻器)ASIC，可顯著(zhù)減少PCB面積，降低功耗而且增加靈活性。和原來(lái)的方法相比，新方法是降低成本的典型代表，隨著(zhù)通道數目的增加，降低成本的需求愈加突出。在提供靈活性和簡(jiǎn)化設計的同時(shí)，這種方法也能降低功耗。ChannelCore64的應用包括無(wú)線(xiàn)基站，衛星地面站和其它多通道無(wú)線(xiàn)電接收器等。在這些系統應用中，需要從一個(gè)頻帶非常寬的信號中提取很多具有不同帶寬的通道(或者信號)，然后將整個(gè)
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基于單片機的FPGA并行配置方法

在當今變化的市場(chǎng)環(huán)境中，產(chǎn)品是否便于現場(chǎng)升級、是否便于靈活使用，已成為產(chǎn)品能否進(jìn)入市場(chǎng)的關(guān)鍵因素。在這種背景下，altera公司的基于SRAM LUT結構的FPGA器件得到了廣泛的應用。這類(lèi)器件的配置數據存儲在SRAM中。由于SRAM的掉電易失性，系統每次上電時(shí)，必須重新配置數據，只有在數據配置正確的情況下系統才能正常工作。這種器件的優(yōu)點(diǎn)是可在線(xiàn)重新配置ICR（In-Circuit Reconfigurability），在線(xiàn)配置方式一般有兩類(lèi)：一是通過(guò)下載電費由計算機直接對其進(jìn)行配置；二是通過(guò)微處理器對其
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基于FPGA的相檢寬帶測頻系統的設計

在電子測量技術(shù)中，頻率測量是最基本的測量之一。常用的測頻法和測周期法在實(shí)際應用中具有較大的局限性，并且對被測信號的計數存在
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AMI Semiconductor繼續領(lǐng)跑FPGA-to-ASIC轉換行業(yè)

現在轉換90nm Xilinx和Altera FPGA AMI Semiconductor, Inc. (AMIS) 今日宣布，它已具備將1.2伏90nm FPGA轉換為基于單元的130nm ASIC的能力。有了這種能力的支持，OEM就能從昂貴的高密FPGA原型制作轉到更節省成本的ASIC生產(chǎn)。 AMIS是首家供應Altera和Xilinx 90nm FPGA所用嵌入式替換組件的公司，主要面向通
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賽靈思面向最新VIRTEX-5 LXT平臺

最新的8.2i升級了ISE，PlanAhead和Chipscope Pro設計軟件加速設計收斂并為Virtex-5 LXT FPGA提供增強的生產(chǎn)力。賽靈思公司今天宣布面向最新Virtex™-5 LXT FPGA平臺推出完整的邏輯設計解決方案，包含升級版集成軟件環(huán)境(ISE™)設計工具。Virtex™-5 LXT FPGA平臺是業(yè)內第一款提供硬代碼PCI Express®
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JTAG口及其對F1aSh的在線(xiàn)編程

本文介紹一種通過(guò)JTAG對Flash進(jìn)行的在線(xiàn)編程方法。
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基于FPGA的IJF數字基帶編碼的實(shí)現

1 引言 20世紀80年代初，加拿大渥太華大學(xué)的費赫教授（K.Feher）領(lǐng)導的科研小組發(fā)明了IJF－OQPSK調制技術(shù)。IJF－OQPSK中文名稱(chēng)叫做無(wú)碼間干擾和抖動(dòng)-交錯正交相移鍵控。他是現代數字恒包絡(luò )調制技術(shù)中新型的調制技術(shù)之一。進(jìn)行這種調制時(shí)，首先要對數字基帶信號進(jìn)行IJF編碼，將其變換成一種無(wú)碼間干擾和抖動(dòng)、頻譜主瓣窄、具有快速滾降的基帶波形，然后再用OQPSK調制。這樣，調制后的基帶信號就具有了以下特點(diǎn)：以調波的相位平滑連續，而且每個(gè)號碼內的相位變化不會(huì )超過(guò)π/2，以調波的包絡(luò )近于恒
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解決硬盤(pán)驅動(dòng)器能耗難題

今天，大多數開(kāi)發(fā)便攜式媒體播放器、PDA、智能電話(huà)和基于IP協(xié)議的語(yǔ)音電話(huà)等高檔電池供電消費類(lèi)產(chǎn)品的設計人員都在使用某種或其他類(lèi)型的FPGA(現場(chǎng)可編程門(mén)陣列)。比較先進(jìn)的FPGA器件還集成了一個(gè)與外部邏輯連接在一起的嵌入式RAM，因此可以用來(lái)增加更先進(jìn)的功能。這種FPGA的一種典型應用包括充當系統處理器及其HDD(硬盤(pán)驅動(dòng)器)之間的橋接器件，利用RAM作為一個(gè)FIFO(先進(jìn)先出存儲器)將處理器存儲器與硬盤(pán)驅動(dòng)器加以區分，進(jìn)而有利于更快的數據傳輸。這種方法有一種顯著(zhù)的節能優(yōu)勢：當硬盤(pán)驅動(dòng)器運行時(shí)，它需要汲
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東芝與聯(lián)華制造的Xilinx 65納米Virtex-5 FPGA元件

兩款由日本東芝與臺灣聯(lián)華電子制造的Xilinx 65納米Virtex-5 FPGA元件由Chipworks 率先披露元件的內部結構分析報告現已接受客戶(hù)訂購 Chipworks 公司宣布，已分析Xilinx公司采用65納米制程的XC5VLX50Virtex-5 FPGA兩個(gè)元件樣本。其中一款元件由數位消費市場(chǎng)65納米技術(shù)的領(lǐng)導廠(chǎng)商日本東芝公司制造；而另一款元件則由另一業(yè)界先鋒臺灣聯(lián)華電子制造，亦是Xilinx過(guò)去10多年來(lái)的主要晶圓代工伙伴。Chipwo
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利用FPGA解決TMS320C54x與SDRAM的接口問(wèn)題

在DSP應用系統中，需要大量外擴存儲器的情況經(jīng)常遇到。例如，在數碼相機和攝像機中，為了將現場(chǎng)拍攝的諸多圖片或圖像暫存下來(lái)，需要將DSP處理后的數據轉移到外存中以備后用。從目前的存儲器市場(chǎng)看，SDRAM由于其性能價(jià)格比的優(yōu)勢，而被DSP開(kāi)發(fā)者所青睞。DSP與SDRAM直接接口是不可能的。 FPGA（現場(chǎng)可編程門(mén)陣列）由于其具有使用靈活、執行速度快、開(kāi)發(fā)工具豐富的特點(diǎn)而越來(lái)越多地出現在現場(chǎng)電路設計中。本文用FPGA作為接口芯片，提供控制信號和定時(shí)信號，來(lái)實(shí)現DSP到SDRAM的數據存取。 1 SDRA
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基于DSP和FPGA的高精度數據采集卡設計

引言當前，許多領(lǐng)域越來(lái)越多地要求具有高精度A/D轉換和實(shí)時(shí)處理功能。同時(shí)，市場(chǎng)對支持更復雜的顯示和通信接口的要求也在提高，如環(huán)境監測、電表、醫療設備、便攜式數據采集以及工業(yè)傳感器和工業(yè)控制等。傳統設計方法是應用MCU或DSP通過(guò)軟件控制數據采集的A/D轉換，這樣必將頻繁中斷系統的運行，從而減弱系統的數據運算能力，數據采集的速度也將受到限制。本文采用DSP+FPGA的方案，由硬件控制A/D轉換和數據存儲，最大限度地提高系統的信號采集和處理能力。系統結構整個(gè)采集卡包括信號調理、數據采集、數據
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2006年11月8日，Xilinx和Altera發(fā)布65nm工藝的FPGA

　　Xilinx在5月16日發(fā)布了Virtex-5系列FPGA，可以提供330 000個(gè)邏輯單元和1200個(gè)用戶(hù)I/O，邏輯性能比上一代Virtex-4平均提高30%。　　Altera公司在11月8日正式發(fā)布65nm工藝的Stratix III系列FPGA。與Stratix II相比，Stratix III的功耗降低了50%，性能提高了25%，密度是其兩倍。在解決低功耗問(wèn)題上，Stratix III FPGA采用了可編程功耗技術(shù)和可選內核電壓技術(shù)。但目前只有Xilinx可以提供樣片，Altera將在2
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Silicon Logic Engineering 新增高端FPGA 設計服務(wù)

SLE的服務(wù)，可協(xié)助客戶(hù)降低前期費用，縮短設計和開(kāi)發(fā)時(shí)間致力于 “一次成功” 多元ASIC及ASIC系統設計的高端ASIC設計公司 Silicon Logic Engineering Inc. （SLE），在其提供的服務(wù)中新增高端FPGA設計服務(wù)。Silicon Logic Engineering是系統互連領(lǐng)域的領(lǐng)導廠(chǎng)商Tundra半導體公司（TSX代碼：TUN）旗下的設計服務(wù)分公司。技術(shù)產(chǎn)品公司可運
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基于CORDIC算法的32位浮點(diǎn)三角超越函數之正余弦函數的FPGA實(shí)現

摘要：本文在傳統CORDIC算法的基礎之上，通過(guò)增加迭代次數，對參數進(jìn)行了優(yōu)化篩選，提高了運算精度，使設計出的軟核能夠在精度要求較高的場(chǎng)合中運行，如實(shí)時(shí)語(yǔ)音、圖像信號處理、濾波技術(shù)等。輸出數據經(jīng)過(guò)IEEE-754標準化處理，能夠直接兼容大多數處理器，擴展了其應用范圍。最終在A(yíng)ltera公司NiosⅡ處理器中通過(guò)增加自定義指令的方式完成了硬件實(shí)現。關(guān)鍵詞： CORDIC；自定義指令；IEEE-754標準化處理引言浮點(diǎn)超越函數的應用領(lǐng)域十分廣泛，涉及航空航天、機器人技術(shù)、實(shí)時(shí)語(yǔ)音、圖
關(guān)鍵字： 0610_A CORDIC FPGA IEEE-754標準化處理消費電子雜志_技術(shù)長(cháng)廊自定義指令消費電子

65nm半導體工藝發(fā)展策略

摘要：本文研究Altera在65nm工藝上的工程策略，介紹公司如何為客戶(hù)降低生產(chǎn)和計劃風(fēng)險，并同時(shí)從根本上提高密度、性能，及降低成本和功耗。關(guān)鍵詞： 65nm；FPGA；功耗引言Altera在65nm半導體制造工藝上的發(fā)展策略是充分利用先進(jìn)的技術(shù)和方法，以最低的成本為客戶(hù)提供性能最好的器件，同時(shí)降低客戶(hù)風(fēng)險，保證產(chǎn)品盡快面市。Altera在130nm和90nm器件上的市場(chǎng)份額表明，有效控制高端半導體技術(shù)中存在的風(fēng)險，能夠提高FPGA體系結構在市場(chǎng)上的受歡迎程度。因此，早自2003
關(guān)鍵字： 0610_A 65nm FPGA 單片機功耗嵌入式系統雜志_技術(shù)長(cháng)廊