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mcu,DSP,PLD/EDA的介紹/比較/分析
- 當今,數字時(shí)代的核心動(dòng)力便是單片機,DSP ,PLD/ EDA ,以其各自的特點(diǎn)滿(mǎn)足了各種需要,推動(dòng)著(zhù)信息技術(shù)的快速發(fā)展。這里將對這三類(lèi)電子產(chǎn)品分別加以介紹,并作比較和分析。
- 關(guān)鍵字： 單片機(Single-chipMicrocomputer) 數字信號處理(DSP) 可編程邏輯器件(PLD)/電子設計自動(dòng)化(EDA)
基于C5509A的功放閉環(huán)數字控制系統(圖)
- 隨著(zhù)通信系統的發(fā)展，要求通信具有更高的傳輸可靠性、更強的抗干擾能力。在無(wú)線(xiàn)信號發(fā)射過(guò)程中，射頻信號必須經(jīng)功放放大，再經(jīng)天線(xiàn)發(fā)射出去，信號經(jīng)功放后的幅度和穩定性對通信的可靠性和抗干擾起著(zhù)關(guān)鍵作用。攻放輸出信號的幅度越大通信可靠性越穩定，接收的準確性和可靠性就越高。在發(fā)射端，功放輸出功率控制一方面需要保證功放的安全可靠，另一方面又要盡可能使功放輸出功率最大。因此，對功放的輸出功率控制就顯得十分重要，早期的功放控制一般采用模擬等方法實(shí)現。
- 關(guān)鍵字： C5509A DSP 功放 閉環(huán) 數字控制
MAX706S在DSP系統中的應用
- 對于實(shí)際的DSP應用系統特別是產(chǎn)品化的DSP系統而言，可靠性是一個(gè)不容忽視的問(wèn)題。由于DSP系統的時(shí)鐘頻率比較高，因此在運行時(shí)極有可能發(fā)生干擾和被干擾的現象，嚴重時(shí)系統可能會(huì )出現死機。為了克服這種情況，除了在軟件上作一些保護措施外，硬件上也必須作相應的處理。硬件上最有效的保護措施就是采用具有監視(Watchdog)功能的自動(dòng)復位電路。各大公司生產(chǎn)了多種微處理器監控器，用來(lái)監測微處理器的運行狀態(tài)，一旦微處理器失控就強行復位微處理器，引導程序重新運行。
- 關(guān)鍵字： MAX706S DSP 監控電路
基于FPGA+DSP的智能車(chē)全景視覺(jué)系統
- 為實(shí)現智能車(chē)全景視覺(jué)系統的應用研究平臺，設計了一種基于FPGA+雙DSP的實(shí)時(shí)6通道數字圖像采集與處理系統。該系統由兩片FPGA與兩個(gè)DSP組成。第一個(gè)FPGA進(jìn)行多通道視覺(jué)圖像采集的同步控制、邏輯處理，第二片FPGA輔助DSP進(jìn)行海量圖像數據的高速并行處理。
- 關(guān)鍵字： 全景視覺(jué)系統 FPGA+DSP 數字圖像采集與處理系統
基于FPGA和多DSP的高速視覺(jué)測量系統的研究
- 針對高速視覺(jué)測量系統數據處理速度快、數據處理量大的特點(diǎn)，將FPGA技術(shù)與DSP技術(shù)相結合，研究了一種基于FPGA和多DSP的多通道并行處理的高速視覺(jué)測量系統。詳細介紹了FPGA技術(shù)與多DSP技術(shù)在數字圖像處理過(guò)程中的不同應用、高速視覺(jué)測量系統的總體結構以及各部分的工作原理。
- 關(guān)鍵字： 高速視覺(jué)測量系統 DSP FPGA
基于DSP的嵌入式導航計算機系統中CPLD器件軟件更新的實(shí)現
- 針對嵌入式導航計算機系統中CPLD器件軟件更新需求，提出了通過(guò)串行方式基于DSP的CPLD軟件更新方案，通過(guò)DSP的I／O口模擬CPLD的JTAG時(shí)序邏輯，將由串口接收到的CPLD配置信息文件，移入到其內部邏輯中，從而實(shí)現軟件更新。分析研究了實(shí)現該方案需解決的硬件和軟件中的關(guān)鍵問(wèn)題，設計實(shí)現了提出的CPLD器件軟件更新方案，并在實(shí)際的導航計算機系統中進(jìn)行了驗證和應用。
- 關(guān)鍵字： CPLD器件軟件更新 DSP JTAG
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