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不用處理器控制FPGA總線(xiàn)的方法

  • 許多FPGA設計使用嵌入式處理器實(shí)現控制。典型的解決方案是使用Nios這樣的軟處理器，雖然內置硬處理器的FPGASoC也變得很流行了。圖1顯示的是一個(gè)典型的
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基于FPGA的設計解決物聯(lián)網(wǎng)實(shí)現的核心挑戰

  • 當前，物聯(lián)網(wǎng)(IoT)已成為一個(gè)廣受歡迎的名詞，幾乎每一個(gè)電子設備相互連接到互聯(lián)網(wǎng)上加以使用，都被大家稱(chēng)為物聯(lián)網(wǎng)。它包含了一個(gè)從智能家電、汽車(chē)到可
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FPGA和CPLD內部自復位電路設計方案

  • 本文描述了復位的定義，分類(lèi)及不同復位設計的影響，并討論了針對FPGA和CPLD的內部自復位方案。1、定義復位信號是一個(gè)脈沖信號，它會(huì )使設計的電路進(jìn)入設
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CRC循環(huán)冗余校驗的原理與算法及FPGA實(shí)現

  • CRC基本原理在串行數據流的最有效的檢錯方案是CRC(Cyclic Redundancy check)循環(huán)冗余檢驗，CRC循環(huán)冗余校驗最根本的原理就是將原始數據除以某個(gè)固定的
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十年FPGA開(kāi)發(fā)經(jīng)驗工程師談設計技巧

  • 從大學(xué)時(shí)代第一次接觸FPGA至今已有10多年的時(shí)間，至今記得當初第一次在EDA實(shí)驗平臺上完成數字秒表、搶答器、密碼鎖等實(shí)驗時(shí)那個(gè)興奮勁。當時(shí)由于沒(méi)有接
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如何基于EMIF接口的DSP控制系統設計？

  • 摘要：提出一種DSP 通過(guò)EMIF 接口控制復雜系統的方案。通過(guò)將DSP 芯片連接多片FPGA，并利用FPGA 與各種外部芯片連接，使得DSP 通過(guò)EMIF 接口就能控制
  • 關(guān)鍵字： EMIF接口  FPGA  DSP  

適用于 FPGA、GPU 和 ASIC 系統的電源管理

  • 在 FPGA、GPU 或 ASIC 控制的系統板上，僅有為數不多的幾種電源管理相關(guān)的設計挑戰，但是由于需要反復調試，所以這類(lèi)挑戰可能使系統的推出時(shí)間嚴重滯后
  • 關(guān)鍵字： FPGA  GPU  ASIC  電源管理  

FPGA開(kāi)發(fā)之IP核：軟核、硬核以及固核概念

  • IP(Intelligent Property)核是具有知識產(chǎn)權核的集成電路芯核總稱(chēng)，是經(jīng)過(guò)反復驗證過(guò)的、具有特定功能的宏模塊，與芯片制造工藝無(wú)關(guān)，可以移植到不同的
  • 關(guān)鍵字： FPGA  IP核  固核概念  

如何基于蜜罐技術(shù)的FPGA實(shí)現技術(shù)？

  • 1. 項目背景蜜罐技術(shù)由來(lái)已久，蜜罐(Honeypot)是一種在互聯(lián)網(wǎng)上運行的計算機系統。它是專(zhuān)門(mén)為吸引并誘騙那些試圖非法闖入他人計算機系統的人(如電腦黑
  • 關(guān)鍵字： 蜜罐技術(shù)  FPGA  實(shí)現技術(shù)  

如何基于FPGA的短波通信接收機？

  • 短波通信又稱(chēng)高頻通信，是利用HF波段(3-30MHz)電磁波進(jìn)行的無(wú)線(xiàn)電通信。短波通信主要靠天波傳播，可經(jīng)電離層一次或數次反射，最遠可傳至上萬(wàn)里，如按氣
  • 關(guān)鍵字： FPGA  短波通信  接收機  

十年FPGA開(kāi)發(fā)經(jīng)驗工程師教你的絕密設計技巧

  • 從大學(xué)時(shí)代第一次接觸FPGA至今已有10多年的時(shí)間，至今記得當初第一次在EDA實(shí)驗平臺上完成數字秒表、搶答器、密碼鎖等實(shí)驗時(shí)那個(gè)興奮勁。當時(shí)由于沒(méi)有接
  • 關(guān)鍵字： CPLD  電子工程師  FPGA  

如何為基于FPGA的嵌入式系統進(jìn)行安全升級？

  • 如何防止器件ldquo;磚頭化rdquo;，只發(fā)出警告就夠了嗎?ldquo;系統正在更新，請勿關(guān)閉電源。rdquo;我們都看到過(guò)這個(gè)警告，它通常在電子器件要在閃存
  • 關(guān)鍵字： 嵌入式  FPGA  

如何基于CPLD的電池供電系統斷電電路的設計？

  • 今天，大多數的CPLD(復雜可編程邏輯器件)都采用可減少功耗的工作模式，但當系統未使用時(shí)，應完全切斷電源以保存電池能量，從而實(shí)現很多設計者的終極節
  • 關(guān)鍵字： CPLD  電池供電  斷電電路  

引起的較高時(shí)鐘頻率仿真失敗原因

  • 通常如果你的設計在較低時(shí)鐘頻率時(shí)通過(guò)了仿真，但是在較高時(shí)鐘頻率時(shí)卻失敗了，你的第一個(gè)問(wèn)題應該是你的設計在某個(gè)較高時(shí)鐘頻率時(shí)是否達到了時(shí)序約束
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如何設計基于FPGA的虛擬現實(shí)定位系統？

  • 虛擬現實(shí)技術(shù)是目前計算機信息科學(xué)中的前沿學(xué)科，文中設計了一種以FPGA 為核心的數據采集處理系統.利用HMC5883L和ADXL345對虛擬場(chǎng)景中物體的方位和朝
  • 關(guān)鍵字： FPGA  虛擬現實(shí)  定位系統  
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