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asic-to-fpga 文章 進(jìn)入asic-to-fpga技術(shù)社區
FPGA+CPU：并行處理大行其道
- 深亞微米時(shí)代，傳統材料、結構乃至工藝都在趨于極限狀態(tài)，摩爾定律也已有些捉襟見(jiàn)肘。而步入深亞納米時(shí)代，晶體管的尺寸就將接近單個(gè)原子，無(wú)法再往下縮減。傳統ASIC和ASSP設計不可避免地遭遇了諸如設計流程復雜、生產(chǎn)良率降低、設計周期過(guò)長(cháng)，研發(fā)制造費用劇增等難題，從某種程度上大大放緩了摩爾定律的延續。 顯而易見(jiàn)的是，在巨額的流片成本面前，很多中小規模公司不得不改變策略，更多的轉向FPGA的開(kāi)發(fā)和設計。反觀(guān)FPGA市場(chǎng)，即便是5年前，其相對于A(yíng)SIC的市場(chǎng)增速還是相當遲緩的，但在近些年，尤其是邁進(jìn)90n
- 關(guān)鍵字： FPGA CPU
Altera將舉辦技術(shù)大會(huì )分享最新解決方案
- Altera宣布將主辦2015年Altera技術(shù)大會(huì )(Altera Technology Day，ATD)活動(dòng)，這是橫跨亞太地區八個(gè)地點(diǎn)的一系列以技術(shù)為導向的研討會(huì )，包括臺灣、印度、新加坡、馬來(lái)西亞、韓國與中國，時(shí)間將從2015年8月6日至9月23日。 Altera技術(shù)及市場(chǎng)專(zhuān)家將會(huì )分享在電子系統設計上的最新趨勢， Terasic、MathWorks與Tektronix等合作夥伴也將展示在電子設計與產(chǎn)品上使用Altera的FPGA、SoC、IP與電源解決方案，以提供加速產(chǎn)品上市的價(jià)值。關(guān)于研討會(huì )
- 關(guān)鍵字： Altera FPGA
設計成本低、可重復使用的配電架構
- 最近，航天子系統采用的先進(jìn)半導體最底限是需有多個(gè)低電壓、具高電流軌條件，例如核心電壓小于1伏特(V)/30安培(A)的現場(chǎng)可編程門(mén)陣列(FPGA)。此外，各個(gè)負載也須具有獨特的排序、暫瞬、線(xiàn)路與負載調節的要求，這樣會(huì )讓配電網(wǎng)絡(luò )的設計變得更復雜。 目前航天總線(xiàn)提供28和100伏特不穩定的電源軌，可用于為最新的航天級半導體生成隔離的、有效率的穩壓電源。為滿(mǎn)足未來(lái)航天子系統的需求，開(kāi)發(fā)一個(gè)低成本、可擴展的配電架構，且可重復的設計是尋求從28或100伏特兩種輸入中，可有效地生成多個(gè)較小的電軌，并同時(shí)限制
- 關(guān)鍵字： FPGA PCB
基于FPGA與PCI總線(xiàn)的并行計算平臺設計實(shí)現
- 當前對于各種加密算法。除了有針對性的破解算法，最基本的思想就是窮舉密鑰進(jìn)行匹配，通常稱(chēng)為暴力破解算法。由于暴力破解算法包含密鑰個(gè)數較多，遍歷的時(shí)間超過(guò)實(shí)際可接受的范圍。如果計算速度提高到足夠快。這種遍歷的算法因結構設計簡(jiǎn)便而具有實(shí)際應用的前景。 PCI總線(xiàn)(外設互聯(lián)總線(xiàn))與傳統的總線(xiàn)標準——ISA總線(xiàn)(工業(yè)標準結構總線(xiàn))相比，具有更高的傳輸率(132MBps)、支持32位處理器及DMA和即插即用等優(yōu)點(diǎn)，用于取代ISA總線(xiàn)而成為目前臺式計算機的事實(shí)I/O總線(xiàn)標準，在普通PC
- 關(guān)鍵字： FPGA PCI
基于千兆網(wǎng)的FPGA多通道數據采集系統設計
- FPGA豐富的邏輯資源、充沛的I/O引腳以及較低的功耗，被廣泛應用于嵌入式系統和高速數據通信領(lǐng)域?，F如今，各大FPGA生產(chǎn)廠(chǎng)商為方便用戶(hù)的設計和使用，提供了較多的、可利用的IP核資源，極大地減少了產(chǎn)品的開(kāi)發(fā)周期和開(kāi)發(fā)難度，從而使用戶(hù)得以更專(zhuān)注地構思各種各樣創(chuàng )意且實(shí)用的功能，而不是把大量時(shí)間浪費在產(chǎn)品的調試和驗證中。 千兆以太網(wǎng)技術(shù)在工程上的應用是當前的研究熱點(diǎn)之一。相比于其他RS-232或RS-485等串口通信，千兆以太網(wǎng)更加普及和通用，可以直接與Internet上的其他終端相連;相比于百兆網(wǎng)絡(luò )
- 關(guān)鍵字： FPGA DDR2
采用基于A(yíng)ltera FPGA的存儲參考設計，NAND閃存使用壽命加倍
- Altera公司開(kāi)發(fā)了基于其Arria® 10 SoC的存儲參考設計，與目前的NAND閃存相比，NAND閃存的使用壽命將加倍，程序擦除周期數增加了7倍。參考設計在經(jīng)過(guò)優(yōu)化的高性?xún)r(jià)比單片解決方案中包括了一片Arria 10 SoC和集成雙核ARM® Cortex®A9處理器，同時(shí)采用了Mobiveil的固態(tài)硬盤(pán)(SSD)控制器，以及NVMdurance的NAND優(yōu)化軟件。這一參考設計提高了NAND應用的性能和靈活性，同時(shí)延長(cháng)了數據中心設備的使用壽命，從而降低了NAND陣列的成本。
- 關(guān)鍵字： Altera FPGA
小梅哥和你一起深入學(xué)習FPGA之mif文件的制作
- 本文檔主要講解實(shí)現一個(gè)1024點(diǎn)的16位正弦波數據的生成，并將該數據制作成quartus II使用的mif文件，使用此文件，我們便可以使用FPGA，基于直接數字合成(DDS)原理生成標準的正弦波，即實(shí)現信號發(fā)生器的功能。小梅哥的DDS實(shí)驗已經(jīng)做完，目前還沒(méi)有進(jìn)行文檔的編寫(xiě)。朋友今天邀請我為他制作一個(gè)1024點(diǎn)的16位的正弦波mif文件，實(shí)現之后，發(fā)現過(guò)程中涉及到MATLAB軟件、Excel軟件、Quartus II軟件的使用，每個(gè)過(guò)程簡(jiǎn)單，但是步驟較多，因此在這里以文檔的方式記錄下來(lái)，分享給需要的朋友
- 關(guān)鍵字： FPGA mif
FPGA實(shí)現的數字密碼鎖
- 本文介紹了一種以FPGA為基礎的數字密碼鎖。采用自頂向下的數字系統設計方法，將數字密碼鎖系統分解為若干子系統，并且進(jìn)一步細劃為若干模塊，然后用硬件描述語(yǔ)言VHDL來(lái)設計這些模塊，同時(shí)進(jìn)行硬件測試。測試結果表明該數字密碼鎖能夠校驗10位十進(jìn)制數字密碼，且可以預置密碼，設有斷電保護裝置，解碼有效指示等相應功能。 1功能概述 (1)密碼鎖的工作時(shí)鐘由外部晶振提供，時(shí)鐘頻率為50MHz，運算速度高，工作性能穩定。 (2)密碼的設置和輸入由外接鍵盤(pán)完成，控制電路的安全系數高，操作方便;
- 關(guān)鍵字： FPGA 數字密碼鎖
Altera宣布Stratix 10的創(chuàng )新：FPGA和SoC性能翻番、功耗降低70%
- 即將于2015年秋天提供Stratix 10 FPGA和SoC工程樣片的Altera公司，近日發(fā)布其Stratix 10 FPGA和SoC體系結構和產(chǎn)品細節，在性能、集成度、密度和安全特性方面實(shí)現了突破?！ tratix 10 FPGA和SoC采用了Altera革命性的HyperFlex FPGA架構，由Intel 14nm三柵極工藝技術(shù)制造，內核性能是前一代FPGA的2倍。性能好、密度高、具有先進(jìn)的嵌入式處理功能的FPGA與GPU類(lèi)浮點(diǎn)計算性能和異構3D SiP集成特性相結合，支持Altera客戶(hù)
- 關(guān)鍵字： Stratix 10 FPGA SoC工程樣片 Altera 201507
Altera全球業(yè)務(wù)開(kāi)發(fā)總監：數字電源躍居FPGA SoC設計新寵
- 20/14奈米現場(chǎng)可編程閘陣列(FPGA)將加速改搭數位電源。FPGA邁向20/14奈米先進(jìn)制程，導致電路復雜度和電源供應需求激增，相關(guān)晶片商已開(kāi)始導入高整合、可編程，且支援大電流的數位電源解決方案，從而提升FPGA核心電源軌的供電效能，同時(shí)改善系統整體功耗、占位空間和散熱機制，以滿(mǎn)足系統業(yè)者日益嚴格的節能設計要求。 Altera全球業(yè)務(wù)開(kāi)發(fā)總監Patrick Wadden強調，資料中心業(yè)者將更加注重伺服器核心處理器功耗。 Altera全球業(yè)務(wù)開(kāi)發(fā)總監Patrick Wadden表示，基地
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FPGA實(shí)戰演練邏輯篇：FPGA與ASIC
- 拋開(kāi)FPGA不提，大家一定都很熟悉ASIC。所謂ASIC，即專(zhuān)用集成電路(Application Specific Integrated Circuit)的簡(jiǎn)稱(chēng)，電子產(chǎn)品中，它無(wú)所不在，還真是比FPGA普及得多得多。但是ASIC的功能相對固定，它是為了專(zhuān)一功能而生，希望對它進(jìn)行任何的功能和性能的改善往往是無(wú)濟于事的。打個(gè)淺顯的比喻，如圖1.2所示，如果說(shuō)ASIC是布滿(mǎn)鉛字的印刷品，那么FPGA就是可以自由發(fā)揮的白紙一張。(特權同學(xué)版權所有) ? 圖1.2 ASIC和FPG
- 關(guān)鍵字： FPGA ASIC
FPGA實(shí)戰演練邏輯篇：FPGA是什么
- 在電子產(chǎn)品開(kāi)發(fā)的各種關(guān)鍵器件中，FPGA已經(jīng)受到了越來(lái)越多的關(guān)注。如果哪怕只是作為電子設計鏈中某個(gè)“小羅嘍”角色的你，對FPGA還聞所未聞，只能說(shuō)明你OUT了。相信閱讀此書(shū)的大多數讀者，您可能聽(tīng)說(shuō)過(guò)FPGA，但不是很了解;或者您已經(jīng)知道FPGA的存在，但不太清楚近期的動(dòng)向，或許您打算在不久的將來(lái)對FPGA進(jìn)行初步的嘗試。不管怎樣，只要您對FPGA感興趣，那么就讓我們一起踏出通往FPGA世界的第一步吧!(特權同學(xué)版權所有) 簡(jiǎn)單來(lái)說(shuō)，FPGA就是“可反復編程的邏
- 關(guān)鍵字： FPGA
基于I2C總線(xiàn)圖像傳感器配置的FPGA實(shí)現
- 基于FPGA的嵌入式圖像檢測系統因其快速的處理能力和靈活的編程設計使得它在工業(yè)現場(chǎng)的應用非常廣泛，通常這些系統都是通過(guò)采集圖像數據流并對它實(shí)時(shí)處理得到所需的特征信息。圖像數據的獲取是整個(gè)系統的第一步，作為整個(gè)系統的最前端，它決定了原始數據的質(zhì)量，是整個(gè)系統成功的關(guān)鍵。CMOS圖像傳感器采用CMOS工藝，可以將圖像采集單元和信號處理單元集成到同一塊芯片上，因而在集成度、功耗、成本上具有很大優(yōu)勢，這使得它在嵌入式圖像處理領(lǐng)域的運用越來(lái)越多。CMOS圖像傳感器芯片大都把I2C總線(xiàn)的一個(gè)子集作為控制接口，用戶(hù)
- 關(guān)鍵字： I2C FPGA
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歡迎您創(chuàng )建該詞條，闡述對asic-to-fpga的理解，并與今后在此搜索asic-to-fpga的朋友們分享。 創(chuàng )建詞條
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