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EEPW首頁(yè) >> 主題列表 >> irig－b碼

分布式錄波器高精度同步時(shí)鐘信號的實(shí)現

  • 同步時(shí)鐘信號是分布式錄波器系統任務(wù)順利完成的關(guān)鍵。介紹一種利用可編程CPLD器件實(shí)現性能優(yōu)良的分布式同步信號源。通過(guò)高度集成，將IRIG-B(DC)解碼器以及系統的各種同步邏輯電路集成在一個(gè)MAXII570芯片中，構成一個(gè)高精度同步系統，從而達到最佳同步效果。
  • 關(guān)鍵字： 分布式同步邏輯  IRIG-B  CPLD  

IRIG-B的編碼輸出電路

基于CPLD的IRIG-B碼對時(shí)方式在繼電保護裝置中的應用

  • 時(shí)間的精確和統一是變電站自動(dòng)化系統的最基本要求。只有電力系統中的各種自動(dòng)化設備(如故障錄波器、繼電保護裝置、RTU微機監控系統等)采用統一的時(shí)間基準，在發(fā)生事故時(shí)，才能根據故障錄波數據，以及各開(kāi)關(guān)、斷路器動(dòng)
  • 關(guān)鍵字： 通信報文對時(shí)  GPS IRIG－B碼對時(shí)  繼電保護  

基于CPLD器件在時(shí)間統一系統中的應用

  • 引言隨著(zhù)電子技術(shù)的發(fā)展，對遙測信號的幀結構的可編程度、集成度的要求越來(lái)越高，用于時(shí)間統一系統的B碼源的設計也趨于高度集成化。為了適應現代靶場(chǎng)試驗任務(wù)的要求，我們采用Altera的CPLD器件，將用于產(chǎn)生B碼的各種
  • 關(guān)鍵字： CPLD  時(shí)間統一系統  IRIG－B碼  

一種低成本的無(wú)線(xiàn)IRIG-H(DC)解碼器

  • 摘要：基于A(yíng)Tmega8單片機設計出一種簡(jiǎn)單、可靠、低成本的H碼(DC)解碼器。通過(guò)標準RS485接口接收差分H碼信號，信號經(jīng)隔離后通過(guò)單片機解碼程序處理，轉換成標準時(shí)間碼(時(shí)分形式)通過(guò)無(wú)線(xiàn)方式發(fā)送給其他設備。此設計增
  • 關(guān)鍵字： IRIG-H  ATmega8  nRF905  無(wú)線(xiàn)  解碼  

基于FPGA的IRIG-B碼解碼器設計

  • 摘要 針對基于單片機的IRIG—B碼解碼器解碼精度低、工作穩定性差等問(wèn)題，提出了一種基于FPGA的IRIG—B碼解碼器設計。在實(shí)現過(guò)程中著(zhù)重分析了輸
  • 關(guān)鍵字： IRIG―B碼  解碼  毛刺  

基于FPGA的IRIG-B標準DC code編碼器VHDL設計

  • 為了實(shí)現靶場(chǎng)時(shí)統終端輸出IRIG-B標準DC code信號，采用VHDL語(yǔ)言在FPGA邏輯電路中設計了DC code編碼器硬件電路，通過(guò)QuartusⅡ軟件建立工程文件對VHDL語(yǔ)言DC code編碼器電路進(jìn)行編譯和仿真，獲得了符合IRIG-B標準的DC code信號。經(jīng)過(guò)實(shí)踐驗證，該電路具有實(shí)現方法簡(jiǎn)單、電路穩定性好、精度高的特點(diǎn)，實(shí)測同步精度小于1μs。
  • 關(guān)鍵字： IRIG-B  FPGA  code  VHDL    

基于FPGA的IRIG-B編碼器的設計

  • 我國靶場(chǎng)測量、工業(yè)控制、電力系統測量與保護、計算、通信、氣象等測試設備均采用國際標準IRIG-B格式的時(shí)間碼(簡(jiǎn)稱(chēng)B碼)作為時(shí)間同步標準。B碼是一種串行的時(shí)間格式，分為直流碼(DC碼)和交流碼(AC碼)兩種，其格式和碼
  • 關(guān)鍵字： IRIG-B  FPGA  編碼器    

多功能內置式IRIG-B碼終端設計

  • 摘要：在分析武器裝備靶場(chǎng)試驗測控設備同步技術(shù)現狀基礎上，提出了一種多功能內置式IRIG-B碼終端設計；給出了終端的組成、功能與工作過(guò)程，詳細介紹了IRIG-B碼采集模塊、IRIG-B碼產(chǎn)生模塊和軟件模塊的設計；終端具有
  • 關(guān)鍵字： 設計  終端  IRIG-B  內置  多功能  

基于FPGA的IRIG-B(DC)碼解碼

  • 摘要：在分析了IRIG-B(DC)碼碼型特點(diǎn)的基礎上，提出了一種IRIG-B(DC)時(shí)間碼解碼的設計方法。該方法由少量外圍電路與一片現場(chǎng)可編程門(mén)陣列(FPGA)芯片組成，來(lái)實(shí)現對IRG-B(DC)碼的解碼、1 PPS信號輸出、實(shí)時(shí)時(shí)間顯示以
  • 關(guān)鍵字： IRIG-B  FPGA  DC  解碼    

基于CPLD的IRIG-B碼對時(shí)方式在繼電保護裝置中的應

  • 時(shí)間的精確和統一是變電站自動(dòng)化系統的最基本要求。只有電力系統中的各種自動(dòng)化設備(如故障錄波器、繼電保...
  • 關(guān)鍵字： IRIG-B碼  對時(shí)方式  在繼電保護  

IRIG-B碼對時(shí)方式在繼電保護裝置中的應用

  • 摘要：隨著(zhù)變電站自動(dòng)化技術(shù)的發(fā)展，對變電站內時(shí)間的精確和統一提出了更高的要求。本文提出了一種采用IRIG-B時(shí)間碼來(lái)時(shí)時(shí)的方案。在這種對時(shí)方案中，每個(gè)變電站只安裝一個(gè)GPS接收裝置，利用RS422／485總線(xiàn)傳輸IRIG-
  • 關(guān)鍵字： IRIG-B  對時(shí)方式  繼電保護裝置  中的應用    

FPGA實(shí)現IRIG-B(DC)碼編碼和解碼的設計

  • 為達到IRIG-B碼與時(shí)間信號輸入、輸出的精確同步，采用現代化靶場(chǎng)的IRIG-B碼編碼和解碼的原理，從工程的角度出發(fā)，提出了使用現場(chǎng)可編程門(mén)陣列(FPGA)來(lái)實(shí)現IRIG-B碼編碼和解碼的設計方案和體系結構，設計中會(huì )涉及到幾個(gè)不同的時(shí)鐘頻率，FPGA對時(shí)鐘的同步性具有靈活性、效率高、且功耗低?？垢蓴_性好的特點(diǎn)。結果表明，FPGA能夠確保為從設備提供同源的時(shí)鐘基準，使時(shí)鐘與信號的延遲控制在200 ns以?xún)?，從而得到了IRIG-B碼與時(shí)間精確同步的效果。
  • 關(guān)鍵字： IRIG-B  FPGA  DC  編碼    

基于FPGA的IRIG-B(DC)碼產(chǎn)生電路設計

  • 摘要：提出了一種IRIG-B(DC)碼產(chǎn)生電路的設計方法。采用Altera公司低功耗Cyclone FPGA系列中的EPlC6T144、8段數碼管、晶體振蕩器和MAX3232E等器件構成硬件電路、使用VHDL語(yǔ)言設計IRIG-B直流時(shí)間碼的軟件。為了設置和
  • 關(guān)鍵字： IRIG-B  FPGA  DC  產(chǎn)生電路    

基于FPGA的IRIG-B編碼器實(shí)現

  • 摘要：旨在設計一款基于FPGA的IRIG-B時(shí)間系統。該系統采用FPGA作為控制器，GPS引擎M12T作為標準時(shí)鐘源，利用M12T輸出的100 pps信號觸發(fā)IRIG-B編碼模塊，完成DC碼編碼。在DC碼的基礎上，通過(guò)正弦查找表實(shí)現了IRIG-B交
  • 關(guān)鍵字： 實(shí)現  編碼器  IRIG-B  FPGA  基于  FPGA  
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irig－b碼介紹

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