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EEPW首頁(yè) >> 主題列表 >> 串并轉換

FPGA系統設計原則和技巧之：FPGA系統設計的3種常用技巧

  • 輸入的數據經(jīng)過(guò)選擇開(kāi)關(guān)后，分別進(jìn)入緩沖模塊1和緩沖模塊2。當數據寫(xiě)入緩沖模塊1的時(shí)候，數據處理單元從緩沖模塊2讀取數據進(jìn)行處理；當數據寫(xiě)入緩沖模塊2的時(shí)候，數據處理單元從緩沖區模塊1讀取數據進(jìn)行處理。
  • 關(guān)鍵字： FPGA系統設計  緩沖模塊  乒乓操作  串并轉換  流水線(xiàn)處理  

D／A轉換在System View環(huán)境下的仿真及硬件實(shí)現

  • 摘要 針對模擬信號在傳輸介質(zhì)中優(yōu)于數字信號，而設計數模轉換模塊。首先用System View對DAC模塊進(jìn)了仿真。然后設計的D/A轉換的硬件電路。通過(guò)設計了一個(gè)前置的串并轉換電路，不僅可以實(shí)現8位并行數字信號的D/A轉換，
  • 關(guān)鍵字： 權電流  串并轉換  低通濾波  

基于FPGA的雙通道汽車(chē)渦輪增壓葉片溫度采集卡研制

  • 摘要：一種應用于汽車(chē)渦輪增壓器葉片溫度檢測的雙通道數據采集卡，該卡由峰值檢測、串行A/D構成模擬電路和由FPGA構成整個(gè)數字電路而組成。重點(diǎn)設計了FPGA內部串并轉換電路和FIFO，經(jīng)仿真和實(shí)驗驗證，串并轉換和FIFO的
  • 關(guān)鍵字： FPGA  串并轉換  FIFO  仿真  

基于CPLD的串并轉換和高速USB通信設計

  • 濾波和抗干擾是任何智能儀器系統都必須考慮的問(wèn)題。在傳統的應用系統中，濾波部分往往要占用較多的軟件資源和硬件資源。復雜可編程邏輯器件(CPLD)的出現，為解決這一問(wèn)題開(kāi)辟了新的途徑，采用CPLD實(shí)現濾波是一種高效
  • 關(guān)鍵字： CPLD  USB  串并轉換  通信設計    

四種常用FPGA/CPLD設計思想與技巧

STM-1并行幀同步系統的設計與FPGA實(shí)現

四種常用FPGA/CPLD設計思想與技巧之流水線(xiàn)操作

四種常用FPGA/CPLD設計思想與技巧之串并轉換

AT24系列存儲器數據串并轉換接口的IP核設計

  • 介紹用VHDL語(yǔ)言設計該存儲器數據串并轉換接口的IP核，從而通過(guò)硬件（FPGA或其他可編程芯片）實(shí)現AT24系列存儲器與8位微處理器之間的并行通信。
  • 關(guān)鍵字： AT  24  存儲器數據  串并轉換    
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串并轉換介紹

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