FPGA在彈上信息處理機中的應用
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圖3 信息處理機工作流程
38.4K異步串行輸入通道由FPGA的UART IP核完成串行輸入數據的接收，IP核根據字間隔是否超過(guò)2個(gè)字的接收時(shí)間來(lái)判斷是否完成一幀的接收，原理和1553總線(xiàn)數據的接收相同。
115.2K異步串行輸入通道由FPGA的UART IP核完成串行輸入數據的接收.緩沖區由一個(gè)FIFO組成。組幀狀態(tài)機會(huì )隨時(shí)查詢(xún)該FIFO空滿(mǎn)狀態(tài)，若不空，則就開(kāi)始連續的讀取過(guò)程，每間隔200μs從FIFO中讀取一個(gè)數據并按照規定格式和位置填入數據融合表,直到該FIFO的數據取完為止，若為空，則新幀對應通道的位置數據填零。
(4)組幀
組幀工作即遙測數據的數據融合，將各路遙測信息按照給定的數據融合格式組織成一個(gè)完整的100幀(1幀200us，100幀20ms)格式進(jìn)行發(fā)送，該功能由設計在FPGA內部“組幀狀態(tài)機(MFSTM)IP”完成。
(5)數據融合表
上電復位后，組幀狀態(tài)機MFSTM等待同步鎖定信號Sync Locked=“1”后開(kāi)始工作，并根據20ms緩沖區切換信號SwitchBuf進(jìn)行周期性的切換。按照數據融合表設計好的順序依次訪(fǎng)問(wèn)1.28M同步輸入串口緩沖區、4M 1553B總線(xiàn)數據緩沖區、115.2K異步輸入串口緩沖區、38.4K異步輸入串口緩沖區等等，并讀取指定數量的數據依次填入本次20ms的數據融合表中，重復100次，從而完成表中1～100行數據的填寫(xiě)。數據融合表的數據結構設計成FIFO, 使用FIFO可以平衡快速的組幀狀態(tài)機和慢速的發(fā)送狀態(tài)機之間的速度差異，使發(fā)送的數據流保持在2.56Mbps的波特率之下，持續發(fā)送。
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