20位Σ-Δ立體聲ADA電路TLC320AD75C的設計

摘 要：介紹了Σ-Δ型ADC和DAC的特點(diǎn)及構成，并詳細論述了Σ-Δ型立體聲ADA電路TLC320AD75C的模擬與數字音頻數據接口技術(shù)、DAC的串行控制接口技術(shù)及該類(lèi)器件的使用注意事項。

關(guān)鍵詞： Σ-ΔADC／DAC TLC320AD75C 音頻數據接口

１ Σ-Δ型ADC及DAC

現今使用的絕大部分A/D轉換器，例如并行比較型、逐次比較型、積分型等都屬于線(xiàn)性脈沖編碼調制（LPCM）型A/D轉換器[1]。一個(gè)分辨率為n位的這種類(lèi)型的A/D轉換器，為了能區分2n個(gè)不同的量化等級，需要相當復雜的比較網(wǎng)絡(luò )和極高精度的模擬電子器件。當位數n較高時(shí)，比較網(wǎng)絡(luò )的實(shí)現是十分困難的，因而限制了轉換器分辨率的提高。同時(shí)使用A/D轉換器構成采集系統時(shí)，還必須在轉換之前對抽樣值進(jìn)行抽樣保持，A/D轉換器分辨率越高，這種要求就越重要，因此在一些高精度采集系統中，在A(yíng)/D轉換器的前端除了設置有抗混疊濾波器外，大都還需要設置專(zhuān)門(mén)的抽樣／保持電路，從而增加了采集系統的復雜度。

所謂總和增量調制編碼（Σ-Δ）型A/D轉換器則與之不同[2]。LPCM型A/D轉換器完全忽略掉信號樣值之間的相關(guān)性，只是直接根據抽樣數據的每個(gè)樣值的大小進(jìn)行量化編碼；而Σ-Δ型A/D轉換器則是根據前一樣值與后一樣值之差即所謂增量的大小來(lái)進(jìn)行量化編碼。Σ-Δ型A/D轉換器一般由兩部分組成，第一部分為模擬Σ-Δ調制器，第二部分為數字抽取濾波器，如圖１（ａ）所示。Σ-Δ調制器以極高的抽樣頻率（遠高于奈奎斯特抽樣頻率）對輸入模擬信號進(jìn)行抽樣，并對兩個(gè)抽樣值之間的差值進(jìn)行低位量化（通常為１位），從而得到用低位數碼表示的Σ-Δ碼，然后將這種Σ-Δ碼送給第二部分的數字抽取濾波器進(jìn)行抽取濾波，從而得到高分辨率的LPCM信號。圖１（ｂ）為與之相對應的Σ-Δ型D/A轉換器。這種類(lèi)型的A/D和D/A轉換器，就量化而言，由于采用了極低位的量化器，避免了LPCM型A/D轉換器中需要制造高位D/A轉換器或高精度電阻網(wǎng)絡(luò )的困難；而且由于它采用Σ-Δ調制器技術(shù)和數字抽取濾波器，可以獲得極高的分辨率，大大超過(guò)了LPCM型A/D轉換器；再者由于碼位低，抽樣與量化編碼可以同時(shí)完成，幾乎不花時(shí)間，因此不需要抽樣保持電路，這樣就使采集系統的構成大為簡(jiǎn)化。與傳統的LPCM型A/D轉換器相比，Σ-Δ型A/D轉換器實(shí)際上是采用以高抽樣速率來(lái)?yè)Q取高位量化，即以速度換精度的方案。自90年代以來(lái)，Σ-Δ型A/D和D/A轉換器獲得了很大發(fā)展，并在高精度數據采集特別是在數字音響系統、多媒體、地震勘探儀、聲納、電子測量等領(lǐng)域中獲得了廣泛的應用。

２ TLC320AD75C簡(jiǎn)介

TLC320AD75C是使用四階Σ-Δ技術(shù)的高性能20位立體聲模數和數模轉換器（ADA），能同時(shí)進(jìn)行四路20位分辨率的模擬到數字（A/D）和數字到模擬（D/A）信號通道的轉換。其它功能還包括數字衰減、數字復原濾波、軟靜音和片內定時(shí)及控制[3]。該芯片具有以下特點(diǎn)：

·單5V（模擬／數字）電源電平及3.3V至5V數字接口電平

·采樣速率高達48kHz；

·分辨率為20位；

·ADC的信噪比為100dB；

·ADC的總諧波失真＋噪聲為0.0017%

·DAC的信噪比為104dB；

·DAC的總諧波失真＋噪聲為0.0013%；

·內部電源基準；

·串行接口；

·差分結構；

·DAC具有ＰＷＭ輸出；

·DAC的采樣率為32、44.1和48kHz時(shí)可進(jìn)行數字復原濾波；

·DAC具有數字衰減／軟靜音功能。

TLC320AD75C的引腳排列及引腳功能請參閱TI公司的產(chǎn)品數據手冊，其功能框圖如圖２所示。

３ TLC320AD75C的接口電路設計

由TLC320AD75C的功能方框圖可以看出，TLC320AD75與外電路的接口主要由三部分組成：一是TLC320AD75C與模擬音頻數據的接口，包括ADC的差分輸入和DAC的PWM輸出；二是TLC320AD75C與微控制器的數字音頻數據接口；三是DAC的串行控制接口。下面給出具體的電路設計。

3.1 與模擬音頻數據的接口

為了提供高的共模噪聲抑制比和增加輸入動(dòng)態(tài)范圍，TLC320AD75C的ADC的輸入采用差分形式；同時(shí)還要考慮到TLC320AD75C具有很高的速度和分辨率、開(kāi)關(guān)電容輸入結構以及單電源工作等特點(diǎn)，這就要求我們必須仔細設計相關(guān)的驅動(dòng)放大器。驅動(dòng)放大器必須提供一個(gè)低的信號源阻抗和足夠的輸出電流以驅動(dòng)ADC輸入，并且其高頻輸出阻抗必須足夠低，以避免帶來(lái)轉換誤差。圖３給出了TLC320AD75C與模擬音頻數據的接口電路，由于左、右聲道電路完全相同，故只畫(huà)出了一個(gè)聲道的接口電路。U1、U2和U3皆選用超低噪聲、寬頻帶、高精度、高速運算放大器OP37。U1和U2將單極性音頻輸入變換為差分形式的輸出，U3則將TLC320AD75C輸出的差分信號對L2-L1（PWM信號）變換成單極性信號。U1中＋5V通過(guò)兩個(gè)100KΩ的電阻給運放同相端提供+2.5的靜態(tài)偏置，100μF的電容則使其交流接地。U2同相端接法同U1，圖３中未畫(huà)出。

3.2 與數字音頻數據的接口

TLC320AD75C的串行端口有兩種工作方式：當M/S引腳為高電平時(shí)，ADC串行端口配置為主方式，TLC320AD75C從MCLKI產(chǎn)生LRCKA和SCLKA；當M/S接低電平時(shí)為從方式，器件從外部接收LRCKA和SCLKA。

本文以ADC的主方式為例說(shuō)明TLC320AD75C與微控制器間的接口。主方式時(shí)LRCKA在內部由MCLKI產(chǎn)生，LRCKA固定為采樣頻率fs(MCIKI/256)。在此信號為高電平期間，左通道數據串行移至輸出端；在低電平期間，右通道數據移至輸出端。轉換周期由LRCKA的上升沿同步。圖4中的（a）、（b）、（c）三個(gè)波形表示了在左、右通道數據所用的32個(gè)SCLKA周期中的前20個(gè)周期內，從TLC320AD75C中移出的20位、MSB在前的ADOUT數據。

從圖４可以看出，TLC320AD75C與具有同步串口的微控制器如TI公司DSP系列TMS320C2X/3X/5X/2XX/54X的接口相當容易。然而，目前我國ＤＳＰ的開(kāi)發(fā)和應用還不普遍，大量的科技和工程技術(shù)人員對ＤＳＰ比較生疏。與此相反，單片機如MCS51、8098、MCS196系列卻在我國相當普及并得到了廣泛的應用。遺憾的是MCS51系列單片機沒(méi)有同步串口，而且目前的大量數據采集系統的輸出要求的是并行數據?？紤]到上述情況，為了同MCS51系列接口，就要在滿(mǎn)足圖４時(shí)序的前提下，設計串轉并電路和并轉串電路。

圖５是TLC320AD75C的ADC與MCS51接口電路，DAC接口電路是上述電路的逆過(guò)程，只要將８位輸出鎖存移位寄存器（三態(tài)、串入并出）74LS595改成８位輸入鎖存移位寄存器74LS597（三態(tài)、并入串出）即可，此處不再詳述。圖５與圖３的畫(huà)法一樣，鑒于篇幅的限制，省略掉了一些電路細節，讀者應用本文中的電路時(shí)應補上。下面簡(jiǎn)單講述一下圖５所示電路的工作過(guò)程。根據圖４串行接口時(shí)序，要求利用LRCKA和SCLKA生成圖４（d）所示的脈沖。在該脈沖的高電平期間20位串行數據送到由三片74LS595級聯(lián)而成的串入并出接口電路中；在脈沖的下降沿將74LS595中移位寄存器中的數據傳輸到鎖存器；在脈沖的低電平期間發(fā)中斷到MCS51的INTO，MCS51依次發(fā)出三個(gè)片選信號，讀走該20位數據，從而完成一個(gè)聲道的采集工作。因此如何產(chǎn)生圖4(d)所示的脈沖是本電路的核心問(wèn)題。在圖５所示電路中，74LS123捕捉到的LRCKA上升沿和下降沿通過(guò)線(xiàn)與的方式生成圖4(e)形式的極窄脈沖。在該脈沖的低電平期間置位74LS74；兩片74LS160接成20進(jìn)制的計數器，在74LS74輸出高電平到來(lái)時(shí)對SCLKA進(jìn)行計數，當計滿(mǎn)20個(gè)脈沖時(shí)輸出一高電平脈沖，該脈沖經(jīng)一非門(mén)倒相去74LS74的復位端。74LS74在上述的置位與復位作用下即產(chǎn)生圖4(f)所示的脈沖，同時(shí)在該脈沖的低電平期間還要去清除計數器，停止計數器工作，直至該脈沖的下一個(gè)高電平到來(lái)。要指出的是圖4(f)所示脈沖比圖４（ｄ）所示的脈沖有一延遲，但只要該延遲時(shí)間小于ＴSCLKA/2，即圖4(f)所示脈沖的上升沿比轉換開(kāi)始后SCLKA的第一個(gè)上升沿早，同步計數器就可正確計數，不會(huì )漏掉１位串行數據。

3.3 DAC的串行控制接口

16位控制數據輸入執行器件的控制功能。TLC320AD75C采用最高有效位在前的格式，因此，對于16位數據字，D16是最高有效位（MSB），D1是最低有效位。圖6表示CDIN、SHIFT及LATCH的輸入時(shí)序。在LATCH為低電平期間，內部裝載數據。CDIN是24位數據流，包括16位控制數據D1～D16和8位器件地址A1～A8。圖７示出了TLC320AD75C與MCS51串行口的接口電路。在方式０狀態(tài)下，MCS51的串行口為同步移位寄存器方式，數據由RXD端出入，同步移位脈沖由TXD端輸出。由于MCS51發(fā)送、接收的是8位數據，低位在先，而TLC320AD75C采用最高有效位在前的格式，故在MCS51的軟件中應將數據高低位顛倒過(guò)來(lái)。