SFI-4接口的數據處理

　　(1)收端的RXI/F模塊

　　來(lái)自I/O引腳的接收端數據一方面在FPGA I/0內部通過(guò)ISERDES進(jìn)行串并轉換，然后把數據速率降低1/4供內部處理；另一方面用移相狀態(tài)機在IODELAY模塊上進(jìn)行移相，多達64級，每級大約15 ps，直到采樣時(shí)鐘的上升沿對準數據有效窗口的中心位置。RXIF模塊處理后的效果如圖1所示。只做位對齊的前提是要求在分配I/O引腳時(shí)給SFI－4接口同方向的信號盡可能靠近，數據總線(xiàn)間Skew盡可能小，并且PCB布線(xiàn)要等長(cháng)。

　　圖1 RXI/F模塊處理后的效果

　　(2) 收端的RX FIFO模塊

　　使用此FIFO的目的是一方面把ISERDES輸出的共64位數據寫(xiě)入FIFO；另一方面用用戶(hù)時(shí)鐘讀出FIFO數據給后端的用戶(hù)邏輯使用，最終達到隔離區域時(shí)鐘和用戶(hù)時(shí)鐘的目的。FIFO的位置如圖2所示。

　　圖2 FIFO的位置

　　(3)發(fā)送端的TXI/F模塊

　　發(fā)送端的處理是內部己經(jīng)處理好的數據經(jīng)過(guò)FPGA I/O內部的OSERDES進(jìn)行并串轉換輸出，如圖3所示的OSERDES部分。

　　圖3 OSERDES部分

　　(4) 發(fā)送端的TX FIFO模塊

　　使用此FIFO的目與RX FIFO功能類(lèi)似，區別在于讀出∏FO的數據通過(guò)OSERDES進(jìn)行并轉串輸出。