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Altera推進(jìn)了FPGA和SoC中高速串行收發(fā)器的評估

—— JNEye鏈路分析工具支持系統設計人員迅速進(jìn)行收發(fā)器鏈路仿真,查看通道特性
作者: 時(shí)間:2014-01-28 來(lái)源:電子產(chǎn)品世界 收藏

  公司(Nasdaq: ALTR)日前發(fā)布鏈路分析工具,提供驗證和電路板級全套設計工具。支持設計人員迅速方便的評估高速 和SoC中的高速串行鏈路性能。該工具結合了統計鏈路的速度優(yōu)勢和時(shí)域波形的精度優(yōu)勢,是一種新的混合行為仿真方法。工具經(jīng)過(guò)優(yōu)化,支持 10代系列產(chǎn)品,為用戶(hù)提供了評估Altera下一代和SoC收發(fā)器鏈路性能的平臺。

本文引用地址:http://dyxdggzs.com/article/221225.htm

  Altera研究員李鵬博士評論說(shuō):“我們提供全套的系統級設計工具,利用這些工具,客戶(hù)可以對其系統中使用的和SoC迅速進(jìn)行仿真和驗證。JNEye鏈路分析工具是這些解決方案的最新實(shí)例。使用JNEye,設計人員能夠在電路板級迅速理解我們收發(fā)器的性能,非常準確的了解我們的器件與系統中其他器件是怎樣相互作用的。”

  JNEye工具提供了混合建模方法,集成了器件特征模型,非常精確的處理工藝、電壓和溫度(PVT)變化。工具提供真實(shí)的仿真精度,簡(jiǎn)化了串行鏈路收發(fā)器的評估,而使用業(yè)界標準模型是無(wú)法實(shí)現這一點(diǎn)的。JNEye支持采用IBIS-AMI器件模型進(jìn)行鏈路仿真,可以評估Altera FPGA和其他發(fā)送器或者接收器之間的串行鏈路。采用JNEye鏈路分析工具,設計人員能夠針對誤碼率迅速優(yōu)化發(fā)送和接收均衡系數。工具還能用作后設計支持工具,以幫助進(jìn)行調試和驗證。

  在Quartus II軟件環(huán)境下,JNEye工具包含在A(yíng)ltera驗證和電路板設計工具套裝中。這些工具支持設計人員分析并解釋數據,監視系統在真實(shí)條件下的性能。JNEye工具目前支持28 nm Stratix V和Arria V FPGA,以及20 nm Arria 10 FPGA和SoC。使用這一工具,Arria 10器件設計人員還可以迅速驗證其電路板系統設計。

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