基于VerilogHDL的FIR數字濾波器設計與仿真

2、Verilog HDL代碼編寫(xiě)風(fēng)格

　　HDL代碼編寫(xiě)應該具有很好的易讀性和可重用性，而自頂向下的分割方法可以幫助我們達到最佳的結果。HDL代碼在達到功能的情況下要盡可能的簡(jiǎn)潔，盡量避免使用帶有特殊庫單元的實(shí)例，因為這樣會(huì )使得整個(gè)進(jìn)程變得不可靠。

　　在本設計中，我們將設計劃分成一個(gè)頂級文件和三個(gè)次級文件，并且調用了QuartusII中的MegaFunction功能輔助完成整個(gè)設計。

圖3顯示FIR濾波器的頂級方塊圖

表1：FIR濾波器的設計范例的端口列表

3、驗證仿真

　 完全可綜合設計的一個(gè)優(yōu)點(diǎn)就是同樣的HDL代碼能夠用于驗證和綜合。在使用HDL代碼之前必須要驗證設計的功能，最好且最簡(jiǎn)單的方法就是利用驗證工具，其次是利用仿真工具作有目的的仿真。

　　QuartusII內部帶有仿真器，只要通過(guò)建立正確的Vector Waveform File（向量波形文件）就可以開(kāi)始仿真了。圖4所示為QuartusII內部仿真器得到的8階FIR的脈沖響應波形。

　　五、結論

　　利用Verilog HDL設計數字濾波器的最大優(yōu)點(diǎn)就是可使設計更加靈活。比較硬件電路圖設計，Verilog HDL語(yǔ)言設計的參數可以很容易在Verilog程序中更改，通過(guò)綜合工具的簡(jiǎn)化和綜合即可以得到電路圖，其效率要高出利用卡諾圖進(jìn)行人工設計許多。而且編譯過(guò)程也非常簡(jiǎn)單高效。優(yōu)秀編碼風(fēng)格能夠在綜合過(guò)程中節省芯片使用的單元，從而降低設計成本。

　　參考文獻：

　　[1]. 夏宇聞。VerilogHDL數字系統設計教程，北京航空航天大學(xué)出版社，北京. 2003.

　　[2]. Altera Corporation. Introduction to QuartusII. 2003

　　[3]. Michael D. Ciletti. Advanced Digital Design with Verilog HDL. Prentice Hall, NJ.2005.

　　[4].彭保等.基于VerilogHDL的FPGA設計. 微計算機信息, 2004年第20卷第10期