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基于多數決定邏輯門(mén)的全加器電路設計

作者： 時(shí)間：2012-02-19 來(lái)源：網(wǎng)絡(luò ) 收藏
OTTOM: 0px; MARGIN: 0px 0px 20px; COLOR: rgb(0,0,0); TEXT-INDENT: 2em; LINE-HEIGHT: 24px; PADDING-TOP: 0px; TEXT-ALIGN: left">基于多數決定邏輯門(mén)的全加器電路設計



3 結語(yǔ)
提出一種低功耗的僅用輸入電容和CMOS反向器實(shí)現的一位全加器電路設計。該電路僅用了6個(gè)管子，從而達到降低功耗的目的。較少的管子、工作于極低電源電壓以及短路電流的消除是該全加器3個(gè)主要特征。

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