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DAC及其緩沖器有助于提升系統性能與簡(jiǎn)化設計一

作者： 時(shí)間：2012-10-03 來(lái)源：網(wǎng)絡(luò ) 收藏
構

　　性能特點(diǎn)

　　建立時(shí)間： 圖4和圖5比較了乘法DAC在電壓模式下的建立時(shí)間以及AD5541A的建立時(shí)間。當輸出上的容性負載最小時(shí)，AD5541A的建立時(shí)間約為1?s.

　　

DAC及其緩沖器有助于提升系統性能與簡(jiǎn)化設計一

　　圖4. 乘法DAC的建立時(shí)間

　　

DAC及其緩沖器有助于提升系統性能與簡(jiǎn)化設計一

　　圖5. AD5541A的建立時(shí)間

　　噪聲頻譜密度： 表1比較了AD5541A和乘法DAC的噪聲頻譜密度。AD5541A在10kHz下的性能略占優(yōu)勢，在1 kHz下優(yōu)勢非常明顯。

　　表1. AD5541A與乘法DAC的噪聲頻譜密度

　　

DAC及其緩沖器有助于提升系統性能與簡(jiǎn)化設計一
積分非線(xiàn)性： 積分非線(xiàn)性(INL)衡量DAC的理想輸出與排除增益和失調誤差之后的實(shí)際輸出之間的最大偏差。與R-2R網(wǎng)絡(luò )串聯(lián)的開(kāi)關(guān)可能會(huì )影響INL.乘法DAC一般采用NMOS開(kāi)關(guān)。當用于電壓開(kāi)關(guān)模式時(shí)，NMOS開(kāi)關(guān)的源極連接至基準電壓，漏極連接至梯形電阻，柵極由內部邏輯驅動(dòng)(圖6)。

　　

DAC及其緩沖器有助于提升系統性能與簡(jiǎn)化設計一

　　圖6. 乘法DAC開(kāi)關(guān)

關(guān)鍵詞： DAC 緩沖器 系統性能

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