基于Simulink的數字下變頻器設計及其FPGA實(shí)現
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數字下變頻是數字接收機中一個(gè)重要組成部分,實(shí)現將高速ADC轉換后的數字信號進(jìn)行抽取和濾波,得到低速的數字基帶信號。針對傳統模擬接收機系統帶寬較窄,系統體積大,同時(shí)缺少靈活性的缺點(diǎn),本文利用MATLAB的Simulink工具箱結合Altera公司的DspBuilder軟件,仿真和設計了一體積較小(只需要一片FPGA)、可靈活配置的中頻數字寬帶接收機,并進(jìn)行了FPGA的硬件實(shí)現。實(shí)驗結果表明:設計的數字中頻接收機具有系統帶寬較寬,體積較小,可以進(jìn)行靈活的配置,能滿(mǎn)足不同的性能要求等優(yōu)點(diǎn)。
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