基于FPGA的兩種DDS實(shí)現

引言
DDS(Direct Digital Freqiaency Synthesizers)廣泛應用于雷達系統、數字通信、電子對抗、電子測量等民用軍用設備中。它是隨著(zhù)半導體技術(shù)和數字技術(shù)的快速發(fā)展而發(fā)展起來(lái)的新型的頻率合成技術(shù)，與傳統的VCO+PLL的模擬方式產(chǎn)生所需頻率相比，DDS技術(shù)具有頻率分辨率高，相位噪聲低，帶寬較寬，頻譜純度好等優(yōu)點(diǎn)。這些技術(shù)指標在一個(gè)系統中是至關(guān)重要的，決定著(zhù)一個(gè)系統的成敗。

1 DDS的基本原理
1．1 頻率合成方式的基本原理
DDFS是根據余弦函數相位和幅值的對應關(guān)系，從相位出發(fā)，由不同的相位給出不同的電壓幅值，再經(jīng)過(guò)D／A變換和濾波最后得到一定頻率和調頻率的模擬信號。由此可見(jiàn)，DDS有很多功能模塊組成，如圖1所示。

若相位累加器有N位，時(shí)鐘頻率為fclk，頻率控制字為FCW。N位的相位累加器可以對時(shí)鐘頻率進(jìn)行2N分頻，所以DDS的精度可以達到：

頻率控制字是用來(lái)控制累加器的步進(jìn)的，累加器的步進(jìn)為。假設初始的相位偏移△φ=0，則經(jīng)過(guò)N個(gè)時(shí)鐘周期后相位累加器的輸出θ=2π*FCW*N*(1／2N)。在相位步進(jìn)△0時(shí)，完成2π的相位變化即為完成一個(gè)輸出周期，所以20／△θ*Tclk=T0，即：

可見(jiàn)調節FCW可以任意地按照要求改變輸出頻率，這就達到了頻率合成的目的。
1．2 直讀方式DDS的原理
直讀法(DDWS)工作流程是，把所需要的DDS的波形，直接用Matlab抽樣量化，然后把量化的數據直接存儲到FPGA的BlockRAM中，再在時(shí)鐘頻率的控制下直接從BlockRAM中讀取數據，D／A后輸出原來(lái)波形。