如何優(yōu)化嵌入式DSP應用的功耗
架構
應用范例如圖 2 所示。如欲獲得該應用的詳細信息(包括獨立的應用手冊及源代碼),請查閱參考資料 15。
圖 2. 音頻應用
音頻信號經(jīng)過(guò)采樣通過(guò)多信道緩沖串行端口 (McBSPs) 回放到 DSP。DSP DMA 引擎向McBSP 輸入或讀出采樣信號。立體聲音頻數據通過(guò) RxSplit 任務(wù)與 Processing Task(正在處理的任務(wù))分離為兩個(gè)數據流。DIP 開(kāi)關(guān)用于選擇 G726 編碼/解碼處理或簡(jiǎn)單音量控制。兩個(gè)通道隨后在 TxJoin 任務(wù)中組合,然后輸出至揚聲器。
Control(控制)任務(wù)被周期性觸發(fā),檢查 DIP 開(kāi)關(guān)以確定是否需要進(jìn)行模式切換(如改變處理模式或進(jìn)入睡眠狀態(tài))。根據應用模式的不同,Control(控制)任務(wù)可能會(huì )檢查 CPU 負載,如果合適還會(huì )更改 V/F 設定點(diǎn)。
與電源相關(guān)的關(guān)鍵設計決定包括:
- 使用 OS 線(xiàn)程及阻塞原語(yǔ) (blocking primitive) 空閑時(shí)鐘;
- 使用 DMA 提高后臺數據 (background data) 傳輸效率。在 DMA 塊中完成傳輸(而不是每次數據采樣都從串行端口導入或讀出)后即中斷 CPU;
- 使用共享的外部時(shí)鐘控制串行端口(無(wú)需對串行端口進(jìn)行重新編程,即可進(jìn)行 DSP CPU 的頻率縮放);
- 注冊回叫以便為編解碼器驅動(dòng)程序設定鉤子機制,當應用進(jìn)入深度睡眠模式時(shí)關(guān)斷編解碼器;
- 在音頻質(zhì)量下降前使用校準功能恢復設定點(diǎn)頻率(及電壓);
- 使用電源管理器的時(shí)鐘適應功能,使周期函數在頻率縮放后繼續以特定速率工作;
- 使用 DSP 再引導間的電源管理器“深度睡眠”接口。
結論
總體效果總結如表 6 所示。前后模式的主要差異用黑體表示。
設置 | DSP 內核 (mW) | DSP 節省 (%) | 電路板 (mW) | 電路板節省 (%) |
1. CPU 工作頻率為 192MHz、電壓為1.6v | 207.8 | -- | 2219 | -- |
2. CPU 工作頻率為192MHz、電壓為 1.6v | 203.3 | 2.17 | 1789 | |
3. CPU 工作頻率為192MHz、電壓為1.6v | 155.2 | 1663 | 25.1 | |
4. CPU 工作頻率為144MHz、電壓為 1.4v | 99.5 | 1605 | 27.7 | |
5. DSP 處于深度睡眠(完全空閑)狀態(tài) | 0.361 | 1352 |
表 6. 節電效果
- 模式 #1 為基準測量,全部使用片外代碼。
- 模式 #2 消除所有片上代碼,DSP 級節電效果較小,但板級節電達到 19%。
- 模式 #3 包括一些引導時(shí)間節電配置(如關(guān)閉 DSP 的 CLKOUT 信號、未用計時(shí)器的自動(dòng)空閑配置以及關(guān)閉板上 LED)及在 BIOS 空閑環(huán)路中的閑置,從而可實(shí)現25% 的 DSP 內核級節電。
- 模式 #4 為設定點(diǎn)在 1.4v 下降至 144MHz 時(shí)的功耗,在該模式下可進(jìn)行音頻處理,同時(shí)仍能滿(mǎn)足實(shí)時(shí)最低要求,從而實(shí)現 52% 的 DSP 內核級節電。
- 模式 #5 為應用處于待機模式下的功耗,該模式配置包括外部編解碼器關(guān)斷、設定點(diǎn)支持以最小電壓最大頻率快速啟動(dòng)驅動(dòng)、DSP 處于門(mén)控時(shí)鐘深度睡眠模式,該模式下的待機功耗僅為 361µW。
設計人員可根據特定應用的要求選擇適用的技術(shù),從而更有利于支持 RTOS 集成高回報技術(shù)。借助 OS 的這種支持功能,設計人員能夠以低開(kāi)銷(xiāo)方便安全地提高應用電源效率。
本文討論的電源優(yōu)化策略是一種從嵌入式項目之初即可用于降低與調節應用功耗的通用模型。當測量功耗無(wú)法滿(mǎn)足要求或需要采用額外的運行時(shí)技術(shù)時(shí),上述策略可重復使用,先期步驟也可重復進(jìn)行。例如,在音頻應用中采用這種策略,僅需幾種高回報的節電技術(shù),即可節省大量電能。
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