高速高精度流水線(xiàn)模數轉換器的設計
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對比版圖修正前后兩版芯片的測試結果，我們可以發(fā)現修正后ADC的INL從原來(lái)的-5.0/+4.8LSB降低為-0.62/+0.46LSB，在2.41MHz輸入，100MHz采樣率下SNDR和SFDR分別從原來(lái)的57.9dB和68.9dBc提高到67.5dB和87.2dBc。所以說(shuō)，本文對寄生電阻的分析是合理的，對應的修正措施也是行之有效的。
結語(yǔ)
本文給出了兩次流片的測試結果，著(zhù)重分析了第一版芯片性能不太理想的原因，指出問(wèn)題出在版圖設計中的寄生電阻效應，并用MATLAB行為級建模驗證了這種效應對ADC性能的影響。根據分析結果，第二版芯片版圖相應地作了修正并再次流片，測試結果表明本文對寄生電阻的分析是合理的，對應的修正措施也是行之有效的。修正后ADC的INL從原來(lái)的-5.0/+4.8 LSB降低為-0.62/+0.46 LSB;在2.41MHz輸入，100MHz采樣率下SNDR和SFDR分別從原來(lái)的57.9dB和68.9dBc提高到67.5dB和87.2dBc。該ADC是在0.18mm CMOS工藝下加工的，總面積為3.51mm2，電源電壓為1.8V，功耗僅112mW。
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