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全新 Spartan UltraScale+ FPGA 系列 - 以小型封裝實(shí)現高 I/O 和低功耗
- 在構建嵌入式應用的過(guò)程中，硬件設計人員長(cháng)期以來(lái)面臨著(zhù)艱難的取舍，為推動(dòng)產(chǎn)品快速上市，他們必須在成本、I/O 數量和邏輯密度要求之間達成平衡。我們非常高興地宣布一款解決方案讓這種取舍自此成為歷史: 全新 AMD Spartan UltraScale+ FPGA 低成本系列帶來(lái)出色的 I/O 邏輯單元比、低功耗以及強大的安全功能，同時(shí)兼具小型尺寸。AMD Spartan UltraScale+ FPGA 系列在價(jià)格、功耗、功能和尺寸之間取得了良好的平衡，為我們的成本優(yōu)化型產(chǎn)品組合提供有力補充
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第六代Spartan FPGA迎接智能邊緣互聯(lián)新挑戰
- 預計到2028年，物聯(lián)網(wǎng)設備的數量將增加一倍以上，處理能力需求也將同步增長(cháng)。設備數量的激增會(huì )推動(dòng)產(chǎn)生對于更高數量I/O的需求、對更通用I/O的需求，以及對于邊緣端安全解決方案的需求；處理能力需求的提升則需要更強且更有效率的處理器，這些需求的驅動(dòng)下，經(jīng)濟型FPGA迎來(lái)了全新的市場(chǎng)發(fā)展機遇。 作為經(jīng)濟型FPGA的經(jīng)典系列，從1998年Spartan FPGA首發(fā)以來(lái)持續推動(dòng)著(zhù)包括日常所使用技術(shù)的進(jìn)步以及醫療機器人和宇航探索等很多突破性的進(jìn)展，特別是最近這些年在諸多邊緣互聯(lián)應用中收獲了廣泛的應用場(chǎng)景。在總結Sp
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Achronix以創(chuàng )新FPGA技術(shù)推動(dòng)智能汽車(chē)與先進(jìn)出行創(chuàng )新
- 全球領(lǐng)先的高性能現場(chǎng)可編程門(mén)陣列（FPGA）和嵌入式FPGA（eFPGA）半導體知識產(chǎn)權（IP）提供商Achronix Semiconductor公司宣布，該公司參加了由私募股權和風(fēng)險投資公司Baird Capital舉辦的“Baird車(chē)技術(shù)與出行大會(huì )（Baird Vehicle Technology & Mobility Conference）”。Achronix此舉是為了聯(lián)絡(luò )更多的創(chuàng )新者和投資者，共同推動(dòng)更加先進(jìn)的FPGA技術(shù)更廣泛地應用于智能汽車(chē)、自動(dòng)駕駛、ADAS和其他先進(jìn)出行方式。Bai
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英特爾成立獨立FPGA公司Altera
- 3月1日，英特爾宣布，成立全新的FPGA（現場(chǎng)可編程門(mén)陣列）半導體公司Altera，并計劃在未來(lái)兩到三年內為Altera進(jìn)行股票發(fā)行。據了解，2015年，英特爾斥資167億美元收購Altera，也是迄今為止該公司最大額的并購交易。Altera將致力于提供端到端的FPGA解決方案、易于使用的AI以及軟件工具，同時(shí)也加強了供應鏈的韌性，以在FPGA市場(chǎng)繼續保持領(lǐng)先地位。英特爾表示，Altera的產(chǎn)品組合將更加多元化，包含業(yè)界唯一內置AI能力的FPGA。Altera FPGA在云端運算、數據中心、工業(yè)自動(dòng)化、通
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英特爾宣布成立全新獨立運營(yíng)的FPGA公司——Altera
- 今天，英特爾宣布成立全新獨立運營(yíng)的FPGA公司——Altera。在FPGA Vision線(xiàn)上研討會(huì )期間，首席執行官Sandra Rivera和首席運營(yíng)官Shannon Poulin進(jìn)行了分享，展示其在超過(guò)550億美元的市場(chǎng)中保持領(lǐng)先性的戰略規劃，強調將通過(guò)打造集成AI功能的FPGA等舉措，進(jìn)一步豐富公司的產(chǎn)品組合，同時(shí)亦表明將持續助力客戶(hù)應對不斷增加的挑戰。會(huì )上，Altera也作為新公司的品牌正式對外公布。Altera首席執行官Sandra Rivera表示，“現階段，客戶(hù)正面臨日益復雜的技術(shù)挑戰，而我們
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CPLD/FPGA 內部結構與原理
- 可編程邏輯器件（Programmable Logic Device，PLD）起源于20世紀70年代，是在專(zhuān)用集成電路（ASIC）的基礎上發(fā)展起來(lái)的一種新型邏輯器件，是當今數字系統設計的主要硬件平臺，其主要特點(diǎn)就是完全由用戶(hù)通過(guò)軟件進(jìn)行配置和編程，從而完成某種特定的功能，且可以反復擦寫(xiě)。在修改和升級PLD時(shí)，不需額外地改變PCB電路板，只是在計算機上修改和更新程序，使硬件設計工作成為軟件開(kāi)發(fā)工作，縮短了系統設計的周期，提高了實(shí)現的靈活性并降低了成本，因此獲得了廣大硬件工程師的青睞，形成了巨大的PLD產(chǎn)業(yè)規模
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淺談因電遷移引發(fā)的半導體失效
- 前言半導體產(chǎn)品老化是一個(gè)自然現象，在電子應用中，基于環(huán)境、自然等因素，半導體在經(jīng)過(guò)一段時(shí)間連續工作之后，其功能會(huì )逐漸喪失，這被稱(chēng)為功能失效。半導體功能失效主要包括：腐蝕、載流子注入、電遷移等。其中，電遷移引發(fā)的失效機理最為突出。技術(shù)型授權代理商Excelpoint世健的工程師Wolfe Yu在此對這一現象進(jìn)行了分析。?1、?背景從20世紀初期第一個(gè)電子管誕生以來(lái)，電子產(chǎn)品與人類(lèi)的聯(lián)系越來(lái)越緊密，特別是進(jìn)入21世紀以來(lái)，隨著(zhù)集成電路的飛速發(fā)展，人們對電子產(chǎn)品的需求也變得愈加豐富。隨著(zhù)電子
- 關(guān)鍵字： 電遷移 半導體失效 世健 Microchip Flash FPGA
2024年FPGA將如何影響AI？
- 隨著(zhù)新一年的到來(lái)，科技界有一個(gè)話(huà)題似乎難以避開(kāi)：人工智能。事實(shí)上，各家公司對于人工智能談?wù)摰萌绱酥?，沒(méi)有熱度才不正常！在半導體領(lǐng)域，大部分對于A(yíng)I的關(guān)注都集中在GPU或專(zhuān)用AI加速器芯片（如NPU和TPU）上。但事實(shí)證明，有相當多的組件可以直接影響甚至運行AI工作負載。FPGA就是其中之一。對于那些了解FPGA靈活性和可編程性的人來(lái)說(shuō)，這并不令人驚訝，但對許多其他人來(lái)說(shuō)，這兩者之間的聯(lián)系可能并不明顯。問(wèn)題的關(guān)鍵在于通過(guò)軟件讓一些經(jīng)典的AI開(kāi)發(fā)工具（如卷積神經(jīng)網(wǎng)絡(luò )（CNN））針對FPGA支持的可定制電路設
- 關(guān)鍵字： FPGA AI 萊迪思
Verilog HDL基礎知識9之代碼規范示例
- 2.Verilog HDL 代碼規范 模板示例//******************************************************** // // Copyright(c)2016, ECBC // All rights reserved // // File name
- 關(guān)鍵字： FPGA verilog HDL 代碼規范
Verilog HDL基礎知識9之代碼規范
- 1.RTL CODE 規范1.1標準的文件頭在每一個(gè)版塊的開(kāi)頭一定要使用統一的文件頭，其中包括作者名，模塊名，創(chuàng )建日期，概要，更改記錄，版權等必要信息。 統一使用以下的文件頭：其中*為必需的項目//******************************************************** // // Copyright(c)2016, ECBC // All rights&nbs
- 關(guān)鍵字： FPGA verilog HDL 代碼規范
詳解CPLD/FPGA架構與原理
- 可編程邏輯器件（Programmable Logic Device，PLD）起源于20世紀70年代，是在專(zhuān)用集成電路（ASIC）的基礎上發(fā)展起來(lái)的一種新型邏輯器件，是當今數字系統設計的主要硬件平臺，其主要特點(diǎn)就是完全由用戶(hù)通過(guò)軟件進(jìn)行配置和編程，從而完成某種特定的功能，且可以反復擦寫(xiě)。在修改和升級PLD時(shí)，不需額外地改變PCB電路板，只是在計算機上修改和更新程序，使硬件設計工作成為軟件開(kāi)發(fā)工作，縮短了系統設計的周期，提高了實(shí)現的靈活性并降低了成本，因此獲得了廣大硬件工程師的青睞，形成了巨大的PLD產(chǎn)業(yè)規模
- 關(guān)鍵字： CPLD FPGA 架構
Verilog HDL基礎知識8之綜合語(yǔ)句
- 可綜合語(yǔ)句1.要保證Verilog HDL賦值語(yǔ)句的可綜合性，在建模時(shí)應注意以下要點(diǎn)：2.不使用initial。3.不使用#10。4.不使用循環(huán)次數不確定的循環(huán)語(yǔ)句，如forever、while等。5.不使用用戶(hù)自定義原語(yǔ)（UDP元件）。6.盡量使用同步方式設計電路。7.除非是關(guān)鍵路徑的設計，一般不采用調用門(mén)級元件來(lái)描述設計的方法，建議采用行為語(yǔ)句來(lái)完成設計。8.用always過(guò)程塊描述組合邏輯，應在敏感信號列表中列出所有的輸入信號。9.所有的內部寄存器都應該能夠被復位，在使用FPGA實(shí)現設計時(shí)，應盡量使
- 關(guān)鍵字： FPGA verilog HDL 綜合語(yǔ)句
Microchip推出低成本PolarFire SoC Discovery工具包 加速RISC-V和FPGA設計
- 嵌入式行業(yè)對基于RISC-V?的開(kāi)源處理器架構的需求日益增長(cháng)，但在商用芯片或硬件方面的選擇仍然有限。為了填補這一空白并推動(dòng)創(chuàng )新，Microchip Technology Inc.（微芯科技公司）宣布推出PolarFire? SoC Discovery工具包。通過(guò)為嵌入式處理和計算加速提供用戶(hù)友好、功能豐富的開(kāi)發(fā)工具包，Microchip可幫助各種水平的工程師采用新興技術(shù)。新發(fā)布的開(kāi)源開(kāi)發(fā)工具包具有支持Linux?和實(shí)時(shí)應用的四核 RISC-V 應用級處理器、豐富的外設和95K低功耗高性能FPGA邏輯元件。
- 關(guān)鍵字： Microchip PolarFire 嵌入式系統工程師 RISC-V FPGA
Verilog HDL基礎知識7之模塊例化
- Verilog使用模塊（module）的概念來(lái)代表一個(gè)基本的功能塊。一個(gè)模塊可以是一個(gè)元件，也可以是低層次模塊的組合。常用的設計方法是使用元件構建在設計中多個(gè)地方使用的功能塊，以便進(jìn)行代碼重用。模塊通過(guò)接口（輸入和輸出）被高層的模塊調用，但隱藏了內部的實(shí)現細節。這樣就使得設計者可以方便地對某個(gè)模塊進(jìn)行修改，而不影響設計的其他部分。在verilog中，模塊聲明由關(guān)鍵字module開(kāi)始，關(guān)鍵字endmodule則必須出現在模塊定義的結尾。每個(gè)模塊必須具有一個(gè)模塊名，由它唯一地標識這個(gè)模塊。模塊的端口列表則描述
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Verilog HDL基礎知識6之語(yǔ)法結構
- 雖然 Verilog 硬件描述語(yǔ)言有很完整的語(yǔ)法結構和系統，這些語(yǔ)法結構的應用給設計描述帶來(lái)很多方便。但是 Verilog是描述硬件電路的，它是建立在硬件電路的基礎上的。有些語(yǔ)法結構是不能與實(shí)際硬件電路對應起來(lái)的，比如 for 循環(huán)，它是不能映射成實(shí)際的硬件電路的，因此，Verilog 硬件描述語(yǔ)言分為可綜合和不可綜合語(yǔ)言。下面我們就來(lái)簡(jiǎn)單的介紹一下可綜合與不可綜合。(1) 所謂可綜合，就是我們編寫(xiě)的Verilog代碼能夠被綜合器轉化為相應的電路結構。因此，我們常用可綜合語(yǔ)句來(lái)描述數字硬件電路。(2) 所
- 關(guān)鍵字： FPGA verilog HDL 語(yǔ)法結構
fpga介紹
FPGA是英文Field－Programmable Gate Array的縮寫(xiě)，即現場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、EPLD等可編程器件的基礎上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專(zhuān)用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現的，既解決了定制電路的不足，又克服了原有可編程器件門(mén)電路數有限的缺點(diǎn)。
FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個(gè)新概念，內部包括可 [ 查看詳細 ]
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