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基于FPGA 的二維提升小波變換IP核設計

  • 提出了一種高效并行的二維離散提升小波(DWT)變換結構，該結構只需要7 行數據緩存，即可實(shí)現行和列方向同時(shí)進(jìn)行濾波變換。
  • 關(guān)鍵字： 小波變換  數據緩存  FPGA  IP核  

基于FPGA的水聲信號高速采集存儲系統設計

  • 介紹了一種基于FPGA的水聲信號數據采集與存儲系統的設計與實(shí)現，給出了系統的總體方案，并對各部分硬件和軟件的設計進(jìn)行了詳細描述。系統以FPGA作為數據的控制處理核心，以存儲容量達2GB的大容量NAND型Flash作為存儲介質(zhì)。該系統主要由數據采集模塊、數據存儲模塊和RS～232串行通信模塊組成，具有穩定可靠、體積小、功耗低、存儲容量大等特點(diǎn)，實(shí)驗證明該系統滿(mǎn)足設計要求。
  • 關(guān)鍵字： 水聲信號數據采集  NANDFlash  FPGA  

基于FPGA控制的IDE磁盤(pán)陣列設計

  • 設計了一種基于FPGA控制的高速數據存儲系統。該系統采用FPGA實(shí)現了對四個(gè)符合ATA-6規范的、RAID 0配置的IDE磁盤(pán)陣列的管理，并配合四個(gè)SDRAM實(shí)現對數據的高速穩定存儲。該磁盤(pán)陣列同時(shí)掛四個(gè)IDE硬盤(pán)，平均數據流達到200MB/s，峰值傳輸速率達到800MB/s，也可以擴展更多硬盤(pán)，構成大容量的磁盤(pán)陣列。
  • 關(guān)鍵字： 高速數據存儲  IDE磁盤(pán)陣列  FPGA  

基于FPGA的實(shí)時(shí)數字化光纖傳輸系統的設計與實(shí)現

  • 提出一種實(shí)時(shí)數字化光纖傳輸系統，該系統分為發(fā)送端和接收端。發(fā)送端用A／D轉換器將輸入的模擬信號數字化，再用FPGA對數據進(jìn)行處理，并通過(guò)光纖傳輸。同時(shí)，FPGA還控制A／D轉換器的工作。接收端用串行收發(fā)器TLK1501對接收數據進(jìn)行解碼處理，還原有效信號。實(shí)驗表明，該系統實(shí)時(shí)性好、信號傳輸誤碼率低、工作性能穩定、抗干擾性強，系統具有可行性和有效性。
  • 關(guān)鍵字： 光纖通訊  高速數字信號傳輸  FPGA  

軟件無(wú)線(xiàn)電數字下變頻技術(shù)研究及FPGA實(shí)現

  • 在數字下變頻系統實(shí)現方案中，輸入的模擬中頻信號經(jīng)過(guò)高速A/D采樣數字化后與數控振蕩器NCO(Numerically Controlled Osillator)產(chǎn)生的正交本振信號混頻，然后再由抽取濾波模塊進(jìn)行處理，以輸出低速的低頻或基帶信號。本文以軟件無(wú)線(xiàn)電數字下變頻技術(shù)為研究對象，參考GSM系統建立數字下變頻系統。
  • 關(guān)鍵字： 數字變頻  軟件無(wú)線(xiàn)電  FPGA  

基于FPGA的固定倍率圖像縮放的實(shí)現

  • 基于FPGA硬件實(shí)現固定倍率的圖像縮放，將2維卷積運算分解成2次1維卷積運算，對輸入原始圖像像素先進(jìn)行行方向的卷積，再進(jìn)行列方向的卷積，從而得到輸出圖像像素。把圖像縮放過(guò)程設計為一個(gè)單元體的循環(huán)過(guò)程，在單元體內部，事先計算出卷積系數。降低了FPGA設計的復雜性，提高了圖像縮放算法的運算速度，增強了系統的實(shí)時(shí)性，已經(jīng)應用于某款航空電子產(chǎn)品中，應用效果良好。
  • 關(guān)鍵字： 圖像縮放  卷積運算  FPGA  

10Gbps線(xiàn)速轉發(fā)引擎的并行流水線(xiàn)設計與實(shí)現

  • 設計了一種基于FPGA平臺的并行處理流水線(xiàn)結構，配合高速查表，可支持10Gbps接口的報文轉發(fā)。該設計已應用在國家863計劃重大課題“可擴展到T比特的高性能IPv4/v6路由器基礎平臺及實(shí)驗系統”中,并通過(guò)測試。
  • 關(guān)鍵字： 并行流水線(xiàn)  高速查表  FPGA  

基于FPGA的雙路可移相任意波形發(fā)生器

  • 本文論述了利用用FPGA來(lái)開(kāi)發(fā)DDS函數發(fā)生器的總體設計思路，詳細討論了任意波形產(chǎn)生、頻率精確調整、雙路移相輸出、PWM調制波產(chǎn)生、D/A轉換與濾波電路、鍵盤(pán)與顯示等諸方面軟硬件實(shí)現方法。 整個(gè)設計
  • 關(guān)鍵字： DDS  任意波形發(fā)生器  FPGA  

基于FPGA的同步FIFO在大幅面高速彩色噴繪機噴頭數據傳輸中的應用

  • 研究了基于FPGA的同步FIFO和移位寄存器，利用同步FIFO作為大幅面高速彩色噴繪機噴頭與上位機之間數據傳輸以及接口數據傳輸的緩存模塊。該設計在保證數據傳輸實(shí)時(shí)性的前提下，解決了噴頭和上位機像素數據格式方向不一致的問(wèn)題，并消除了部分數據冗余。
  • 關(guān)鍵字： 同步FIFO  彩色噴繪機  FPGA  

基于FPGA的電梯控制器的設計與實(shí)現

  • 介紹了基于A(yíng)ltera公司EP1K30TC144芯片的電梯控制器設計過(guò)程，描述了該控制系統的功能。該設計采用VHDL語(yǔ)言進(jìn)行編程，以QUARTUSⅡ軟件為開(kāi)發(fā)平臺，對本設計進(jìn)行了仿真，并使用JTAG將程序代碼下載到實(shí)驗板上進(jìn)行了硬件驗證。
  • 關(guān)鍵字： JTAG  電梯控制器  FPGA  

基于FPGA的水聲信號高速采集存儲系統的設計與實(shí)現

  • 介紹了一種基于FPGA的水聲信號數據采集與存儲系統的設計與實(shí)現,給出了系統的總體方案,并對各部分硬件和軟件的設計進(jìn)行了詳細描述。系統以FPGA作為數據的控制處理核心,以存儲容量達2 GB的大容量NAND型Flash作為存儲介質(zhì)。該系統主要由數據采集模塊、數據存儲模塊和RS-232串行通信模塊組成,具有穩定可靠、體積小、功耗低、存儲容量大等特點(diǎn),實(shí)驗證明該系統滿(mǎn)足設計要求。
  • 關(guān)鍵字： 數據采集  Flash  FPGA  

基于FPGA的全數字交流伺服系統信號處理

  • 在交流伺服驅動(dòng)系統概念的基礎上，提出了基于A(yíng)CTEL現場(chǎng)可編程邏輯器件APA300的光電編碼器與光柵尺信號處理電路設計原理，該電路由4倍頻細分、辨向電路、計數電路組成，信號處理模塊通過(guò)VHDL語(yǔ)言實(shí)現。
  • 關(guān)鍵字： 交流伺服系統  VHDL  FPGA  光柵尺信號處理  

主飛行儀表圖形加速顯示系統的FPGA設計

  • 針對主飛行顯示儀對圖形處理和顯示的苛刻要求，采用基于儀器總線(xiàn)和擴展總線(xiàn)的高速陣列信號處理板的設計模式，提出了一種基于硬件加速的PFD圖形顯示設計方法。該方法實(shí)現了圖形分層雙緩存交替切換、圖形填充、圖形合成和多通道DMA像素引擎，提高了PFD圖形生成和顯示的實(shí)時(shí)性和可靠性。實(shí)踐證明，該設計顯著(zhù)解決了PFD圖形顯示系統中的速度瓶頸。
  • 關(guān)鍵字： 圖形處理  圖形合成  FPGA  

用FPGA內部集成的DSP實(shí)現圖像處理的實(shí)例分析

  • intevac是商用和軍用市場(chǎng)光學(xué)產(chǎn)品的前沿開(kāi)發(fā)商。本文介紹該公司nightvista嵌入式電子系統的開(kāi)發(fā)，該產(chǎn)品是高性能超低亮度緊湊型攝像機。該攝像機最初采用了流行的數字信號處理器、幾個(gè)assp和外部存儲器件。系統對性能的需求越來(lái)越高，工程師團隊決定試驗一種替代方案——在可編程邏輯中實(shí)現可配置軟核處理器。
  • 關(guān)鍵字： 圖像處理  NIOS  FPGA  

一種并行存儲器系統的FPGA實(shí)現

  • 圍繞小衛星體積小、重量輕和價(jià)格低廉的特點(diǎn)，一個(gè)多CPU共享內存的系統（CPU仍然采用有相應宇航級器件的8086）將是比較合適的選擇。同時(shí)為了提高共享內存的數據通信帶寬，使其不成為整個(gè)系統的瓶頸，本文提出了一個(gè)用ASIC設計一個(gè)共享總線(xiàn)開(kāi)關(guān)網(wǎng)絡(luò )（簡(jiǎn)稱(chēng)SBSN，下同），組合成Omega網(wǎng)絡(luò )的方案，以消除對某一組內存的總線(xiàn)競爭，實(shí)現多CPU對共享分組存儲系統的低位交叉并行訪(fǎng)問(wèn)。
  • 關(guān)鍵字： 并行存儲器  多CPU共享內存  FPGA  
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