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基于DSP Builder的DDS設計及其FPGA實(shí)現
- 直接數字合成器，是采用數字技術(shù)的一種新型頻率合成技術(shù)，他通過(guò)控制頻率、相位增量的步長(cháng)，產(chǎn)生各種不同頻率的信號。他具有一系列的優(yōu)點(diǎn)；較高的頻率分辨率；可以實(shí)現快速的頻率切換；在頻率改變時(shí)能夠保持相位的連續；很容易實(shí)現頻率、相位和幅度的數控調制等。目前可采用專(zhuān)用芯片或可編程邏輯芯片實(shí)現DDS[1]，專(zhuān)用的DDS芯片產(chǎn)生的信號波形、功能和控制方式固定，常不能滿(mǎn)足具體需要[2]?？删幊踢壿嬈骷哂衅骷幠４?、工作速度快及可編程的硬件特點(diǎn)，并且開(kāi)發(fā)周期短，易于升級，因為非常適合用于實(shí)現DDS。 1 DDS的
- 關(guān)鍵字： 嵌入式系統 單片機 DSP Builder DDS FPGA 嵌入式
G.726語(yǔ)音編解碼器在SoPC中的實(shí)現
- 摘 要：在對G.726語(yǔ)音編解碼標準分析的基礎上給出了基于FPGA的DSP設計流程,利用MATLAB/Simulink、DSP Builder和SOPC Builder工具設計了G.726語(yǔ)音編解碼器,通過(guò)仿真實(shí)驗驗證了所設計的編解碼器模型的正確性,實(shí)現了編解碼器在SoPC系統中的綜合。 關(guān)鍵詞：ADPCM MATLAB/Simulink DSP Builder FPGA SoPC G.726是ITU前身CCITT于1990年在G.721和G.723標準的基礎上提出的關(guān)于把64kbps非線(xiàn)性PCM信號
- 關(guān)鍵字： ADPCM Builder DSP FPGA MATLAB/Simulink SoPC 消費電子 消費電子
應用SoPC Builder開(kāi)發(fā)電子系統
- 電子設計應用2004年第9期摘 要：本文從系統總線(xiàn)設計、用戶(hù)自定義指令和FPGA協(xié)處理器的應用這三個(gè)方面詳細介紹了如何應用SoPC設計思想和SoPC Builder工具來(lái)開(kāi)發(fā)電子系統。通過(guò)應用SoPC Builder開(kāi)發(fā)工具，設計者可以擺脫傳統的、易于出錯的軟硬件設計細節，從而達到加快項目開(kāi)發(fā)、縮短開(kāi)發(fā)周期、節約開(kāi)發(fā)成本的目的。關(guān)鍵詞：SoPC；SoPC Builder；FPGA引言隨著(zhù)技術(shù)的進(jìn)一步發(fā)展，SoC設計面臨著(zhù)一些諸如如何進(jìn)行軟硬件協(xié)同設計，如何縮短電子產(chǎn)品開(kāi)
- 關(guān)鍵字： FPGA SoPC SoPC Builder
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