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EEPW首頁(yè) >> 主題列表 >> 時(shí)序電路

數字電路之時(shí)序電路

  • 數字電路之時(shí)序電路-在《數字電路之如雷貫耳的“邏輯電路”》、《數字電路之數字集成電路IC》之后,本文是數字電路入門(mén)3,將帶來(lái)「時(shí)序電路」的講解,及其核心部件觸發(fā)器的工作原理。什么是時(shí)序電路?
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FPGA/CPLD狀態(tài)機穩定性研究

  • 在FPGA/CPLD設計中,狀態(tài)機是最典型、應用最廣泛的時(shí)序電路模塊,如何設計一個(gè)穩定可靠的狀態(tài)機是我們必須面對的問(wèn)題.
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一款基于門(mén)控時(shí)鐘的低功耗時(shí)序電路設計

  •   在傳統設計中,所有計算機運算(算法、邏輯和存儲進(jìn)程)都參考時(shí)鐘同步執行,時(shí)鐘增加了設計中的時(shí)序電路數量。在這個(gè)電池供電設備大行其道的移動(dòng)時(shí)代,為了節省每一毫瓦(mW)的功耗,廠(chǎng)商間展開(kāi)了殘酷的競爭,因此將電路分成多個(gè)電源域并根據要求關(guān)閉它們,并且在設計每個(gè)時(shí)序電路的同時(shí)節省功耗,這兩點(diǎn)至關(guān)重要。時(shí)序電路(如計數器和寄存器)在現代設計中無(wú)處不在。本文以約翰遜計數器為例介紹了如何采用有效門(mén)控時(shí)鐘來(lái)設計高能效的時(shí)序電路。   約翰遜計數器系統,可同步提供多種特殊類(lèi)型的數據序列,這對于大多數重要應用(如D/
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基于二叉樹(shù)的時(shí)序電路測試序列設計

  • 摘要:為了實(shí)現時(shí)序電路狀態(tài)驗證和故障檢測,需要事先設計一個(gè)輸入測試序列?;诙鏄?shù)節點(diǎn)和樹(shù)枝的特性,建立時(shí)序電路狀態(tài)二又樹(shù),按照電路二叉樹(shù)節點(diǎn)(狀態(tài))與樹(shù)枝(輸入)的層次邏輯關(guān)系,可以直觀(guān)和便捷地設計出時(shí)
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基于數據選擇器和D觸發(fā)器的多輸入時(shí)序電路

  • 在SSI時(shí)序邏輯電路設計中,遵循的設計準則是:在保證所設計的時(shí)序邏輯電路具有正確功能的前提下,觸發(fā)器的激...
  • 關(guān)鍵字: SSI  數據選擇器  D觸發(fā)器  時(shí)序電路  

基于FPGA的TDI-CCD時(shí)序電路的設計

  • 文中較為詳細地介紹了TDI-CCD的結構和工作原理,并根據工程項目所使用的IL-E2 TDI-CCD的特性,設計了一種基于現場(chǎng)可編程門(mén)陣列 (FPGA) 的TDI-CCD時(shí)序電路
  • 關(guān)鍵字: FPGA  CCD  TDI  時(shí)序電路    
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時(shí)序電路介紹

  時(shí)序邏輯電路簡(jiǎn)稱(chēng)時(shí)序電路   時(shí)序電路,它是由最基本的邏輯門(mén)電路加上反饋邏輯回路(輸出到輸入)或器件組合而成的電路,與組合電路最本質(zhì)的區別在于時(shí)序電路具有記憶功能。時(shí)序電路的特點(diǎn)是:輸出不僅取決于當時(shí)的輸入值,而且還與電路過(guò)去的狀態(tài)有關(guān)。它類(lèi)似于含儲能元件的電感或電容的電路,如觸發(fā)器、鎖存器、計數器、移位寄存器、儲存器等電路都是時(shí)序電路的典型器件。   時(shí)序邏輯電路的狀態(tài)是由存儲電路來(lái)記憶 [ 查看詳細 ]

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