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基于FPGA的毫米波多目標信號形成技術(shù)的研究
- 毫米波多目標信號發(fā)生器通過(guò)模擬的方法產(chǎn)生多種類(lèi)型高精度的雷達多目標回波信號，在實(shí)際雷達系統前端不具備的條件下對雷達系統后級進(jìn)行調試，便于制導武器的性能測試，大大加快新武器的研制進(jìn)程。毫米波多目標信號產(chǎn)生的關(guān)鍵是要求回波信號距離分辨率極高，常規的多目標信號產(chǎn)生方法如使用數字延時(shí)線(xiàn)產(chǎn)生多目標之間的延時(shí)，其控制不靈活，并且有些延時(shí)線(xiàn)需要接ECL電源，使用不方便也增加了設計的復雜度。使用分立元件實(shí)現延時(shí)則使電路元件過(guò)多，電路的穩定性及延時(shí)的精確性也會(huì )大大降低。本文介紹一種新的產(chǎn)生毫米波雷達模擬器的多目標信號的方法
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大型設計中FPGA的多時(shí)鐘策略
- 利用FPGA 實(shí)現大型設計時(shí)，可能需要FPGA 具有以多個(gè)時(shí)鐘運行的多重數據通路，這種多時(shí)鐘FPGA 設計必須特別小心，需要注意最大時(shí)鐘速率、抖動(dòng)、最大時(shí)鐘數、異步時(shí)鐘設計和時(shí)鐘/數據關(guān)系。設計過(guò)程中最重要的一步是確定要用多少個(gè)不同的時(shí)鐘，以及如何進(jìn)行布線(xiàn)，本文將對這些設計策略深入闡述。 FPGA 設計的第一步是決定需要什么樣的時(shí)鐘速率，設計中最快的時(shí)鐘將確定FPGA 必須能處理的時(shí)鐘速率。最快時(shí)鐘速率由設計中兩個(gè)觸發(fā)器之間一個(gè)信號的傳輸時(shí)間P 來(lái)決定，如果P 大于時(shí)鐘周期T，則當信號在一個(gè)觸發(fā)
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自適應算術(shù)編碼的FPGA實(shí)現
- 算術(shù)編碼是一種無(wú)失真的編碼方法，能有效地壓縮信源冗余度，屬于熵編碼的一種。算術(shù)編碼的一個(gè)重要特點(diǎn)就是可以按分數比特逼近信源熵，突破了Haffman編碼每個(gè)符號只不過(guò)能按整數個(gè)比特逼近信源熵的限制。對信源進(jìn)行算術(shù)編碼，往往需要兩個(gè)過(guò)程，第一個(gè)過(guò)程是建立信源概率表，第二個(gè)過(guò)程是對信源發(fā)出的符號序列進(jìn)行掃描編碼。而自適應算術(shù)編碼在對符號序列進(jìn)行掃描的過(guò)程中，可一次完成上述兩個(gè)過(guò)程，即根據恰當的概率估計模型和當前符號序列中各符號出現的頻率，自適應地調整各符號的概率估計值，同時(shí)完成編碼。盡管從編碼效率上看不如已
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基于C的設計方式簡(jiǎn)化FPGA/協(xié)處理器混合平臺軟硬件協(xié)同設計
- 基于C的設計方式簡(jiǎn)化FPGA/協(xié)處理器混合平臺軟硬件協(xié)同設計 在最近幾年中日益流行在高性能嵌入式應用中使用現場(chǎng)可編程門(mén)陣列（FPGA）。FPGA已經(jīng)被證明有能力處理各種不同的任務(wù)，從相對簡(jiǎn)單的控制功能到更加復雜的算法操作。雖然FPGA在某些功能上比設計專(zhuān)用ASIC硬件具有時(shí)間和成本上的優(yōu)勢，但在面向軟件應用中FPGA比傳統處理器和DSP的優(yōu)勢并沒(méi)有體現出來(lái)。這很大程度上是由于過(guò)去割裂了硬件和軟件開(kāi)發(fā)工具和方法之間的關(guān)系?！ ∪欢罱麱PGA在面向軟件設計工具方面的發(fā)展，及器件容量的持續增
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FPGA紅了，工具廠(chǎng)商笑了
- FPGA紅了，工具廠(chǎng)商笑了Cool FPGAs Make Tool Vendors Laugh據Gartner Dataquest在去年美國DAC(設計自動(dòng)化年會(huì ))期間公布的數據，每年采用ASIC開(kāi)始進(jìn)行設計的數量在逐年下降，取而代之的是ASSP（特殊應用標準產(chǎn)品），如圖1。由于深亞微米（DSM）制程以后，ASIC的開(kāi)發(fā)成本不斷上升，因此標準產(chǎn)品中的FPGA是理想的選擇之一（如圖2）。FPGA的應用領(lǐng)域不斷擴大，未來(lái)，消費電子（例如HDTV、無(wú)線(xiàn)路由器）和汽車(chē)電子是所有應用中成長(cháng)最快的（如圖3）。人們期盼
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平臺 FPGA 的發(fā)展帶來(lái)了什么？
- 平臺 FPGA 的發(fā)展帶來(lái)了什么？ Will The Evolution of Platform FPGAs? 當今多平臺 FPGA 動(dòng)搖 ASIC/ASSP 供應商。 作者 Richard Sevcik 賽靈思公司可編程邏輯系統與知識產(chǎn)權/內核及軟件解決方案部執行副總裁 有關(guān) FPGA 是否是 ASIC 和 ASSP 可行替代品的爭論已經(jīng)持續了近十年。iSupply、Gartner Dataquest 及其它業(yè)界分析師的研究表明當前正處在 ASIC 設計新客戶(hù)不斷減少，FPGA 設計新客戶(hù)
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Altera推出具有突破性體系的Stratix II系列FPGA
- FPGA已在數據通信、電信、無(wú)線(xiàn)通信、消費類(lèi)產(chǎn)品、醫療、工業(yè)和軍事等各應用領(lǐng)域當中占據重要地位。由于芯片開(kāi)發(fā)成本不斷攀升，以及對更高性能的不斷追求，繼0.18mm和0.13mm之后，業(yè)界越來(lái)越熱衷于90nm芯片制造工藝。Xilinx、Intel等都已進(jìn)入該領(lǐng)域，Altera也是其重要的倡導者。近期，Altera推出了嶄新體系的大容量Stratix II系列FPGA。它具有創(chuàng )新的自適應FPGA體系，即自適應邏輯模塊（ALM），這使其在單個(gè)器件中具有雙倍多的邏輯容量，比第一代Stratix器件速度快50%，效
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MC33289在汽車(chē)防抱死制動(dòng)系統中的應用
- 摘 要：MC33289是Motorola公司推出的SMARTMOS智能模擬芯片中的高端驅動(dòng)器。本文將其應用在汽車(chē)防抱死制動(dòng)系統(ABS)中 ，通過(guò)CPU和FPGA的設計，實(shí)現在驅動(dòng)電磁閥的同時(shí)對電磁閥及整個(gè)驅動(dòng)部分進(jìn)行靜態(tài)和動(dòng)態(tài)檢測的功能。關(guān)鍵詞：MC33289；防抱死制動(dòng)系統(ABS)；FPGA MC33289性能MC33289是Motorola公司推出的高端驅動(dòng)芯片，主要應用在汽車(chē)和工業(yè)領(lǐng)域驅動(dòng)電磁閥等典型的感性負載。此器件在同一表貼封裝中包含兩個(gè)功率輸出開(kāi)關(guān)，每個(gè)開(kāi)關(guān)由一個(gè)
- 關(guān)鍵字： FPGA MC33289 防抱死制動(dòng)系統(ABS)
高速大容量數據采集板卡的SDRAM控制器設計
- 摘 要：本文對高速、高精度大容量數據采集板卡所采用的SDRAM控制器技術(shù)進(jìn)行了討論，詳細介紹了基于FPGA的SDRAM控制器的設計、命令組合以及設計仿真時(shí)序，并將該技術(shù)應用于基于PCI總線(xiàn)的100MHz單通道 AD9432高速大容量數據采集板卡，最后給出了板卡測試結果。關(guān)鍵詞：SDRAM；FPGA；AD9432 引言高速數據采集具有系統數據吞吐率高的特點(diǎn)，要求系統在短時(shí)間內能夠傳輸并存儲采集結果。因此，采集數據的快速存儲能力和容量是制約加快系統速度和容許采集時(shí)間的主要因素之一。通常用于數據采
- 關(guān)鍵字： AD9432 FPGA SDRAM 存儲器
I2C總線(xiàn)控制器的VHDL設計及實(shí)現
- 摘 要：本文用VHDL設計了一個(gè)簡(jiǎn)潔而實(shí)用的I2C總線(xiàn)控制器，介紹了詳細的設計思路和在FPGA中的實(shí)現，并給出了在嵌入式系統設計中的使用方法。關(guān)鍵詞：I2C總線(xiàn)；VHDL；FPGA 引言I2C總線(xiàn)以其接口簡(jiǎn)單、使用靈活等突出優(yōu)點(diǎn)在數字系統中獲得了廣泛的應用。尤其在嵌入式系統中，I2C總線(xiàn)被普遍用來(lái)連接CPU/MCU和外圍器件。I2C總線(xiàn)規范經(jīng)過(guò)十幾年的實(shí)踐，發(fā)展了多層標準。從傳輸速率上劃分，有標準模式(100Kbit/s)，快速模式(400Kbit/s)，高速模式(3
- 關(guān)鍵字： FPGA I2C總線(xiàn) VHDL
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