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“老司機”十年FPGA從業(yè)經(jīng)驗總結
- 大學(xué)時(shí)代第一次接觸FPGA至今已有10多年的時(shí)間,至今記得當初第一次在EDA實(shí)驗平臺上完成數字秒表、搶答器、密碼鎖等實(shí)驗時(shí)那個(gè)興奮勁。當時(shí)由于沒(méi)有接觸到HDL硬件描述語(yǔ)言,設計都是在MAX+plus II原理圖環(huán)境下用74系列邏輯器件搭建起來(lái)的。 后來(lái)讀研究生,工作陸陸續續也用過(guò)Quartus II、FoundaTIon、ISE、Libero,并且學(xué)習了verilogHDL語(yǔ)言,學(xué)習的過(guò)程中也慢慢體會(huì )到verilog的妙用,原來(lái)一小段語(yǔ)言就能完成復雜的原理圖設計,而且語(yǔ)言的移植性可操作性比原理圖
- 關(guān)鍵字： FPGA Verilog
高云半導體宣布在香港科學(xué)園設立香港研發(fā)中心
- 作為國內領(lǐng)先的可編程邏輯器件供應商,廣東高云半導體科技股份有限公司(以下簡(jiǎn)稱(chēng)“高云半導體”)今日宣布成立香港研發(fā)中心,新成立的研發(fā)中心位于香港科學(xué)園二期浚湖樓,這是繼濟南、上海、廣州、美國硅谷四大研發(fā)中心之后,高云半導體成立的第五大研發(fā)中心。 “在香港科學(xué)園設立研發(fā)中心,將為高云半導體在國際市場(chǎng)開(kāi)拓,創(chuàng )新合作等方面提供重要的技術(shù)支持,”高云半導體CEO朱璟輝介紹,“作為一個(gè)創(chuàng )新驅動(dòng)型的公司,高云將在香港打造一個(gè)實(shí)力雄厚的研發(fā)與技術(shù)支
- 關(guān)鍵字： 高云 FPGA
基于OMAP-L138 DSP+ARM的處理器與FPGA實(shí)現SDR系統
- CritICal Link公司的某客戶(hù)需要針對多個(gè)應用開(kāi)發(fā)一個(gè)擴頻無(wú)線(xiàn)電收發(fā)器。該客戶(hù)已經(jīng)開(kāi)發(fā)出一套算法，準備用于對信號進(jìn)行調制和解調，但他們卻缺少構建完整系統的資源和專(zhuān)業(yè)知識?？蛻?hù)希望利用軟件定義無(wú)線(xiàn)電(SDR)系統的靈活性?xún)?yōu)勢。本文將探討如何基于德州儀器(TI)的OMAP-L138 DSP+ARM處理器與FPGA來(lái)實(shí)現該系統?！ ∑脚_ Critical Link選擇其MityDSP-L138F嵌入式系統模塊作為SDR的基礎，因為該模塊不僅具有很強的處理能力，而且可以
- 關(guān)鍵字： FPGA ARM
基于DSP和FPGA的機器視覺(jué)系統設計與實(shí)現
- 本文將機器視覺(jué)與網(wǎng)絡(luò )技術(shù)相結合，使用TI公司新近推出的6000系列DSPsTMS320DM642為核心，應用ALTERA公司的FPGA，用其實(shí)現圖像預處理，減輕了DSPs的負擔。應用網(wǎng)絡(luò )技術(shù)實(shí)現圖像傳輸?！ ?、引言 機器視覺(jué)自起步發(fā)展到現在，已有15年的發(fā)展歷史。應該說(shuō)機器視覺(jué)作為一種應用系統，其功能特點(diǎn)是隨著(zhù)工業(yè)自動(dòng)化的發(fā)展而逐漸完善和發(fā)展的?！ ∧壳?，國際上視覺(jué)系統的應用方興未艾，1998年的市場(chǎng)規模為46億美元。在國外，機器視覺(jué)的應用普及主要體現在半導體及電子行業(yè)，其中大概 40%
- 關(guān)鍵字： DSP FPGA
再續FPGA初心，京微齊力脫胎京微雅格重新起航
- 新的一年開(kāi)啟新的希望，新的空白承載新的夢(mèng)想。這是年初一集微網(wǎng)給讀者們拜年時(shí)寫(xiě)的寄語(yǔ)。在中國農歷新年開(kāi)年之際，半導體產(chǎn)業(yè)里也迎來(lái)了許多新的起點(diǎn)。例如長(cháng)江存儲在與蘋(píng)果就采購前者的Nand閃存芯片一事談判，又例如前京微雅格副總裁王海力堅守18個(gè)月后的二次創(chuàng )業(yè)。 2005年年底，即將從清華大學(xué)計算機專(zhuān)業(yè)博士畢業(yè)的王海力加入了一家新成立的中外合資公司——雅格羅技，開(kāi)始了國產(chǎn)FPGA芯片研發(fā)。2010年在北京市政府相關(guān)引導資金支持下，該公司也轉換身份并更名為“京微雅格&r
- 關(guān)鍵字： 京微雅格 FPGA
FPGA重點(diǎn)知識13條，助你構建完整“邏輯觀(guān)”之三
- 10、FPGA的時(shí)序基礎理論 我們的分析從下圖開(kāi)始，下圖是常用的靜態(tài)分析結構圖，一開(kāi)始看不懂公式不要緊，因為我會(huì )在后面給以非常簡(jiǎn)單的解釋?zhuān)骸 ∵@兩個(gè)公式是一個(gè)非常全面的，準確的關(guān)于建立時(shí)間和保持時(shí)間的公式。其中Tperiod為時(shí)鐘周期;Tcko為D觸發(fā)器開(kāi)始采樣瞬間到D觸發(fā)器采樣的數據開(kāi)始輸出的時(shí)間;Tlogic為中間的組合邏輯的延時(shí);Tnet為走線(xiàn)的延時(shí);Tsetup為D觸發(fā)器的建立時(shí)間;Tclk_skew為時(shí)鐘偏移，偏移的原因是因為時(shí)鐘到達前后兩個(gè)D觸發(fā)器的路線(xiàn)不是一樣長(cháng)?！ ∵@里我們來(lái)做如下轉
- 關(guān)鍵字： FPGA 時(shí)序
FPGA重點(diǎn)知識13條，助你構建完整“邏輯觀(guān)”之二
- 8、FPGA時(shí)鐘系統 1. FPGA的全局時(shí)鐘是什么? FPGA的全局時(shí)鐘應該是從晶振分出來(lái)的，最原始的頻率。其他需要的各種頻率都是在這個(gè)基礎上利用PLL或者其他分頻手段得到的?！ ?. 全局時(shí)鐘和BUFG: BUFG，輸入為固定管腳，輸出為H型全銅全局高速網(wǎng)絡(luò )，這樣抖動(dòng)和到任意觸發(fā)器的延時(shí)差最小，這個(gè)也就是FPGA做同步設計可以不需要做后仿真的原因?！ ∪謺r(shí)鐘：今天我們從另一個(gè)角度來(lái)看一下時(shí)鐘的概念：時(shí)鐘是D觸發(fā)器的重要組成部分，一個(gè)有效邊沿使得D觸發(fā)器進(jìn)行一次工作。而更多的時(shí)候，D觸發(fā)器保
- 關(guān)鍵字： FPGA 時(shí)鐘
FPGA重點(diǎn)知識13條，助你構建完整“邏輯觀(guān)”之一
- 1、查找表LUT和編程方式 第一部分： 查找表LUT FPGA是在PAL、GAL、EPLD、CPLD等可編程器件的基礎上進(jìn)一步發(fā)展的產(chǎn)物。它是作為ASIC領(lǐng)域中的一種半定制電路而出現的，即解決了定制電路的不足，又克服了原有可編程器件門(mén)電路有限的缺點(diǎn)?！ ∮捎贔PGA需要被反復燒寫(xiě)，它實(shí)現組合邏輯的基本結構不可能像ASIC那樣通過(guò)固定的與非門(mén)來(lái)完成，而只能采用一種易于反復配置的結構。查找表可以很好 地滿(mǎn)足這一要求，目前主流FPGA都采用了基于SRAM工藝的查找表結構，也有一些軍品和宇航級FPGA采用
- 關(guān)鍵字： FPGA CPLD
eFPGA or FPGA SoC，誰(shuí)將引領(lǐng)下一代可編程硬件潮流？
- eFPGA：冉冉升起的新星,eFPGA即嵌入式FPGA(embedded FPGA)，是近期興起的新型電路IP?！ ‰S著(zhù)摩爾定律越來(lái)越接近瓶頸，制造ASIC芯片的成本越來(lái)越高。因此，設計者會(huì )希望ASIC能實(shí)現一定的可配置性，同時(shí)又不影響性能。在希望能做成可配置的模塊中，負責與其他芯片或者總線(xiàn)通信的接口單元又首當其沖。在芯片中，模塊間的通信往往使用簡(jiǎn)單的并行接口或者配合簡(jiǎn)單的時(shí)序邏輯，但是在芯片間通信時(shí)為了保證可靠性，必須通過(guò)一系列握手(handshake)協(xié)議來(lái)完成通信接口。設計者往往希望自己的SoC
- 關(guān)鍵字： eFPGA FPGA
CPU、MCU、FPGA、SoC這些芯片究竟是啥？漲盡姿勢
- 目前世界上有兩種文明，一種是人類(lèi)社會(huì )組成的的碳基文明，一種是各種芯片組成的硅基文明——因為幾乎所有的芯片都是以單晶硅為原料制作的，芯片系統的總數比人類(lèi)的數量還多出數十上百倍。芯片大家族里面也分各種不同類(lèi)型的芯片，從古老的用電子管堆出來(lái)的成噸的邏輯門(mén)到現在的超級數據中心，電子技術(shù)的發(fā)展走過(guò)了一代又一代，到了今天，各種芯片更是百花齊放，芯片廠(chǎng)商百家爭鳴。 可是，這么多芯片，按照功能分類(lèi)，有專(zhuān)門(mén)用于計算的、有專(zhuān)門(mén)用于控制的、有專(zhuān)門(mén)用于存儲的&hell
- 關(guān)鍵字： FPGA SoC
使用ECP5?FPGA解決網(wǎng)絡(luò )邊緣智能、視覺(jué)和互連應用設計挑戰
- 引言 隨著(zhù)傳感器、低成本攝像頭和顯示屏在當今嵌入式設計中的使用量飛速增長(cháng)，市場(chǎng)上出現了許多激動(dòng)人心的全新智能和視覺(jué)應用。與此同時(shí)，嵌入式視覺(jué)應用的爆炸式發(fā)展也讓設計工程師對處理資源需求有了一個(gè)新的認識。包含豐富數據的全新視頻應用促使設計工程師重新考慮到底采用哪種器件，是專(zhuān)用應用處理器(AP)、ASIC還是ASSP?然而，在某些情況下，在現有應用處理器、ASIC或ASSP方面的大量軟件投入以及全新器件的高啟動(dòng)成本已然成為上述應用更新迭代的阻礙。這一次，擺在眼前的問(wèn)題推動(dòng)設計工程師尋求一種協(xié)處理解決方案
- 關(guān)鍵字： FPGA 萊迪思
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