一種基于FPGA的驅動(dòng)接口電路的設計

引言

　　在自動(dòng)控制的很多應用場(chǎng)合, 都需要實(shí)時(shí)對信號進(jìn)行采樣分析, 然后由DSP來(lái)進(jìn)行運算控制。AD芯片是采樣中最常用的芯片, 本文主要對ADI 公司的AD7862芯片進(jìn)行介紹, 同時(shí)為它設計了驅動(dòng)接口電路。由于A(yíng)D7862不能自動(dòng)工作, 需要給它提供相關(guān)的驅動(dòng)信號才能觸發(fā)它進(jìn)行轉換,本文用FPGA芯片給它做一個(gè)接口驅動(dòng)電路, 并詳細的介紹了驅動(dòng)電路程序的設計, 設計的電路為AD7862提供了非常好的驅動(dòng)作用, 并在實(shí)際運用中能使其穩定的工作。

　　1、AD7862芯片簡(jiǎn)介

　　AD7862是美國AD I公司出品的12 bit高速, 低功耗轉換器, 單電源5伏供電。共有4 個(gè)模擬輸入端, 被分為兩個(gè)通道( A B), 通過(guò)輸入端A0來(lái)進(jìn)行選擇。每一個(gè)通道有兩個(gè)輸入端( VA1 VA2或者VB1VB2) 。能夠接受的模擬信號的輸入范圍為正負10伏。不過(guò)模擬信號的輸入端的過(guò)壓保護允許輸入電壓達到正負17 伏。原理框圖如圖1所示。

圖1 AD7862原理框圖。

　　AD7862芯片具有以下特點(diǎn):

　　( 1) 對每一個(gè)通道而言, 從啟動(dòng)轉換到轉換完成需要3. 6 s的時(shí)間。

　　( 2) 芯片由5 V 單電源供電, 功耗低, 工作時(shí)典型值為60 mW。具有自動(dòng)休眠模式, 當一次轉換完成后自動(dòng)進(jìn)入休眠模式, 節省電能。當下一個(gè)轉換周期來(lái)臨時(shí)在自動(dòng)蘇醒。

　　( 3) 提供一個(gè)高速并行接口, 和微處理器、微控制器以及數字信號處理器的連接變得容易。

　　( 4) AD7862系列共有三個(gè)版本分別針對三種不同的輸入范圍。其中AD7862—10針對標準工業(yè)級輸入范圍正負10伏; AD7862—3 主要針對普通信號輸入范圍正負2. 5 V。

　　AD7862—2被用于單極0 到2. 5 V 的輸入范圍。對AD7862—10和AD7862-3來(lái)說(shuō), 轉換輸出的12位為二進(jìn)制補碼, 對于A(yíng)D7862-2來(lái)說(shuō), 輸出的為12位的原碼。

　　2、接口電路程序設計

　　在本設計中用的是AD7862??10, 采用高速轉換模式, 典型轉換時(shí)序如圖2所示。

圖2高速轉換模式時(shí)序圖。

　　圖2中對應的時(shí)間參數的要求如下表1所示。

表1高速采樣模式時(shí)序參數表。

　　從圖2的時(shí)序圖可以看出AD7862 通過(guò)輸入脈沖信號CONVST啟動(dòng)轉換。在CONVST 信號的下降沿, 片上的兩個(gè)track /ho ld都同時(shí)的被設置為ho ld狀態(tài), 兩個(gè)通道開(kāi)始進(jìn)行轉換。轉換時(shí)鐘由內置的晶振提供。BUSY 信號指示轉換結束, 同時(shí)兩個(gè)通道的轉換結果可以被讀出。由A0 的值來(lái)決定第一次讀取的值是VA1 或者VB1, 第二次讀取的是VA2或者VB2。當CS信號和RD信號為低時(shí), 數據被從12位的并行數據線(xiàn)上讀取。在高速轉換模式下, AD7862 的轉換時(shí)間為3. 6 us, track /ho ld收集時(shí)間為0. 3 us。為了保證最佳轉換效果, 在轉換期間和下一次轉換開(kāi)始前300 ns不能進(jìn)行讀取操作。

　　上述的時(shí)序圖對應為先讀取VA1和VA2, 然后在讀取VB1和VB2, 對應的信號A0首先被設為低電平, 然后被拉為高電平。在設計驅動(dòng)電路的過(guò)程中, 一定要保證設計的時(shí)序滿(mǎn)足上述時(shí)序參數的要求 , 不然就有可能發(fā)生采樣不準, 出錯。