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基于DSP+FPGA的WCDMA系統基帶發(fā)送實(shí)現方案
作者：
時(shí)間：2014-03-08
來(lái)源：網(wǎng)絡(luò )
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內所要處理的最大數據量為：
Wmax=9600bits。
根據3GGP協(xié)議TS25.212V2.2.0規定的下行數據基帶處理流程(圖1所示)，并按固定位置復用的方式進(jìn)行處理，每個(gè)數據比特須經(jīng)過(guò)最多10個(gè)環(huán)節的處理過(guò)程，分別是：
估算平均每環(huán)節上每比特的處理要求8條指令。則10ms內必須完成的處理指令數是：9600×10×8=768000條。對應的處理能力要求是76.8MIPS。
●消息處理：包含消息的解釋、對應控制參數的計算、發(fā)給對應的處理FPGA。估計需求不超過(guò)一條承載64Kbps業(yè)務(wù)的無(wú)線(xiàn)信道的基帶數據處理的需求。
綜合考慮上述兩個(gè)方面，則整個(gè)基帶數據處理的等效需求是：
(9600+2400)×10×8/10ms=96MIPS
以TMS320C5410為例，其內部工作時(shí)鐘頻率高達100MHz，運算速度達100MIPS?；贑的軟件開(kāi)發(fā)環(huán)境和匯編級并行處理的優(yōu)化程序，優(yōu)化后的并行執行效率一般為80%，等效的處理能力為80MIPS?？梢?jiàn)，若將整個(gè)基帶數據處理交給該DSP芯片完成，其處理能力無(wú)法滿(mǎn)足整個(gè)處理單元的需求。因此，在基帶處理的實(shí)現方案中，數據量小的業(yè)務(wù)，如隨路信令，AMR語(yǔ)音業(yè)務(wù)可由DSP處理；而數據量大的業(yè)務(wù)，如64Kbps、144Kbps和384Kbps速率的業(yè)務(wù)，大部分處理環(huán)節由FPGA完成。具體實(shí)現如下：
●DSP作為主控單元，完成數據提取、消息解析和部分的基帶數據處理功能，如第二次交織和成幀等；
●FPGA則在DSP的調度下完成基帶數據處理環(huán)節中大部分比較耗時(shí)的處理功能，如：CRC校驗、編碼、速率適配等。
在384Kbps業(yè)務(wù)信道加隨路信令的處理中，384bpsK業(yè)務(wù)數據由DSP通過(guò)同步高速接口以DMA方式遞交給FPGA，在FPGA中處理；而隨路信令因其數據量小，在FPGA處理384Kbps業(yè)務(wù)數據時(shí)，隨路信令數據在DSP中同時(shí)處理。此方法減少了數據處理時(shí)間，提高了處理速度。
結語(yǔ)
本文在分析WCDMA系統因傳輸不同速率和QoS要求的多種業(yè)務(wù)而帶來(lái)的系統復雜度和數據處理延時(shí)的基礎上，著(zhù)重介紹了作為一個(gè)較好的軟硬件結合的設計方案，DSP+FPGA結構在基站分系統的發(fā)送單元實(shí)現中的具體應用。該硬件電路的實(shí)際測試表明，該結構不僅在高速率業(yè)務(wù)的處理時(shí)延上符合規范要求，而且對不同類(lèi)型的業(yè)務(wù)處理有較強的適應能力，滿(mǎn)足了WCDMA系統對多媒體業(yè)務(wù)傳輸的支持。本文引用地址：http://dyxdggzs.com/article/241692.htm
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