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模數轉換器(ADC)不同類(lèi)型數字輸出深解
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時(shí)間：2013-01-27
來(lái)源：網(wǎng)絡(luò )
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出數的更高效接口。例如，對于一個(gè)四通道14位ADC，光數據位就需要60個(gè)輸出引腳。如果采用DDR（雙倍數據速率）LVDS輸出接口，同樣的四通道ADC只需要32個(gè)輸出引腳；JESD204 CML輸出則只需要6個(gè)輸出引腳。不僅引腳數量，數據速率和功耗要求也會(huì )成為問(wèn)題。當CMOS接口的數據傳輸速率提高時(shí)，功耗隨之增加，功耗限制最終會(huì )使數據速率達到一定的上限后就不能再提高。與此同時(shí)，噪聲也會(huì )成為問(wèn)題。與LVDS和CML所用的差分信號相比，CMOS等所用的單端信號更易受噪聲和接地反彈影響。同樣，隨著(zhù)速度和分辨率進(jìn)一步提高，LVDS也會(huì )變得不堪使用。這時(shí)，使用CML驅動(dòng)器更合乎道理，因為它能支持高得多的數據速率。由于能夠支持更高的數據速率，所以數據可以實(shí)現串行化，從而減少所需的輸出驅動(dòng)器數量。
結束語(yǔ)
目前ADC采用的三類(lèi)主要數字輸出各有優(yōu)劣?？紤]采用CMOS、LVDS或CML輸出驅動(dòng)器的ADC時(shí)，必須注意這些優(yōu)缺點(diǎn)。設計系統時(shí)，每類(lèi)驅動(dòng)器都有必須特別重視的品質(zhì)和要求，以便確保接收器件（FPGA或ASIC等）能夠正確捕捉到ADC數據。必須了解需要驅動(dòng)的負載，使用適當的端接，針對ADC所用的不同類(lèi)型數字輸出采用適當的布局布線(xiàn)技術(shù)。隨著(zhù)ADC速度和分辨率的提高，相應的輸出數據速率也會(huì )提高，通常會(huì )予以串行化以獲得更高的吞吐速率。這種情況下，適當設計系統并采用最佳布局布線(xiàn)技術(shù)變得更加重要。
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