基于FPGA的循環(huán)冗余校驗實(shí)驗系統的實(shí)現
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2、其他部分的設計
(1)數據輸入電路部分：將其設計成為一個(gè)FIFO的數據緩存器，這樣做的目的，可以接收源源不斷傳來(lái)的數據，另一方面考慮到可能傳輸出現差錯，可以從緩存將數據調出來(lái)重新傳輸一遍，直到正確傳輸為止，才刪去數據。
(2)顯示電路部分：輸入數據與輸出數據都可以采用數碼管來(lái)進(jìn)行顯示，通過(guò)數碼管顯示可以清楚地觀(guān)察到傳輸過(guò)程中數據傳輸的準確性。傳輸過(guò)程出現的差錯可以由接收端反饋，在發(fā)送端可以用LED燈進(jìn)行提示。
(3)按鍵消抖電路部分：由于設計采用開(kāi)關(guān)是機械開(kāi)關(guān)結構，因此在開(kāi)關(guān)切換的瞬間會(huì )在接觸點(diǎn)出現信號來(lái)回彈跳的現象?；赩HDL的按鍵消抖法主要有三種：電平檢測消抖法、定時(shí)檢測消抖法以及脈寬檢測消抖法。本系統采用定時(shí)檢測消抖法可以進(jìn)行按鍵的消抖。
至于時(shí)鐘電路，對于數碼顯示電路而言，需要額外提供一個(gè)較高頻率的掃描電路，其他的時(shí)鐘可以用普通的時(shí)鐘提供。
實(shí)驗系統的實(shí)物圖如下：本文引用地址：http://dyxdggzs.com/article/190601.htm
四、結束語(yǔ)
基于以上的系統的架構和主要的設計思想，我們通過(guò)兩臺EDA實(shí)驗箱完成了CRC循環(huán)冗余校驗，模擬了現實(shí)的完整的包含發(fā)送、傳輸和接收模塊的系統，實(shí)驗證明，系統能夠完成CRC校驗，拓展了設備的功能，提高了設備的利用率，達到了設計的目的。
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