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一種基于LEACH的改進(jìn)型無(wú)線(xiàn)傳感器網(wǎng)絡(luò )路由算法
- 摘要：路由算法是無(wú)線(xiàn)傳感器網(wǎng)絡(luò )研究的核心技術(shù)之一。在LEACH算法的基礎上，提出了一種基于距離和能量考慮選擇第二層簇頭的兩層LEACH算法DE―LEACH，有效避免了低能量且離基站較遠的節點(diǎn)與基站直接通信，提高了網(wǎng)絡(luò )生
- 關(guān)鍵字： 網(wǎng)絡(luò ) 路由 算法 傳感器 無(wú)線(xiàn) LEACH 改進(jìn)型 基于
基于A(yíng)RM+μc/os Ⅱ的教學(xué)機器人控制系統設計與實(shí)現
- 基于A(yíng)RM+μc/os Ⅱ的教學(xué)機器人控制系統設計與實(shí)現,1．引言近年來(lái)隨著(zhù)人工智能技術(shù)、計算機技術(shù)等相關(guān)技術(shù)的發(fā)展，對智能機器人的研究越來(lái)越多。在教育領(lǐng)域,許多院校已在學(xué)生中開(kāi)設了機器人學(xué)方面的有關(guān)課程。為了滿(mǎn)足機器人學(xué)方面的有關(guān)課程教學(xué)示范和實(shí)驗教學(xué)的需求
- 關(guān)鍵字： 控制系統 設計 實(shí)現 機器人 教學(xué) ARM c/os 基于 機器人 ARM UCOS 伺服
賽普拉斯為用于機器視覺(jué)與運動(dòng)分析應用的 LUPA 高速 SXGA CMOS圖像傳感器添加色彩
- 2008 年 11 月 17日，北京訊，—— 日前，賽普拉斯半導體公司 (NYSE: CY) 宣布推出具有高靈敏度以及高速超級擴展圖形陣列 (SXGA) 分辨率 CMOS 色彩圖像傳感器的商用樣片。最新 130 萬(wàn)像素 LUPA-1300-2-color 傳感器具有觸發(fā)式與流水線(xiàn)式同步曝光與片上數字低壓差分信號 (LVDS) 輸出。該圖像傳感器開(kāi)發(fā)用于需要區分不同色彩的機器視覺(jué)與運動(dòng)分析應用，其不僅可具有 500 幀每秒 (fps) 的高幀速率，同時(shí)還能夠提供可實(shí)現
- 關(guān)鍵字： 賽普拉斯 CMOS 傳感器 LUPA-1300-2-c
基于C++ Builder的自動(dòng)變速器電控單元實(shí)車(chē)試驗數據采集系統
- 摘要 本文闡述了基于Borland C++ Builder開(kāi)發(fā)的自動(dòng)變速器電控單元（ECU）實(shí)車(chē)試驗的數據采集系統，通過(guò)對系統硬件結構、軟件編制核心步驟的描述，詳細介紹了系統的開(kāi)發(fā)過(guò)程。本數據采集系統為自動(dòng)變速器電控單元的開(kāi)發(fā)提供了重要的測試平臺。 關(guān)鍵詞 C++ Builder，電控單元，數據采集，液力自動(dòng)變速器 1 引言 液力自動(dòng)變速器是將車(chē)速和節氣門(mén)開(kāi)度等車(chē)輛的狀態(tài)信號作為電控單元(ECU)的輸入信號，經(jīng)電控單元識別判斷處理后，根據換檔規律，發(fā)出信號給相應電磁閥，利用電磁閥控制油壓回路
- 關(guān)鍵字： ECU C++ Builder 電控單元 數據采集 液力自動(dòng)變速器
Cadence推出C-to-Silicon Compiler
- 加州圣荷塞，2008年7月15日——全球電子設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司（納斯達克: CDNS），今天宣布推出Cadence® C-to-Silicon Compiler，這是一種高階綜合產(chǎn)品，能夠讓設計師在創(chuàng )建和復用系統級芯片IP的過(guò)程中，將生產(chǎn)力提高10倍。C-to-Silicon Compiler中的創(chuàng )新技術(shù)成為溝通系統級模型之間的橋梁，它們通常是用C/C++ 和SystemC寫(xiě)成的，而寄存器傳輸級（RTL）模型通常被用于檢驗、實(shí)現和集成SoC。這種
- 關(guān)鍵字： Cadence SoC C-to-Silicon Compiler 半導體
Cadence推出C-to-Silicon Compiler拓展系統級產(chǎn)品
- 全球電子設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司（納斯達克: CDNS），今天宣布推出Cadence® C-to-Silicon Compiler，這是一種高階綜合產(chǎn)品，能夠讓設計師在創(chuàng )建和復用系統級芯片IP的過(guò)程中，將生產(chǎn)力提高10倍。C-to-Silicon Compiler中的創(chuàng )新技術(shù)成為溝通系統級模型之間的橋梁，它們通常是用C/C++ 和SystemC寫(xiě)成的，而寄存器傳輸級（RTL）模型通常被用于檢驗、實(shí)現和集成SoC。這種重要的新功能對于開(kāi)發(fā)新型SoC和系統級IP，用于消費電子、無(wú)
- 關(guān)鍵字： Cadence C-to-Silicon Compiler
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