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基于FPGA的可編程定時(shí)器/計數器8253的設計與實(shí)現
- 摘 要：本文介紹了可編程定時(shí)器/計數器8253的基本功能，以及一種用VHDL語(yǔ)言設計可編程定時(shí)器/計數器8253的方法，詳述了其原理和設計思想，并利用Altera公司的FPGA器件ACEX 1K予以實(shí)現。關(guān)鍵詞：FPGA；IP；VHDL 引言在工程上及控制系統中，常常要求有一些實(shí)時(shí)時(shí)鐘，以實(shí)現定時(shí)或延時(shí)控制，如定時(shí)中斷，定時(shí)檢測，定時(shí)掃描等，還要求有計數器能對外部事件計數。要實(shí)現定時(shí)或延時(shí)控制，有三種主要方法：軟件定時(shí)、不可編程的硬件定時(shí)、可編程的硬件定時(shí)器。其中可編
- 關(guān)鍵字： FPGA IP VHDL
在TMS320VC5402上實(shí)現的嵌入式TCP/IP協(xié)議棧
- 實(shí)現一個(gè)運行在16位數字信號處理器TMS320VC5402上的小型嵌入式TCP/IP協(xié)議棧。對TCP/IP協(xié)議中的IP協(xié)議、ARP協(xié)議、UDP協(xié)議進(jìn)行分析，完成基于TCP/IP協(xié)議的嵌入式網(wǎng)絡(luò )系統。
- 關(guān)鍵字： 協(xié)議 TCP/IP 嵌入式 實(shí)現 TMS320VC5402
自由IP Core資源的利用
- 摘 要：本文介紹了與免費IP Core運作有關(guān)的問(wèn)題以及免費資源的若干來(lái)源，然后通過(guò)對兩個(gè)不同來(lái)源的、免費的八位RISC CPU進(jìn)行比較和分析，給出了若干選用免費核時(shí)應考慮的問(wèn)題。關(guān)鍵詞：IP Core； CPU引言隨著(zhù)集成電路單位面積晶體管數量的激增和人們對縮短設計周期的追求，設計重用已經(jīng)成為有效的應對方法，它不但適合于A(yíng)SIC，也適合于CPLD/FPGA。在CPLD/FPGA的設計過(guò)程中，由于開(kāi)發(fā)工具的通用性、設計語(yǔ)言的標準化，設計過(guò)程幾乎與所用器件的硬件結構無(wú)關(guān)，
- 關(guān)鍵字： CPU IP Core
TCP/IP協(xié)議棧在嵌入式異構網(wǎng)絡(luò )互聯(lián)中的應用
- TCP/IP協(xié)議棧在嵌入式異構網(wǎng)絡(luò )互聯(lián)中的應用,隨著(zhù)測控技術(shù)與網(wǎng)絡(luò )技術(shù)日益緊密的結合，測控系統接入互聯(lián)網(wǎng)已經(jīng)成為大勢所趨
- 關(guān)鍵字： 應用 網(wǎng)絡(luò )互聯(lián) 嵌入式 協(xié)議 TCP/IP
F5 發(fā)表IP應用切換器 提供高效能流量管理服務(wù)
- 為滿(mǎn)足當前與下一代的網(wǎng)頁(yè)服務(wù)及應用程式對流量管理工作的需求，F5 Networks於12日發(fā)表新款「IP（網(wǎng)際網(wǎng)路協(xié)定）應用切換器」：BIG-IP 5000。F5強調BIG-IP 5000的誕生將「網(wǎng)際網(wǎng)路流量管理」（ITM）帶進(jìn)了新的時(shí)代，它可為企業(yè)與服務(wù)供應商提供更好的選擇，使其能夠建立高效能、高彈性、高獲利的IP網(wǎng)路
- 關(guān)鍵字： BIG-IP 網(wǎng)頁(yè)服務(wù)
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