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基于FPGA的DDS設計

  • 摘要：利用現場(chǎng)可編程門(mén)陣列(FPGA)設計并實(shí)現直接數字頻率合成器(DDS)。結合DDS的結構和原理，給出系統設計方法，并推導得到參考頻率與輸出頻率間的關(guān)系。DDS具有高穩定度，高分辨率和高轉換速度，同時(shí)利用Ahera公司
  • 關(guān)鍵字： FPGA  DDS    

基于DDS的信號模擬器設計

  • 摘要：通過(guò)對DDS的信號模擬器設計的研究，不僅設計出能夠實(shí)現普通射頻合成信號源的功能，正如能夠在幅度、頻率等方面對所需生成的信號加以控制，也能夠實(shí)現定頻、掃頻以及跳頻等輸出方式上的選擇。同時(shí)，該系統增加
  • 關(guān)鍵字： DDS  信號模擬器    

基于FPGA和DDS的信號源研究與設計

  • 1引言直接數字頻率合成DDS(DirectDigitalSynthesizer)是基于奈奎斯特抽樣定理理論和現代器件生...
  • 關(guān)鍵字： FPGA  DDS  信號源  設計  

基于模型的DDS芯片設計與實(shí)現

  • 基于模型的DDS芯片設計與實(shí)現,摘要：介紹了一種基于模型的DDS芯片的設計方法。根據DDS基本原理,在MATLAB環(huán)境下建立模型,用System Generator產(chǎn)生VHDL程序,并在ISE軟件中編寫(xiě)仿真和控制程序,最后在Spartan-3E Starter Kit開(kāi)發(fā)板上實(shí)現設計。與傳統的
  • 關(guān)鍵字： 設計  實(shí)現  芯片  DDS  模型  基于  

基于DSP和DDS的三維感應測井高頻信號源實(shí)現

  • 基于DSP和DDS的三維感應測井高頻信號源實(shí)現,　引言　　高頻信號源設計是三維感應測井的重要組成部分。三維感應測井的原理是利用激勵信號源通過(guò)三個(gè)正交的發(fā)射線(xiàn)圈向外發(fā)射高頻信號，再通過(guò)多組三個(gè)正交的接收線(xiàn)圈，得到多組磁場(chǎng)分量，從而準確測量地層各向異性
  • 關(guān)鍵字： 高頻  信號源  實(shí)現  測井  感應  DSP  DDS  三維  基于  

基于FPGA和DDS的信號源設計

  • 基于FPGA和DDS的信號源設計,1 引言
    直接數字頻率合成DDS(Direct Digital Synthesizer)是基于奈奎斯特抽樣定理理論和現代器件生產(chǎn)技術(shù)發(fā)展的一種新的頻率合成技術(shù)。與第二代基于鎖相環(huán)頻率合成技術(shù)相比，DDS具有頻率切換時(shí)間短、頻率分辨率
  • 關(guān)鍵字： 設計  信號源  DDS  FPGA  基于  FPGA，DDS，Verilog HDL  

基于DDS芯片AD9833的音源發(fā)生器設計

  • 介紹了DDS技術(shù)的原理和特性，采用DDS芯片AD9833產(chǎn)生正弦波音階信號構建音源發(fā)生器，給出了主要電路和關(guān)鍵程序。
  • 關(guān)鍵字： 9833  DDS  AD  芯片    

一種基于DDS+PLL的Chirp-UWB信號產(chǎn)生方案

  • 由于超寬帶信號的帶寬很寬，傳統的信號產(chǎn)生辦法已不能直接應用于超寬帶通信。為此，提出一種基于DDS+PLL的Chirp-UWB信號產(chǎn)生方案，該方法聯(lián)合使用了DDS和PLL兩種信號產(chǎn)生技術(shù)，優(yōu)勢互補。通過(guò)ADS結合Matlab對系統的模型建立和性能分析證明，該方案輸出信號性能優(yōu)良，完全能滿(mǎn)足設計要求，并已成功應用于某超寬帶通信系統。
  • 關(guān)鍵字： 產(chǎn)生  方案  信號  Chirp-UWB  DDS  PLL  基于  轉換器  

基于DDS技術(shù)的雜散分析及抑制方法

  • 頻率合成技術(shù)起源于二十世紀30年代，當時(shí)所采用的頻率合成方法是直接頻率合成。它是利用混頻、倍頻、分頻的方法由參考源頻率經(jīng)過(guò)加、減、乘、除運算，直接組合出所需要的的頻率。它的優(yōu)點(diǎn)是捷變速度快，相位噪
  • 關(guān)鍵字： DDS  雜散分析  方法    

基于FPGA的DDS信號發(fā)生器設計

  • 介紹基于DDS的信號發(fā)生器工作原理和設計過(guò)程，并對關(guān)鍵模塊及外圍電路進(jìn)行了仿真和誤差分析。經(jīng)功能驗證和分析測試，達到了預定的各項技術(shù)指標。旨在建立一種以FPGA為核心，功能可裁剪、波形任意調整的高性能信號發(fā)生器設計方法。采用該設計法將有效地降低開(kāi)發(fā)成本，提高設計效率，并具有一定的工程指導意義和實(shí)用價(jià)值。
  • 關(guān)鍵字： FPGA  DDS  信號發(fā)生器    

基于CPLD的DDS正交信號源的設計

  • 1 引言
    由于傳統的多波形函數信號發(fā)生器需采用大量分離元件才能實(shí)現，且設計復雜，這里提出一種基于CPLD的多波形函數信號發(fā)生器。它采用CPLD作為函數信號發(fā)生器的處理器，以單片機和CPLD為核心，輔以必要的模擬
  • 關(guān)鍵字： CPLD  DDS  信號源    
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dds介紹

DDS的簡(jiǎn)單介紹 　　DDS同 DSP（數字信號處理）一樣，是一項關(guān)鍵的數字化技術(shù)。DDS是直接數字式頻率合成器（Direct Digital Synthesizer）的英文縮寫(xiě)。與傳統的頻率合成器相比，DDS具有低成本、低功耗、高分辨率和快速轉換時(shí)間等優(yōu)點(diǎn)，廣泛使用在電信與電子儀器領(lǐng)域，是實(shí)現設備全數字化的一個(gè)關(guān)鍵技術(shù)。 　　一塊DDS芯片中主要包括頻率控制寄存器、高速相位累加器和正弦計算 [ 查看詳細 ]

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