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Cadence擴充系統IP產(chǎn)品組合,推出NoC以?xún)?yōu)化電子系統連接性

  • 楷登電子(美國Cadence公司)近日宣布擴充其系統 IP 產(chǎn)品組合,新增了 Cadence? Janus? Network-on-Chip(NoC)。隨著(zhù)當今計算需求的不斷提高,更大、更復雜的系統級芯片(SoC)和分解式多芯片系統在市場(chǎng)上迅速普及,硅組件內部和硅組件之間的數據傳輸變得越來(lái)越具有挑戰性,功率、性能和面積(PPA)受到了影響。Cadence Janus NoC 能夠以極低的延遲高效管理這些同步高速通信,幫助客戶(hù)以更低的風(fēng)險更快地實(shí)現其 PPA 目標?!癈adence是IP和設計質(zhì)量領(lǐng)域備受信
  • 關(guān)鍵字: Cadence  系統IP  NoC  電子系統連接性  

利用搭載全域硬2D NoC的FPGA器件去完美實(shí)現智能化所需的高帶寬低延遲計算

  • 隨著(zhù)大模型、高性能計算、量化交易和自動(dòng)駕駛等大數據量和低延遲計算場(chǎng)景不斷涌現,加速數據處理的需求日益增長(cháng),對計算器件和硬件平臺提出的要求也越來(lái)越高。發(fā)揮核心器件內部每一個(gè)計算單元的作用,以更大帶寬連接內外部存儲和周邊計算以及網(wǎng)絡(luò )資源,已經(jīng)成為智能化技術(shù)的一個(gè)重要趨勢。這使得片上網(wǎng)絡(luò )(Network-on-Chip)這項已被提及多年,但工程上卻不容易實(shí)現的技術(shù)再次受到關(guān)注。作為一種被廣泛使用的硬件處理加速器,FPGA可以加速聯(lián)網(wǎng)、運算和存儲,其優(yōu)點(diǎn)包括計算速度與ASIC相仿,也具備了高度的靈活性,能夠為數據
  • 關(guān)鍵字: 2D NoC  FPGA  

Sondrel為下一代多通道汽車(chē)SoC部署Arteris IP

  • Sondrel 和業(yè)界領(lǐng)先的提供片上網(wǎng)絡(luò )(NoC)互連和 IP部署軟件以加快SoC創(chuàng )建的系統級芯片(SoC)系統IP供應商Arteris IP近日宣布, Sondrel 在其下一代先進(jìn)駕駛輔助系統 (ADAS) 架構中采用 FlexNoC 互連 IP。選擇Arteris IP 的片上互連是因為其可配置性和性能。該產(chǎn)品可滿(mǎn)足 SFA 350A 多通道汽車(chē) IP 平臺的要求。FlexNoC 具有設計 NoC的能力,可以匹配 IP 模塊的性能,以確保數據以正確的速度流入、流出和圍繞SoC。它使設計人員能夠在預算
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Achronix在其先進(jìn)FPGA中集成2D NoC以支持高帶寬設計(WP028)

  • 摘要隨著(zhù)旨在解決現代算法加速工作負載的設備越來(lái)越多,就必須能夠在高速接口之間和整個(gè)器件中有效地移動(dòng)高帶寬數據流。Achronix的Speedster?7t獨立FPGA芯片可以通過(guò)集成全新的、高度創(chuàng )新的二維片上網(wǎng)絡(luò )(2D NoC)來(lái)處理這些高帶寬數據流。Achronix的FPGA中特有的2D NoC實(shí)現是一種創(chuàng )新,它與用可編程邏輯資源來(lái)實(shí)現2D NoC的傳統方法相比,有哪些創(chuàng )新和價(jià)值呢?本白皮書(shū)討論了這兩種實(shí)現2D NoC的方法,并提供了一個(gè)示例設計,以展示與軟2D NoC實(shí)現相比,Achronix 2D
  • 關(guān)鍵字: Achronix  FPGA  2D NoC  

在FPGA設計中如何充分利用NoC資源去支撐創(chuàng )新應用設計

  • 日益增長(cháng)的數據加速需求對硬件平臺提出了越來(lái)越高的要求,FPGA作為一種可編程可定制化的高性能硬件發(fā)揮著(zhù)越來(lái)越重要的作用。近年來(lái),高端FPGA芯片采用了越來(lái)越多的Hard IP去提升FPGA外圍的數據傳輸帶寬以及存儲器帶寬。但是在FPGA內部,可編程邏輯部分隨著(zhù)工藝提升而不斷進(jìn)步的同時(shí),內外部數據交換性能的提升并沒(méi)有那么明顯,所以FPGA內部數據的交換越來(lái)越成為數據傳輸的瓶頸。為了解決這一問(wèn)題,Achronix 在其最新基于臺積電(TSMC)7nm FinFET工藝的Speedster7t FPGA器件中包
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片上網(wǎng)絡(luò )(NoC)技術(shù)的發(fā)展及其給高端FPGA帶來(lái)的優(yōu)勢

  • 1. 概述在摩爾定律的推動(dòng)下,集成電路工藝取得了高速發(fā)展,單位面積上的晶體管數量不斷增加。片上系統(System-on-Chip,SoC)具有集成度高、功耗低、成本低等優(yōu)勢,已經(jīng)成為大規模集成電路系統設計的主流方向,解決了通信、圖像、計算、消費電子等領(lǐng)域的眾多挑戰性的難題。?隨著(zhù)片上系統SoC的應用需求越來(lái)越豐富,SoC需要集成越來(lái)越多的不同應用的IP(Intellectual Property)。另外,片上多核系統MPSoC(MultiProcessor-System-on-Chip)也已經(jīng)成
  • 關(guān)鍵字: NoC  SoC  

NETINT Technologies 再次為旗下 Codensity 企業(yè)級 SSD 控制器搭載 Arteris FlexNoC 總線(xiàn)互連 IP 技術(shù)

  • 作為經(jīng)過(guò)硅驗證的創(chuàng )新型 片上網(wǎng)絡(luò ) (NoC) 總線(xiàn)互連 IP 產(chǎn)品的領(lǐng)先供應商,Arteris IP 公司近日宣布 NETINT Technologies 公司再次獲得 Arteris FlexNoC 總線(xiàn)互連 IP 技術(shù)的授權,此項技術(shù)將應用于其下一代帶有片上視頻編碼處理器的企業(yè)級固態(tài)硬盤(pán) (SSD) 存儲系統控制器產(chǎn)品中。此前,NETINT 曾于 2019 年 1 月宣布首次購買(mǎi) Arteris IP 總線(xiàn)互連許可授權(參見(jiàn)“ NETINT Techn
  • 關(guān)鍵字: NoC  SSD  

芯擎科技采用 Arteris FlexNoC 總線(xiàn)互連和 Resilience套件的IP技術(shù),用于開(kāi)發(fā)符合ISO 26262 標準的車(chē)規級系統芯片

  • Arteris IP是一家經(jīng)過(guò)硅驗證的創(chuàng )新型?片上網(wǎng)絡(luò ) (NoC) 互連?IP 產(chǎn)品的領(lǐng)先供應商,近日宣布芯擎科技獲得 Arteris IP FlexNoC 總線(xiàn)互連和 FLexNoC Resilience 套件的IP授權,將其用作新一代汽車(chē)系統級芯片 (SoC) 總線(xiàn)連接的通信骨干網(wǎng)絡(luò )。芯擎科技由中國汽車(chē)行業(yè)領(lǐng)導者吉利集團以及安謀科技(中國)有限公司共同出資成立。其產(chǎn)品將成為下一代汽車(chē)數字駕駛艙、導航和信息娛樂(lè )系統的芯片中樞。Arteris FlexNoC 不僅能夠提升 SoC 性能
  • 關(guān)鍵字: NoC  安全  

Baidu購買(mǎi) IP 的FlexNoC?互聯(lián)產(chǎn)品 用于數據中心的昆侖人工智能(Kunlun AI)云芯片

  • 美國加利福尼亞州坎貝爾2019年4月18日消息—Arteris IP是經(jīng)過(guò)實(shí)際驗證的創(chuàng )新性片上網(wǎng)絡(luò )(NoC)互連知識產(chǎn)權(IP)產(chǎn)品的全球領(lǐng)先供應商,今天宣布Baidu已購買(mǎi)Arteris IP FlexNoC互連,用于該公司的供數據中心使用的高性能昆侖人工智能云芯片。百度的昆侖人工智能云芯片是獨一無(wú)二的產(chǎn)品,這是因為,無(wú)論它們是位于數據中心,還是位于車(chē)輛或消費電子等“周邊”設備中,既能夠進(jìn)行人工智能訓練,也能夠進(jìn)行推理,。百度首席架構設計師Jian Ouyang說(shuō):“Arteris的FlexNoc互連I
  • 關(guān)鍵字: 云計算  百度  NoC  

Arteris IP宣布推出新型FlexNoC?4互連IP 其中含有人工智能(AI)軟件包

  • 美國加利福尼亞州坎貝爾2019年04月11日消息—經(jīng)過(guò)實(shí)際驗證的創(chuàng )新性片上網(wǎng)絡(luò )(NoC)互連知識產(chǎn)權(IP)產(chǎn)品的全球領(lǐng)先供應商Arteris IP,宣布推出新的Arteris IP FlexNoC版本4互連IP和配套的人工智能(AI)軟件包。  FlexNoC 4和人工智能(“FlexNoC 4 AI”) 軟件包實(shí)現了許多新技術(shù),它們可以簡(jiǎn)化今天最復雜的人工智能(AI)、深度神經(jīng)網(wǎng)絡(luò )(DNN)和自主駕駛系統級芯片(SoC)的開(kāi)發(fā)?! rteris IP向一些世界領(lǐng)先的人工智能和深度學(xué)習(DN
  • 關(guān)鍵字: AI  NoC  IP  

Arteris片上互聯(lián)IP被中國三大IC設計公司采用

  • 這家在全世界領(lǐng)先的系統芯片(SoC)開(kāi)發(fā)商使用FlexNoC互連結構IP作為其產(chǎn)品的片上通信骨干網(wǎng)絡(luò ),用于連接現代系統芯片上的幾十個(gè)或幾百個(gè)IP塊。按收入排名位居前三名的中國半導體企業(yè),即深圳市海思半導體,展訊通信和銳迪科微電子,在他們最重要的系統芯片中使用Arteris公司的FlexNoC互連IP 。在大中華地區公開(kāi)宣布采用Arteris公司的FlexNoC互連IP的其他客戶(hù)包括全志科技,福州瑞芯微電子,珠海炬力和虹晶科技。據IHS iSuppli公司的數據,中國的大部分半導體公司得到授權使用Arter
  • 關(guān)鍵字: Ateris  NoC  互聯(lián)  

多核系統中NoC通訊架構的關(guān)鍵技術(shù)

  • 摘要 多核處理器已經(jīng)成為處理器的主流,并發(fā)展成為各種通信與媒體應用的主流處理平臺。通訊結構是多核系統中的核心技術(shù)之一,核間通信的效率是影響多核處理器性能的重要指標。目前有3種主要的通訊架構:總線(xiàn)系統結構
  • 關(guān)鍵字: 關(guān)鍵  技術(shù)  架構  通訊  NoC  系統  

一種基于FPGA的NoC驗證平臺的構建

  • 半導體工藝技術(shù)進(jìn)入深亞微米時(shí)代后,基于總線(xiàn)系統芯片SoC(SvstemonChip)的體系結構在物理設計、通信帶...
  • 關(guān)鍵字: FPGA  NoC  驗證平臺  

基于FPGA的NoC驗證平臺的構建

  • 基于FPGA的NoC驗證平臺的構建,針對基于軟件仿真片上網(wǎng)絡(luò )NoC(Network on Chip)效率低的問(wèn)題,提出基于FPGA的NoC驗證平臺構建方案。該平臺集成可重用的流量產(chǎn)生器TG(Traffic Generation),流量接收器TR(Traffic Receiver)以及NoC軟件,用于對NoC原型系統進(jìn)行功能驗證和性能評估。實(shí)際設計一個(gè)多核NoC,并用該平臺對其進(jìn)行FPGA驗證,結果表明該平臺的驗證速度比軟件仿真提高16 000倍以上,并能對多種不同結構、路由算法、流控策略的NoC進(jìn)行功能驗
  • 關(guān)鍵字: 平臺  構建  驗證  NoC  FPGA  基于  數字信號  

片上網(wǎng)絡(luò )(NoC)技術(shù)發(fā)展現狀及趨勢淺析

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noc介紹

NoC(Network on a Chip),意即片上網(wǎng)絡(luò ). 是指在單芯片上集成大量的計算資源以及連接這些資源的片上通信網(wǎng)絡(luò )。NoC包括計算和通信兩個(gè)子系統,計算子系統(完成廣義的“計算”任務(wù),PE既可以是現有意義上的CPU、SoC,也可以是各種專(zhuān)用功能的IP核或存儲器陣列、可重構硬件等;通信子系統負責連接PE,實(shí)現計算資源之間的高速通信。通信節點(diǎn)及其間的互連線(xiàn)所構成的網(wǎng)絡(luò )被稱(chēng)為片上通信網(wǎng)絡(luò )(O [ 查看詳細 ]

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