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高速實(shí)時(shí)數據采集
高速實(shí)時(shí)數據采集 文章 進(jìn)入高速實(shí)時(shí)數據采集技術(shù)社區
雙通道邏輯控制高速實(shí)時(shí)數據采集系統的設計
- 設計了一種全新構架的高性能數據采集系統。采用平衡式雙通道對稱(chēng)結構，可對32路輸入信號進(jìn)行靈活控制。系統中采用了高速A/D轉換器、大容量的FIFO SRAM、CPLD技術(shù)和PCI數據通信接口，實(shí)現了實(shí)時(shí)、高速的數據采集和處理。
- 關(guān)鍵字： 高速實(shí)時(shí)數據采集 平衡式雙通道 CPLD
高速實(shí)際據采集智能控制器的設計與實(shí)現
- 摘要：文章以嵌入式和數據采集技術(shù)為基礎，研究設計并實(shí)現了基于A(yíng)RM+FPGA體系架構面向高速實(shí)時(shí)數據采集應用的一種實(shí)用新型智能控制器。本文闡述了主處理器ARM最小系統、協(xié)處理器FPGA最小系統和ARM與FPGA通信接口等硬
- 關(guān)鍵字： ARM FPGA 智能控制器 高速實(shí)時(shí)數據采集
基于PCI總線(xiàn)的高速實(shí)時(shí)數據采集系統
- 摘 要：本文介紹了一種基于PCI總線(xiàn)的高速實(shí)時(shí)數據采集系統的設計與實(shí)現方法，主要討論了高速數據采集的存儲與傳輸的硬件解決方案，以及該系統的控制邏輯的實(shí)現，最后給出了控制邏輯仿真波形。關(guān)鍵詞：PCI總線(xiàn)；CPCI總線(xiàn)；高速實(shí)時(shí)數據采集；FIFO；CPLD 引言目前的大多數雷達信號處理機都是采用自定義總線(xiàn)，不具有通用性，每進(jìn)行一些系統功能的改變就需要大量的硬件改動(dòng)。而CPCI總線(xiàn)作為一種新興的工業(yè)總線(xiàn)，其采用了PCI總線(xiàn)的電氣特性以及VME總線(xiàn)的物理特性，兼具了二者的優(yōu)點(diǎn)
- 關(guān)鍵字： CPCI總線(xiàn) CPLD FIFO PCI總線(xiàn) 高速實(shí)時(shí)數據采集
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高速實(shí)時(shí)數據采集介紹
您好，目前還沒(méi)有人創(chuàng )建詞條高速實(shí)時(shí)數據采集!
歡迎您創(chuàng )建該詞條，闡述對高速實(shí)時(shí)數據采集的理解，并與今后在此搜索高速實(shí)時(shí)數據采集的朋友們分享。 創(chuàng )建詞條
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