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雷達信號
雷達信號 文章 進(jìn)入雷達信號技術(shù)社區
AURIX TC3xx雷達信號處理CFAR算法詳解
- CFAR是非常普遍的信號過(guò)濾手段，用于提取超過(guò)動(dòng)態(tài)閾值的點(diǎn)目標信息。AURIX? TC3xx單片機的雷達信號處理單元SPU集成了該硬件功能，并且提供兩種典型的CFAR算法。英飛凌技術(shù)專(zhuān)家 錢(qián)偉喆背景介紹當雷達回波信號功率幅值超過(guò)某個(gè)閾值時(shí)，能被檢測到，該閾值不可能是固定的，必須根據周?chē)h(huán)境、目標分布反射強弱，雜波噪聲干擾等動(dòng)態(tài)變化，而CFAR（constant false alarm rate）就是用于計算動(dòng)態(tài)閾值的典型手段。CFAR直接影響檢測概率（probability of detection）【1
- 關(guān)鍵字： 英飛凌 AURIX 雷達信號 CFAR
基于CPLD的雷達仿真信號的設計
- 雷達信號的仿真是測試系統中必不可少的。但采用函數/任意波發(fā)生器組成測試系統，不僅增加系統成本，而且還給系統軟件設計增加不必要的負擔。為此，提出了一種基于CPLD的雷達仿真信號的實(shí)現方案，它能為機載雷達測試系統提供所需的多種典型的重頻脈沖及制導信號。
- 關(guān)鍵字： 雷達信號 任意波發(fā)生器 CPLD
基于Spartan-6的船用雷達信號處理及顯控系統
- 傳統的船用雷達信號處理和顯示控制系統都是采用FPGA+工控機方案，FPGA用于高速雷達信號的處理，工控機用于運行操作系統、實(shí)現圖形用戶(hù)界面。這種方案的優(yōu)點(diǎn)是利用了FPGA和工控機各自的優(yōu)點(diǎn)進(jìn)行了合理的搭配，缺點(diǎn)是增加了系統的復雜度、成本高、系統的穩定性降低。
- 關(guān)鍵字： 雷達信號 MicroBlaze
用FPGA技術(shù)實(shí)現模擬雷達信號
- 前言FPGA（現場(chǎng)可編程門(mén)陣列）是由掩膜可編程門(mén)陣列和PLD（可編程邏輯器件）演變而來(lái)的，并將二者的特性結合在一起，使FPGA既有掩膜可編程門(mén)陣列的高邏輯密度和通用性，又有PLD的可編程特性。FPAG技術(shù)的發(fā)展使得單個(gè)
- 關(guān)鍵字： FPGA 技術(shù)實(shí)現 模擬 雷達信號
雷達信號介紹
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