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EEPW首頁(yè) >> 主題列表 >> 編解碼器

基于FPGA的HDB3編解碼器設計

  • 基于FPGA的HDB3編解碼器設計,本方案設計模塊可以作為IP(Intellectual Property)核,與嵌入式處理器及其他功能模塊或IP芯核相結合在一片FPGA上構成片上可編程系統SOPC,使得所設計的系統在其規模、可靠性、體積、功耗、性能等方面實(shí)現最優(yōu)化。
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黃金幀編解碼器實(shí)現高質(zhì)量實(shí)時(shí)網(wǎng)絡(luò )視頻

TMS320DM642在移動(dòng)平臺ATP技術(shù)中的應用

  • TMS320DM642在移動(dòng)平臺ATP技術(shù)中的應用,介紹了一種DSP數字處理器TMS320DM642在移動(dòng)平臺ATP技術(shù)中的應用。DSP處理CCD采集的圖像信號,并將相應信息實(shí)時(shí)反饋給電機控制部分,立即作出相應調整從而控制(2CD運動(dòng),使光斑落在視場(chǎng)中心。移動(dòng)平臺ATP(信標光捕獲跟蹤瞄準)技術(shù)是實(shí)現空間激光通信的關(guān)鍵技術(shù),在衛星和航空航天等大容量通信方面具有巨大應用前景。
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LSI的嵌入式體驗質(zhì)量監控技術(shù)

  • 確保 QoE:我們需要什么樣的體驗質(zhì)量?哪些薄弱環(huán)節需要加強?如何提高體驗質(zhì)量?

    高級體驗質(zhì)量將決定電信級互聯(lián)網(wǎng)視頻能否得到廣泛推廣?;ヂ?lián)網(wǎng)視頻的體驗質(zhì)量包羅萬(wàn)象,比如最后一英里的 IP 數據包交付保證解決
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我國數字電視標準技術(shù)對比與分析

  • 2006年9月,國家廣電總局頒布了我國地面數字電視國家標準,該標準是清華DMB-T方案和上海交大ADTB-T方案的融合體,前者采用單載波調制,后者采用多載波調制。本文介紹了單載波調制和多載波調制的工作原理,以及ADTB-T
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利用多內核處理器的并行編程功能實(shí)現視頻代碼轉換

  • 利用多內核處理器的并行編程功能實(shí)現視頻代碼轉換,視頻代碼轉換是指從一種壓縮視頻格式轉換為另一種壓縮視頻格式,通常先要把某種格式解碼為原始視頻幀,然后用新的格式重新編碼。在許多應用中高效的代碼轉換至關(guān)重要。例如,為了支持視頻點(diǎn)播數據流,視頻數據要以某種主流格式存儲起來(lái)以節省空間,但必須支持眾多不同的觀(guān)看設備和解碼器。為了做到這一點(diǎn),需要在數據發(fā)送前以實(shí)時(shí)或者快于實(shí)時(shí)的速度進(jìn)行代碼轉換。在視頻節目制作階段進(jìn)行視頻編輯時(shí),也必須對視頻數據進(jìn)行解碼、修改和重新編碼。在普通家庭,為了能在家用視頻服務(wù)器上使用視頻,視
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利用SoC平臺設計并驗證MPEG-4/JPEG編解碼IP

  • 隨著(zhù)硅工藝在幾何尺寸上的不斷縮小,芯片的設計者事實(shí)上能將所有系統功能整合在單一芯片上。許多芯片制造商和設計者在面對客戶(hù)對于多功能、低功耗、低成本及小型化的需求時(shí),認為SoC的高集成度是解決問(wèn)題的萬(wàn)能藥方。不幸的是,設計的生產(chǎn)力跟不上摩爾定律的速度。
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基于A(yíng)RM926EJ-S的MPEG-4軟解碼器的優(yōu)化與實(shí)現

  • 基于A(yíng)RM926EJ-S的MPEG-4軟解碼器的優(yōu)化與實(shí)現,MPEG-4視頻壓縮標準自問(wèn)世以來(lái)受到人們的廣泛關(guān)注。近幾年,嵌入式應用中對MPEG-4播放器的實(shí)現已經(jīng)成為眾多廠(chǎng)家的研究熱點(diǎn)。專(zhuān)用的MPEG-4播放芯片已經(jīng)非常普遍,但是減少功耗和降低成本一直是商家追求的目標,因此,隨著(zhù)嵌入式的主流微處理器ARM的處理能力越來(lái)越強,用他來(lái)實(shí)現MPEG-4系統的軟解碼成為了眾多嵌入式設計公司研究的重點(diǎn)內容。由于MPEG-4系統龐大且需要大量的數據處理,因此在A(yíng)RM中實(shí)現MPEG-4軟解碼需要對其原算法進(jìn)行充分的優(yōu)
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多制式語(yǔ)音編碼及其DSP實(shí)現

  • 介紹了一種多制式語(yǔ)音編解碼器,在單片TMS320VC5409上完成4路話(huà)音的全雙工通信,并實(shí)現G.729a、CVSD、ADPCM算法之間的編碼轉換,給出了算法的軟硬件實(shí)現、算法的運算量及所占用的硬件資源。
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基于TMS320C5416的G.729語(yǔ)音編解碼算法的優(yōu)化和實(shí)現

  • 通過(guò)分析G.729語(yǔ)音編解碼算法和TMS320VC5416的原理,提出了有效優(yōu)化算法的方案,降低了算法的復雜度,把優(yōu)化的G.729算法在TMS320VC5416的系統板實(shí)現,完成對輸入語(yǔ)音或數據的壓縮、存儲及回放。
  • 關(guān)鍵字: 算法  優(yōu)化  實(shí)現  解碼  語(yǔ)音  TMS320C5416  G.729  基于  編解碼器  

基于C5509A的功放閉環(huán)數字控制系統的設計

通過(guò)IPTV接收無(wú)閃爍電視

  • 網(wǎng)絡(luò )電視也稱(chēng)為IPTV,是三網(wǎng)合一應用中向用戶(hù)提供的語(yǔ)音(VoIP)和數據服務(wù)之外的第三種服務(wù)?,F有IPTV用戶(hù)中,約80%通過(guò)xDSL接入,因此ADSL2+是現階段的首選IPTV操作平臺。盡管VDSL2帶寬更高,但ADSL2+卻擁有覆蓋范圍更廣、成本更低這兩項明顯的優(yōu)勢??梢灶A計,在未來(lái)數年里,這兩項xDSL技術(shù)將繼續被用于IPTV,并且相得益彰。由于xDSL采用常規的銅導線(xiàn)傳輸,而銅導線(xiàn)這種傳輸介質(zhì)本身易受干擾,因此IPTV有時(shí)也會(huì )受到影響?,F在,已有創(chuàng )新性技術(shù)能夠實(shí)現無(wú)干擾的IPTV接收。
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高集成度環(huán)繞聲編解碼器降低音頻系統設計門(mén)檻

基于NiosII的 低碼率實(shí)時(shí)H.264視頻編碼器

  • 根據低碼率實(shí)時(shí)應用領(lǐng)域的特點(diǎn),設計了一種H.264視頻編碼系統。采用FPGA的NiosII CPU架構,自定義硬件模塊實(shí)現H.264.實(shí)時(shí)壓縮編碼。實(shí)驗驗證表明,H.264編碼器對CIF大小的圖像實(shí)現了實(shí)時(shí)編碼,能滿(mǎn)足對低碼率實(shí)時(shí)應用的編碼要求。
  • 關(guān)鍵字: 編解碼器  H.264  NiosII   CPU  

用數字信號處理器優(yōu)化視頻編碼器

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編解碼器介紹

編解碼器(codec)指的是一個(gè)能夠對一個(gè)信號或者一個(gè)數據流進(jìn)行變換的設備或者程序。這里指的變換既包括將信號或者數據流進(jìn)行編碼(通常是為了傳輸、存儲或者加密)或者提取得到一個(gè)編碼流的操作,也包括為了觀(guān)察或者處理從這個(gè)編碼流中恢復適合觀(guān)察或操作的形式的操作。編解碼器經(jīng)常用在視頻會(huì )議和流媒體等應用中。 經(jīng)過(guò)編碼的音頻或者視頻原始碼流經(jīng)常被叫做“Essence”(有譯作“本體”,“精”),以區別于 [ 查看詳細 ]

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