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EEPW首頁(yè) >> 主題列表 >> 內核優(yōu)化

Tensilica和Virage推出針對鉆石處理器內核優(yōu)化的IP設計工具包

  •  Tensilica和Virage Logic( 納斯達克: VIRL)日前聯(lián)手推出16種專(zhuān)為T(mén)ensilica公司鉆石系列標準處理器特別設計的針對內核優(yōu)化的IP Kit，分別采用了TSMC 130納米 和90納米 G 制造工藝。 這些最新的針對內核優(yōu)化的IP Kit由Virage Logic公司 ASAP(面積,速度和功耗) 存儲器和ASAP 邏輯IP核組
  • 關(guān)鍵字： IP設計  Tensilica  Virage  單片機  工具包  內核優(yōu)化  嵌入式系統  鉆石處理器  
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內核優(yōu)化介紹

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