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利用USB2.0單片機實(shí)現全數字圖像的實(shí)時(shí)采集

  • 主要論述利用USB2.0單片機接口技術(shù)實(shí)現高分辨率（640times;480點(diǎn)陣以上）、快速（24幀/s以上）全數字圖像的實(shí)時(shí)采集、傳輸的原理、方法和系統實(shí)現，以及相應的固件程序設計。引言傳統的方法是用視頻采集卡（如1394）
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ARM(STM32F107)的全數字控制逆變器設計

  • 1.系統總體方案1.1總體設計框圖如圖1所示，逆變器系統由升壓電路、逆變電路、控制電路和反饋電路組成。低...
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一種基于VHDL語(yǔ)言的全數字鎖相環(huán)的實(shí)現

  • 　隨著(zhù)集成電路技術(shù)的不斷進(jìn)步，數字化應用逐漸普及，在數字通信、電力系統自動(dòng)化等方面越來(lái)越多地運用了數字鎖相環(huán)。它的好處在于免去了模擬器件的繁瑣，而且成本低、易實(shí)現、省資源。本文綜合以上考慮，在一片FPGA
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基于FPGA的智能全數字鎖相環(huán)的設計

  • 1 引言數字鎖相環(huán)路已在數字通信、無(wú)線(xiàn)電電子學(xué)及電力系統自動(dòng)化等領(lǐng)域中得到了極為廣泛的應用。隨著(zhù)集成電路技術(shù)的發(fā)展，不僅能夠制成頻率較高的單片集成鎖相環(huán)路，而且可以把整個(gè)系統集成到一個(gè)芯片上去。在基于FP
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開(kāi)關(guān)磁阻電機全數字控制系統中FPGA的應用

  • 摘要：提出了基于數字信號處理器(DSP)和現場(chǎng)可編程門(mén)陣列(FPGA)的開(kāi)關(guān)磁阻電動(dòng)機全數字控制系統，對DSP和FPGA的功能進(jìn)行了分配。根據開(kāi)關(guān)磁阻電動(dòng)機的驅動(dòng)要求，分析控制邏輯，由FPGA實(shí)現了電流斬波、角度位置和PWM電
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基于USB2.0單片機的全數字圖像的實(shí)時(shí)采集設計

  • 摘要：主要論述利用USB2.0單片機接口技術(shù)實(shí)現高分辨率（640times;480點(diǎn)陣以上）、快速（24幀/s以上）全數字圖像的實(shí)時(shí)采集、傳輸的原理、方法和系統實(shí)現，以及相應的固件程序設計。引言傳統的方法是用視頻采集卡（如
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采用全數字控制方式的汽車(chē)HID氙氣燈解決方案

  • 過(guò)去汽車(chē)車(chē)燈多采用普通鹵素燈泡，這種車(chē)燈的瓦數和亮度不夠、色溫過(guò)低、燈色偏黃，而且壽命較短，故障率偏高。日前，HID(High Intensity DischargeLamp)氙氣燈正在汽車(chē)車(chē)燈領(lǐng)域興起，與傳統鹵素燈相比，HID氙氣燈具
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全數字智能鉗型吊電氣控制系統的設計方法

  • 概述：本文研究了全數字智能鉗型吊電氣控制系統的設計方法，設計出了以PLC及MENTORⅡ為核心的控制方案。該方案極大的提高了鉗型吊的工作效率、可靠性及控制精度，降低了能耗。實(shí)驗結果證明了此方案的有效性。

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采用VHDL設計的全數字鎖相環(huán)電路設計

  • 摘要:敘述了全數字鎖相環(huán)的工作原理,提出了應用VHDL 技術(shù)設計全數字鎖相環(huán)的方法,并用復雜可編程邏輯器件CPLD 予以實(shí)現,給出了系統主要模塊的設計過(guò)程和仿真結果。0 　引言全數字鎖相環(huán)(DPLL) 由于避免了模擬鎖相環(huán)存
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一種可編程的全數字鎖相環(huán)路的實(shí)現

  • 鎖相環(huán)路已在模擬和數字通信及無(wú)線(xiàn)電電子學(xué)等各個(gè)領(lǐng)域中得到了極為廣泛的應用，特別是在數字通信的調制解調和位同步中常常要用到各種各樣的鎖相環(huán)。鎖相就是利用輸入信號與輸出信號之間的相位誤差自動(dòng)調節輸出相位
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一種自動(dòng)變?？刂频膶掝l帶全數字鎖相環(huán)

  • 針對傳統的全數字鎖相環(huán)只能鎖定已知信號和鎖頻范圍較小的問(wèn)題，提出了一種自動(dòng)變?？刂频膶掝l帶全數字鎖相環(huán)。對比分析了各類(lèi)全數字鎖相環(huán)鎖頻、鎖相的工作機理，提出了一種新的系統模型，重點(diǎn)研究了快速鎖定和頻帶拓寬的原理及實(shí)現方法。應用EDA技術(shù)完成系統設計，并進(jìn)行計算機仿真。仿真結果證實(shí)了該設計具有快的鎖定速度、寬的鎖頻范圍、并能快速跟蹤頻率突變的輸入信號。該鎖相環(huán)通用性強，易于集成，可作為IP核用于SoC的設計。
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全數字鎖相環(huán)的設計及分析

  • 　　1 引 言　　鎖相環(huán)是一種能使輸出信號在頻率和相位上與輸入信號同步的電路，即系統進(jìn)入鎖定狀態(tài)(或同步狀態(tài))后，震蕩器的輸出信號與系統輸入信號之間相差為零，或者保持為常數。傳統的鎖相環(huán)各個(gè)部件都是由模擬電
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基于FPGA的全數字鎖相環(huán)的設計

  • 簡(jiǎn)單介紹了全數字鎖相環(huán)(ADPLL)的結構和工作原理，提出一種在FPGA的基礎上可增大全數字鎖相環(huán)同步范圍的設計方法，并給出了部分verilog HDL設計程序的代碼和仿真波形。
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全數字三相昌閘管觸發(fā)器IP軟核設計

  • 本文利用先進(jìn)的EDA軟件，用VHDL硬件描述語(yǔ)言采用自頂向下的模塊化設計方法，完成了具有相序自適應功能的雙脈沖數字移相觸發(fā)器的IP軟核設計。
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基于FPGA的高階全數字鎖相環(huán)的設計與實(shí)現

  • 本文提出了一種基于PI 控制算法的三階全數字鎖相環(huán)，采用EDA 技術(shù)進(jìn)行系統設計，并用可編程邏輯器件予以實(shí)現。
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